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          基于FPGA多路機載冗余圖像處理系統(tǒng)的設(shè)計方案
          
						
          
				作者：趙小珍 劉波 朱標(biāo) 陳文明
				時間：2014-02-13
				來源：摘自《電子發(fā)燒友》
				
				
				
				
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          　　2 SDRAM 視頻緩存設(shè)計
          本文引用地址：http://www.ex-cimer.com/article/221481.htm

          　　2.1 SDRAM選擇依據(jù)
          

          　　整個系統(tǒng)顯示的分辨率為1600×1200@60 Hz，信號位為真彩色24b，則一幀圖像所需需要存儲的容量C = 1 600×1 200×24=46 080 000 b≈47 Mb;考慮到SDRAM乒乓操作和容量等問題，選用MICRO公司生產(chǎn)的容量為128M的MT48LC4M32B2TG-6器件，速度等級6，時鐘頻率達到166 MHz.該器件具有32根數(shù)據(jù)線和12根地址線，還有一些控制線。通過在FPGA內(nèi)部搭建邏輯控制單元，可以很好的控制SDRAM 視頻信號的翻轉(zhuǎn)等操作。
          

          　　2.2 FPGA內(nèi)部原理邏輯框圖
          

          　　FPGA內(nèi)部原理邏輯框圖如圖3所示。
          

          

          　　2.2.1 FPGA內(nèi)部邏輯功能介紹
          

          　　(1)信號輸入模塊
          

          　　這部分的主要功能是接收外部輸入的視頻信號，增強輸入信號的驅(qū)動能力，為信號的后續(xù)處理做準(zhǔn)備。其用Verilog 語言實現(xiàn)的邏輯代碼如下所示：
          

          
				
            
                
			
							
          
                
			            
                            
              
            
          
		
          
		
          
		
          
		
          
		
          
			
            
				
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          關(guān)鍵詞：
            			            FPGA
                        DVI
                        視頻
                        均衡器
                        SDRAM
                        
            
          
            
			
          
		
          	
		

	

          
	
	
          
		
          
			
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