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          一種新型告訴浮點多DSP并行處理系統(tǒng)結(jié)構(gòu)

          作者: 時間:2009-01-09 來源:網(wǎng)絡 收藏

            傳統(tǒng)的雷達信號處理系統(tǒng)的設計是根據(jù)具體的需求確定算法流程以及硬件結(jié)構(gòu)的。這導致了系統(tǒng)升級的困難加大。當信號處理的內(nèi)容改變、要求處理的數(shù)據(jù)量加大、改進處理算法時,必須對整個系統(tǒng)進行重新設計。

            利用軟件無線電的原理,可以構(gòu)建通用的硬件平臺,輔之以必要的軟件系統(tǒng),能實現(xiàn)各種信號處理功能。

            本結(jié)構(gòu)采用高速浮點(A-21161N)。A-21161集成了一個性能優(yōu)良的浮點DSP核和豐富的在片功能,并且提供了實用可靠的多處理器互聯(lián)及的方式。以六片ADSP-21161N構(gòu)成的多處理器結(jié)構(gòu)具有強大的處理能力,可以完成各種高速實時信號處理功能。

            實時信號處理要求巨大的計算量與超高速的計算速度,而現(xiàn)在的單片DSP很難滿足要求,因此必須采用合理的多DSP并行計算結(jié)構(gòu)。雷達信號處理的特點要求處理結(jié)點具有大的I/O帶寬,以實現(xiàn)高數(shù)據(jù)吞吐能力,通用的系統(tǒng)還必須支持多種算法,因此應能根據(jù)不同并行算法的要求靈活地改變多DSP并行計算的拓撲結(jié)構(gòu),并提供方便多樣的相互通信手段。

          一種新型多DSP并行處理結(jié)構(gòu)

            1 ADSP-21161N芯片簡介

            ADSP-21161N是美國ADI公司近斯推出的功能強大的32bit浮點DSP芯片,采用超級哈佛結(jié)構(gòu),擁有多條內(nèi)部總線、高速運算單元、大容量存儲器、靈活多樣的外部接口。它的核心工作頻率可達100MHz,外部總線工作頻率可達50MHz。由于其內(nèi)部包括兩組處理單元,每組又運用三級流水線結(jié)構(gòu)進行處理,故而運算處理速度可達達到600MIPS,以此來實現(xiàn)DSP的低工作頻率、高處理能力的功能可以降低功耗。

            大容量內(nèi)部雙端口SRAM,容量可達到1Mbit,分成兩個存儲區(qū),一個周期可同時完成指令代碼及操作數(shù)的存取,并可任意設置成16位、32位或48位字寬,給不同的應用帶一籽方便。

            主機(HOST)與多處理器接口無需外部電路,依靠片內(nèi)總線仲裁邏輯和DMA控制器的支持,能夠方便地構(gòu)成緊耦合的共享總線/共享存儲器的并行系統(tǒng)。在片的SDRAM控制器,可直接管理SDRAM,多DSP之間可以很好地協(xié)調(diào)共同使用SDRAM,從而構(gòu)成一個一體化的處理系統(tǒng)。

            兩套雙向高速LINK數(shù)據(jù)傳輸,每套LINK口受獨立的DMA控制 器、發(fā)送/接收數(shù)據(jù)FIFO的支持,可進行最高達100MB/s的高速數(shù)據(jù)傳,大大提高了能力,可借以構(gòu)成松耦合的分布式并行系統(tǒng)。

            另外,還有SPI接口、可編程I/O管腳(FLAG)以及同步串口等通信端口。


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          關鍵詞: DSP 并行處理

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