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UPD78F0411 系統(tǒng)時鐘振蕩器
- UPD78F0411 系統(tǒng)時鐘振蕩器
1.1 X1 振蕩器
X1 振蕩器采用晶體振蕩器或陶瓷振蕩器(2 ~ 10MHz),連接到X1 和X2 引腳。
同樣可以輸入外部時鐘。EXCLK 引腳輸入時鐘信號。
圖5-10 為X1 振蕩器的外部電路示例。
1 - 關(guān)鍵字: 振蕩器 時鐘 系統(tǒng) UPD78F0411
基于OpenBus系統(tǒng)的FPGA嵌入式設(shè)計與實現(xiàn)
- 隨著FPGA技術(shù)的發(fā)展,F(xiàn)PGA設(shè)計已不再只是硬件電路的設(shè)計,而是包含處理器、外國組件和接口邏輯在內(nèi)的完整數(shù)字系統(tǒng),同時在處理器中編程完成嵌入式代碼的FPGA“軟”設(shè)計。與傳統(tǒng)的主要基于硬件描述語言進行FPGA設(shè)計井發(fā)不同,本文在電路設(shè)計軟件Altium Desi gner開發(fā)環(huán)境下,結(jié)合Xilinx公司的ISE設(shè)計軟件,在Altium Designer的創(chuàng)新電子設(shè)計平臺NanoBoard 3000上,設(shè)計實現(xiàn)了基于Altium Designer特有的系統(tǒng)級設(shè)計方法OpenBus系
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基于W77E58的多路數(shù)據(jù)采集系統(tǒng)的設(shè)計與實現(xiàn)
- 為了對實際信號進行監(jiān)測,設(shè)計了以W77E58微控制器為核心的多路數(shù)據(jù)采集系統(tǒng),介紹了系統(tǒng)總體結(jié)構(gòu),闡明了模擬量采集的硬件和軟件設(shè)計方法,給出了具體的電路圖和軟件程序,經(jīng)實際測試表明,該系統(tǒng)具有采集精度高、功耗低、抗干擾能力強、通用性好的特點。
- 關(guān)鍵字: W77E58 多路數(shù)據(jù)采集 系統(tǒng)
多路數(shù)據(jù)采集系統(tǒng)的設(shè)計與實現(xiàn)
- 設(shè)計了一個基于ARM芯片的多路數(shù)據(jù)采集系統(tǒng),可以實現(xiàn)對8路數(shù)據(jù)的采集,信號的采集方式可以是單路采集也可以是多路循環(huán)采集,控制信號可通過觸摸屏或上位機控制輸入,數(shù)據(jù)采集的結(jié)果以數(shù)字和圖形的方式在液晶屏上實時顯示。經(jīng)軟硬件綜合調(diào)試,驗證了方案的可行性。
- 關(guān)鍵字: 多路數(shù)據(jù)采集 系統(tǒng)
基于消息機制的片上多處理器系統(tǒng)的研究
- 描述了一種基于消息機制構(gòu)建的片上多處理器系統(tǒng)。該系統(tǒng)采用主從結(jié)構(gòu),運用消息進行通信,并且從處理器之間彼此相互獨立,在硬件結(jié)構(gòu)與軟件設(shè)計上保持一致。這樣不僅簡化了系統(tǒng)的設(shè)計,更使得系統(tǒng)具有一定的容錯性與穩(wěn)定性。最后在Quartus軟件中設(shè)計并且綜合,在該系統(tǒng)下運行JPEG編碼算法,當運行于100 MHz時,測得系統(tǒng)在不同個數(shù)處理器時的處理性能,滿足了設(shè)計要求。
- 關(guān)鍵字: 消息機制 多處理器 系統(tǒng)
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