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UPD78F0411 時鐘控制（2）
- UPD78F0411 時鐘控制（2）
1.4 控制內(nèi)部低速振蕩時鐘示例
內(nèi)部低速振蕩時鐘不能用作CPU 時鐘。
只有如下外部硬件可以使用這個時鐘。
#61623;看門狗定時器
#61623;8 位定時器H1 (選擇fRL, fRL/27 或fRL/29 作為 - 關(guān)鍵字： 控制 時鐘 UPD78F0411
UPD78F0411 時鐘控制（1）
- UPD78F0411 時鐘控制（1）
UPD78F0411 時鐘控制
1.1 控制高速系統(tǒng)時鐘示例
如下兩種高速系統(tǒng)時鐘可用。
#61623;X1 時鐘: 晶體/陶瓷振蕩器連接到X1 和X2 引腳。
#61623;外部主系統(tǒng)時鐘: 外部時鐘輸入到EXCLK 引 - 關(guān)鍵字： 控制 時鐘 UPD78F0411
UPD78F0411 系統(tǒng)時鐘振蕩器
- UPD78F0411 系統(tǒng)時鐘振蕩器
1.1 X1 振蕩器
X1 振蕩器采用晶體振蕩器或陶瓷振蕩器(2 ～ 10MHz)，連接到X1 和X2 引腳。
同樣可以輸入外部時鐘。EXCLK 引腳輸入時鐘信號。
圖5-10 為X1 振蕩器的外部電路示例。
1 - 關(guān)鍵字： 振蕩器 時鐘 系統(tǒng) UPD78F0411
免費的 I/O：改進 FPGA 時鐘分配控制(圖)
- 同步數(shù)字系統(tǒng)中的時鐘信號(如遠程通信中使用的)為系統(tǒng)中的數(shù)據(jù)傳送定義了時間基準。一個時鐘分配網(wǎng)絡(luò)由多個時鐘信號組成，由一個點將所有信號分配給需要時鐘信號的所有組件。因為時鐘信號執(zhí)行關(guān)鍵的系統(tǒng)功能，很顯然應(yīng)給予更多的關(guān)注，不僅在時鐘的特性(即偏移和抖動)方面，還有那些組成時鐘分配網(wǎng)絡(luò)的組件。 FPGA開發(fā)團隊不斷面臨過于繁瑣、復(fù)雜的時鐘網(wǎng)絡(luò)的挑戰(zhàn)。各種因素，包括不斷增加的I/O需求、降低成本的要求和減少印刷電路板設(shè)計更改的需要，迫使設(shè)計人員重新審視時鐘網(wǎng)絡(luò)。本文將探討FPGA時鐘分配控制方面的挑戰(zhàn)
- 關(guān)鍵字： FPGA 時鐘
時鐘介紹
時鐘的概念多用于數(shù)字語音交換機，因為數(shù)字交換對于以時隙為單位的交換單位而言，其時間性的重要程度非常高。為保證交換機的正常工作，每套交換系統(tǒng)都必須配置精度極高的時鐘發(fā)生器，用于交換系統(tǒng)內(nèi)部工作。系統(tǒng)內(nèi)部的時鐘一般稱為內(nèi)時鐘。
如果兩套交換系統(tǒng)協(xié)調(diào)工作，那么必須要在兩套系統(tǒng)之家，也就是兩個內(nèi)時鐘之間進行協(xié)調(diào)，保證兩個時鐘同步工作，這就是時鐘同步，對于每套系統(tǒng)的內(nèi)時鐘而言，另一套系統(tǒng)的內(nèi)時鐘即為外時鐘 [ 查看詳細 ]
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