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結(jié)合超寬帶測距和雷達(dá)功能以實(shí)現(xiàn)高級IoT應(yīng)用 11.14珠海｜與泰克共探半導(dǎo)體產(chǎn)業(yè)鏈來這里瞧瞧NXP技術(shù)培訓(xùn)視頻吧>> 來學(xué)習(xí)NXP基于i.MX處理器的工業(yè)解決方案吧！

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高速文章進(jìn)入高速技術(shù)社區(qū)

正確選擇輸入網(wǎng)絡(luò)，優(yōu)化高速ADC的動態(tài)性能和增益平坦度

摘要：該應(yīng)用筆記論述了如何選擇適當(dāng)?shù)淖儔浩骱蜔o源元件，并在不犧牲高速ADC動態(tài)性能的情況下獲得較寬的輸入頻響的增益平坦度。
對于較高IF的模/數(shù)轉(zhuǎn)換器(ADC)，正確選擇板級元器件是滿足高動態(tài)性能和較寬增益平坦
關(guān)鍵字：動態(tài) 性能增益平坦 ADC 高速選擇輸入網(wǎng)絡(luò) 優(yōu)化正確

正確理解和比較高速ADC的產(chǎn)品說明書

和一個產(chǎn)品的任何其他方面一樣，產(chǎn)品說明書也可以得到不斷的改進(jìn)，廠商正努力地詳細(xì)闡明產(chǎn)品說明書1。然而，市場上已經(jīng)遺留了許多產(chǎn)品/產(chǎn)品說明書版本，對新版本或者更早的版本來說，不同標(biāo)準(zhǔn)的采用也取決于不同的因
關(guān)鍵字：產(chǎn)品說明書 ADC 高速理解比較正確

高速并行光互聯(lián)技術(shù)及其應(yīng)用

并行光互連技術(shù)　　伴隨著數(shù)字化的進(jìn)程，數(shù)據(jù)的處理、存儲和傳輸?shù)玫搅孙w速的發(fā)展。高帶寬的需求使得短距互聯(lián)成了系統(tǒng)發(fā)展的瓶頸。受損耗和串?dāng)_等因素的影響，基于銅線的電互聯(lián)的高帶寬情況下的傳輸距離受到了限制，
關(guān)鍵字：及其應(yīng)用技術(shù) 互聯(lián) 并行高速

基于USB通信的FPGA高速數(shù)據(jù)采集系統(tǒng)

摘要：為了解決高速數(shù)據(jù)采集以及數(shù)據(jù)傳輸問題，設(shè)計(jì)了基于USB通信的FPGA高速數(shù)據(jù)采集系統(tǒng)。方案以FPGA為控制核心，實(shí)現(xiàn)A／D控制、數(shù)據(jù)緩存雙口RAM和控制CY7C68013A三個功能。系統(tǒng)采用Verilog HDL語言，通過ISE軟件編
關(guān)鍵字：數(shù)據(jù)采集系統(tǒng) 高速 FPGA USB 通信基于

高速ADC電源設(shè)計(jì)方案選擇

本文介紹對于了解高速ADC電源設(shè)計(jì)至關(guān)重要的各種測試測量方法。為了確定轉(zhuǎn)換器對供電軌噪聲影響的敏感度，以及確定供電軌必須處于何種噪聲水平才能使ADC實(shí)現(xiàn)預(yù)期性能，有兩種測試十分有用：一般稱為電源抑制比（PSRR
關(guān)鍵字：方案選擇設(shè)計(jì) 電源 ADC 高速

基于Cadence_Allegro的高速PCB設(shè)計(jì)信號完整性分析與仿真

摘要：信號完整性問題已成為當(dāng)今高速PCB設(shè)計(jì)的一大挑戰(zhàn)，傳統(tǒng)的設(shè)計(jì)方法無法實(shí)現(xiàn)較高的一次設(shè)計(jì)成功率，急需基于EDA軟件進(jìn)行SI仿真輔助設(shè)計(jì)的方法以解決此問題。在此主要研究了常見反射、串?dāng)_、時序等信號完整性問題
關(guān)鍵字：完整性分析仿真信號設(shè)計(jì) Cadence_Allegro 高速 PCB

變頻器在高速公路上的應(yīng)用

1 引言
在高速公路上，設(shè)有很多收費(fèi)站，每一進(jìn)、出車道上均有一欄桿機(jī)，欄桿機(jī)的傳動需要變頻器驅(qū)動。這些收費(fèi)站大都遠(yuǎn)離城市，收費(fèi)站的生活區(qū)也不可能由城市自來水供應(yīng)。一般是就地打一口井，抽地下水滿足生活需求
關(guān)鍵字：應(yīng)用公路高速變頻器

彌合高速數(shù)據(jù)轉(zhuǎn)換器連續(xù)波和調(diào)制信號測量之間的差異

我們一般使用連續(xù)波 (CW) 信號來描述高速模數(shù)轉(zhuǎn)換器 (ADC) 和數(shù)模轉(zhuǎn)換器 (DAC)。這樣做的原因是：1）就 ADC 而言，CW 信號更易于通過 CW 生成器和窄帶通濾波器無噪生成；2）就 DAC 而言，CW 信號更容易分析；3）它
關(guān)鍵字：信號測量德州儀器差異調(diào)制連續(xù) 高速數(shù)據(jù) 轉(zhuǎn)換器彌合

基于高速超微型C8051F300單片機(jī)的CCD驅(qū)動電路設(shè)計(jì)

本文所介紹的驅(qū)動電路己應(yīng)用于TCDl206，超微型的封裝結(jié)構(gòu)使其很容易與其他芯片一起嵌入在CCD相機(jī)中，系統(tǒng)運(yùn)行可靠。
關(guān)鍵字： CCD 驅(qū)動電路設(shè)計(jì) 單片機(jī) C8051F300 高速微型基于

MAX121與TMS320VC5402在高速數(shù)據(jù)采集中的接口

MAX121與TMS320VC5402在高速數(shù)據(jù)采集中的接口,TMS320VC5402是TI公司的第五代DSP專門基于數(shù)字信號處理的低功耗的DSP芯片，工作頻率高達(dá)10ns，在數(shù)字信號處理中應(yīng)用廣泛。該芯片提供了2個MCBSP，既可以工作在SPI模式又可以工作在通用串口模式，在系統(tǒng)設(shè)計(jì)中應(yīng)用靈活
關(guān)鍵字：集中接口數(shù)據(jù) 高速 TMS320VC5402 MAX121

多傳感器融合定位在高速鐵路的應(yīng)用

2009年在武廣、鄭西等客運(yùn)專線中，C3列控系統(tǒng)的應(yīng)用，對高速鐵路列車定位技術(shù)提出了更高的要求。C3列控系統(tǒng)的主要技術(shù)原則中明確提出，列車的運(yùn)營速度達(dá)到350 km／h，最小追蹤間隔為3 min，并且300 km／h及以上動車組
關(guān)鍵字：鐵路應(yīng)用高速定位融合傳感器

信號鏈基礎(chǔ)：時鐘抖動解秘――高速鏈路時鐘抖動規(guī)范基礎(chǔ)知識分享

用于在更遠(yuǎn)距離對日益增長的海量數(shù)據(jù)進(jìn)行傳輸?shù)囊恍?biāo)準(zhǔn)不斷出現(xiàn)。來自各行業(yè)的工程師們組成了各種委員會和標(biāo)準(zhǔn)機(jī)構(gòu)，根據(jù)其開發(fā)標(biāo)準(zhǔn)的目標(biāo)（數(shù)據(jù)吞吐量和通信距離）確定抖動預(yù)算；同時還要考慮到組成通信鏈路的模塊
關(guān)鍵字：抖動時鐘規(guī)范基礎(chǔ)知識分享鏈路解秘基礎(chǔ) 信號高速

500兆/秒高速A/D系統(tǒng)的實(shí)現(xiàn)

摘要：介紹采樣率為500兆/秒、采樣精度為8bit的高速A/D系統(tǒng)的設(shè)計(jì)結(jié)構(gòu)以及高速電路設(shè)計(jì)中的問題,最后還討論了如何在Windows95下設(shè)計(jì)具有實(shí)時性要求的程序。關(guān)鍵詞：高速A/D變換高速電路設(shè)計(jì) Windows95 實(shí)時程
關(guān)鍵字：實(shí)現(xiàn) 系統(tǒng) A/D 高速

基于DSP和高速A／D的電力系統(tǒng)多通道同步采樣

基于DSP和高速A／D的電力系統(tǒng)多通道同步采樣,摘要：介紹了一種以DSP芯片TMS320C6711D為處理核心，輔以高速A／D芯片ADS8364，實(shí)現(xiàn)電力系統(tǒng)多通道同步采樣分析的系統(tǒng)結(jié)構(gòu)，著重介紹系統(tǒng)的硬件設(shè)計(jì)，通過測試及使用表明，該設(shè)計(jì)使用方便、實(shí)時性好、抗干擾性強(qiáng)、測
關(guān)鍵字：同步采樣通道電力系統(tǒng) DSP 高速基于

基于Cadence的高速PCB設(shè)計(jì)

1 引言　　隨著人們對通信需求的不斷提高，要求信號的傳輸和處理的速度越來越快.相應(yīng)的高速PCB的應(yīng)用也越來越廣，設(shè)計(jì)也越來越復(fù)雜.高速電路有兩個方面的含義：一是頻率高，通常認(rèn)為數(shù)字電路的頻率達(dá)到或是超過45MHz
關(guān)鍵字：設(shè)計(jì) PCB 高速 Cadence 基于

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