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高速PCB中電源完整性的設(shè)計(jì)
- 中心議題：* 電源噪聲的起因及分析* 去耦電容的應(yīng)用* 電源回路的設(shè)計(jì)解決方案： * 電源的分層設(shè)計(jì)來考慮 * 電容與芯片盡可能靠近芯片器件
* 利用電源層和地層作為回路，減少了返回環(huán)路面積 一、引言隨著 - 關(guān)鍵字： 設(shè)計(jì) 完整性 電源 PCB 高速
802.11n，打造高速WLAN網(wǎng)絡(luò)
- 前言WLAN作為運(yùn)營商分擔(dān)2/3G移動數(shù)據(jù)流量的主要手段，已經(jīng)在全國得到了大規(guī)模的部署和應(yīng)用，用戶可以隨時隨地的在機(jī)場、咖啡廳、賓館等有Wi-Fi信號覆蓋的場所享受無線網(wǎng)絡(luò)帶來的方便和快捷。但現(xiàn)階段的WLAN接入設(shè)備仍
- 關(guān)鍵字： 網(wǎng)絡(luò) WLAN 高速 打造 802.11n
高速轉(zhuǎn)換器時鐘分配器件的端接
- 高速轉(zhuǎn)換器時鐘分配器件的端接,使用時鐘分配器件1或者扇出緩沖器為ADC和DAC提供時鐘時，需要考慮印刷電路板上的走線和輸出端接，這是信號衰減的兩個主要來源。時鐘走線與信號擺幅
PCB上的走線類似于低通濾波器，當(dāng)時鐘信號沿著走線傳輸時，會造成 - 關(guān)鍵字： 器件 分配 時鐘 轉(zhuǎn)換器 高速
基于Spartan-6的16路高速串行傳輸?shù)脑O(shè)計(jì)與實(shí)現(xiàn)
- 摘要：高速串行傳輸?shù)脑O(shè)計(jì)是FPGA設(shè)計(jì)的一個重要方面。在串行傳輸?shù)脑O(shè)計(jì)中摒棄了采用FPGA內(nèi)部邏輯資源實(shí)現(xiàn)從而限制了串并轉(zhuǎn)換速度的傳統(tǒng)設(shè)計(jì)方法，SelectIOTM接口技術(shù)給FPGA實(shí)現(xiàn)高速串行傳輸提供了良好的舞臺，本文詳
- 關(guān)鍵字： 設(shè)計(jì) 實(shí)現(xiàn) 傳輸 串行 Spartan-6 高速 基于
基于千兆以太網(wǎng)的高速數(shù)據(jù)傳輸系統(tǒng)設(shè)計(jì)
- 摘要：介紹了千兆以太網(wǎng)接口以及TCP／IP協(xié)議，提出了幾種設(shè)計(jì)方案，講述了一種使用FPGA和MAC軟核建立千兆以太網(wǎng)的方法。實(shí)驗(yàn)證明，這種方法穩(wěn)定性好、傳輸帶寬高、額外成本低，適用于大多數(shù)高速數(shù)據(jù)傳輸系統(tǒng)，是一種
- 關(guān)鍵字： 傳輸系統(tǒng) 設(shè)計(jì) 數(shù)據(jù) 高速 千兆 以太網(wǎng) 基于
高速數(shù)據(jù)采集系統(tǒng)中精確時標(biāo)的CPLD實(shí)現(xiàn)方法
- 高速數(shù)據(jù)采集系統(tǒng)中精確時標(biāo)的CPLD實(shí)現(xiàn)方法,本文介紹一種利用復(fù)雜可編程邏輯器件給高速數(shù)據(jù)采集系統(tǒng)中的采集數(shù)據(jù)貼上精確時間標(biāo)簽的方法，并利用MAX PLUSⅡ開發(fā)環(huán)境驗(yàn)證設(shè)計(jì)方案的正確性。此設(shè)計(jì)方案已經(jīng)成功地應(yīng)用到自行設(shè)計(jì)的高速數(shù)據(jù)采集卡中。
關(guān)鍵詞 - 關(guān)鍵字： CPLD 實(shí)現(xiàn) 方法 標(biāo)的 精確 數(shù)據(jù)采集 系統(tǒng) 高速
用開關(guān)電源給高速AD轉(zhuǎn)換器供電的優(yōu)缺點(diǎn)
- 系統(tǒng)設(shè)計(jì)工程師常被要求降低總體功耗，以減少對我們環(huán)境的影響，同時降低投資和運(yùn)營成本。他們還需要提高電路密度，以便實(shí)現(xiàn)外形尺寸更小的電子系統(tǒng)，并且能在更嚴(yán)苛的環(huán)境下工作。遺憾的是，若將高功耗解決方案整合
- 關(guān)鍵字： 供電 缺點(diǎn) 轉(zhuǎn)換器 AD 高速 開關(guān)電源
基于光纖通信的分布式高速高精度數(shù)據(jù)采集系統(tǒng)設(shè)計(jì)
- 摘要：介紹了一個高精度、高信噪比的遠(yuǎn)距離分布式多通道數(shù)據(jù)采集系統(tǒng)的設(shè)計(jì)方法。該系統(tǒng)由前端采集模塊和后端解算卡組成，其中前端分布式采集模塊負(fù)責(zé)對模擬信號進(jìn)行采樣并在抗混疊數(shù)字濾波后，通過光纖通道將數(shù)據(jù)傳
- 關(guān)鍵字： 數(shù)據(jù)采集 系統(tǒng) 設(shè)計(jì) 高精度 高速 光纖通信 分布式 基于
IEEE1394總線的高速網(wǎng)絡(luò)通信系統(tǒng)設(shè)計(jì)
- 摘要: 介紹了高速網(wǎng)絡(luò)通信系統(tǒng)的網(wǎng)絡(luò)構(gòu)建、拓?fù)浣Y(jié)構(gòu)、節(jié)點(diǎn)架構(gòu)，詳細(xì)描述了系統(tǒng)的整體設(shè)計(jì)方案、硬件設(shè)計(jì)、軟件設(shè)計(jì)和工作過程。經(jīng)實(shí)驗(yàn)驗(yàn)證，該網(wǎng)絡(luò)可以實(shí)現(xiàn)最高400 Mb/s的高速數(shù)據(jù)實(shí)時傳輸，證明了這種網(wǎng)絡(luò)通信系統(tǒng)
- 關(guān)鍵字： 系統(tǒng) 設(shè)計(jì) 網(wǎng)絡(luò)通信 高速 總線 IEEE1394
一種64位高速PCI總線接口的設(shè)計(jì)與實(shí)現(xiàn)
- 摘要：設(shè)計(jì)了一種基于PCD656的高速PCI總線接口，數(shù)據(jù)傳輸主要為DMA方式。文中介紹了PCI9656的內(nèi)部結(jié)構(gòu)和功能，討論了其WDM驅(qū)動開發(fā)過程，分析了其局部總線在進(jìn)行DMA傳輸時的配置時序，提出了一些設(shè)計(jì)中需要注意的問題
- 關(guān)鍵字： 設(shè)計(jì) 實(shí)現(xiàn) 接口 總線 高速 PCI 一種
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