3. 

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	asic ip核
          

          
	
          
    	
          
    	  	
          
              	
                                
          
                  

                                
          
                    
          3-DES IP核的VerilogHDL設(shè)計
          
                                                            
            
                    	
          • 首先介紹了3-DES算法的加密/解密原理，在此基礎(chǔ)上，采用流水線技術(shù)，設(shè)計了一種高速的3-DES加/解密IP核，并用VerilogHDL語言描述其中的各個模塊。
            • 
                    	                        
          • 關(guān)鍵字：
                        IP核  流水線技術(shù)  VerilogHDL  DES加/解密                          
            • 
                   	
          
                    
          
                
          
                                
          
                    
          基于Nios II的過程控制實驗裝置的研究
          
                                                            
            
                    	
          • 利用SOPC強大的IP核和容易配置的優(yōu)勢簡化設(shè)計流程。充分發(fā)揮NiosⅡ強大的并行處理能力。該系統(tǒng)主要涉及多個下位機與FPGA的通信問題。
            • 
                    	                        
          • 關(guān)鍵字：
                        SOPC  IP核  NiosII                          
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          MCUUSB設(shè)備控制器IP核的設(shè)計
          
                                                            
            
                    	
          • 本論文針對USB1.1 協(xié)議規(guī)范，本著自主開發(fā)USB控制芯片，把MCU 和USB 設(shè)備控制器用軟核的形式集成在一塊芯片上，微控制器我們是用14 位指令字長度，且是單字節(jié)指令和單周期指令，其核心指令只有 39 條，容易掌握和設(shè)計，而且完全滿足總體設(shè)計的要求。
            • 
                    	                        
          • 關(guān)鍵字：
                        USB控制芯片  IP核  MCU                          
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          基于FPGA 的二維提升小波變換IP核設(shè)計
          
                                                            
            
                    	
          •  提出了一種高效并行的二維離散提升小波(DWT)變換結(jié)構(gòu)，該結(jié)構(gòu)只需要7 行數(shù)據(jù)緩存，即可實現(xiàn)行和列方向同時進(jìn)行濾波變換。
            • 
                    	                        
          • 關(guān)鍵字：
                        小波變換  數(shù)據(jù)緩存  FPGA  IP核                          
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          面積優(yōu)先的分組密碼算法SMS4 IP核設(shè)計
          
                                                            
            
                    	
          • 對新分組密碼算法SMS4進(jìn)行了FPGA實現(xiàn)。所設(shè)計的SMS4算法的IP核主要包括具有加解密功能的非流水線式數(shù)據(jù)通路和實時產(chǎn)生子密鑰的密鑰擴展模塊，并且支持電子密碼本(ECB)和分組鏈接(CBC)兩種工作模式。提出了一種不含密鑰初始化的運行模式，使解密吞吐率提高近一倍。
            • 
                    	                        
          • 關(guān)鍵字：
                        分組密碼  IP核  FPGA                          
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          基于Avalon-ST接口幀讀取IP核的設(shè)計和應(yīng)用
          
                                                            
            
                    	
          • 研究基于Avalon-ST接口幀讀取的IP核設(shè)計應(yīng)用，通過Avalon-ST接口將外部存儲中不同格式的幀數(shù)據(jù)轉(zhuǎn)化為視頻流輸出。根據(jù)Avalon總線協(xié)議及Avalon-ST視頻協(xié)議研究設(shè)計方案，使用Verilog HDL語言對模塊進(jìn)行硬件設(shè)計，并將實現(xiàn)的模塊進(jìn)行測試。
            • 
                    	                        
          • 關(guān)鍵字：
                        Avalon-ST  IP核  Verilog                          
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          有功電能計量IP核的設(shè)計
          
                                                            
            
                    	
          • 對有功電能計量的數(shù)學(xué)模型進(jìn)行了分析，給出了相應(yīng)的IP核實現(xiàn)模型，并詳細(xì)討論了CIC抽取濾波器、IIR高通濾波器、FIR低通濾波器、數(shù)字頻率變換等模塊的原理與設(shè)計。
            • 
                    	                        
          • 關(guān)鍵字：
                        有功電能  CycloneII  IP核                          
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          基于FPGA的二-十進(jìn)制轉(zhuǎn)碼器設(shè)計
          
                                                            
            
                    	
          • 針對二進(jìn)制轉(zhuǎn)十進(jìn)制(BCD)轉(zhuǎn)碼器的FPGA實現(xiàn)目標(biāo)，提出了一種高效、易于重構(gòu)的轉(zhuǎn)碼器設(shè)計方案。并在FPGA開發(fā)板上成功地實現(xiàn)了該設(shè)計。
            • 
                    	                        
          • 關(guān)鍵字：
                        BCD轉(zhuǎn)碼器  IP核  路徑延遲                          
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          在選用FPGA進(jìn)行設(shè)計時如何降低功耗
          
                                                            
            
                    	
          • 傳統(tǒng)意義上，ASIC和CPLD是低功耗競爭中當(dāng)仁不讓的贏家。但是由于相對成本較高，且用戶對高端性能和額外邏輯的要求也越來越多，在低功耗應(yīng)用中使用CPLD正在失去優(yōu)勢。ASIC也面臨相同的風(fēng)險。而例如FPGA這樣日益增長的可編程半導(dǎo)體器件正逐步成為備受青睞的解決方案。
            • 
                    	                        
          • 關(guān)鍵字：
                        低功耗  ASIC  CPLD  可編程半導(dǎo)體器件                          
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          FPGA并行計算抽象接口的設(shè)計與實現(xiàn)
          
                                                            
            
                    	
          • 本設(shè)計為基于C語言開發(fā)的程序開發(fā)了一個FPGA的并行計算接口，凡是以C語言設(shè)計的程序，均可通過調(diào)用本設(shè)計的接口，把復(fù)雜的算法、數(shù)值處理交給FPGA芯片完成，在不需要程序員學(xué)習(xí)FPGA知識以及使用FPGA開發(fā)工具的前提下，大大地減輕CPU的負(fù)荷以及從根本上提高了程序的執(zhí)行效率，是FPGA并行化應(yīng)用的一次全新嘗試。
            • 
                    	                        
          • 關(guān)鍵字：
                        IP核  調(diào)度模塊  FPGA  PCI設(shè)備驅(qū)動  Express總線                          
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          基于FPGA的3D圖像處理器IP核的實現(xiàn)
          
                                                            
            
                    	
          • LCD顯示屏的應(yīng)用越來越廣，數(shù)量越來越多。LCD顯示屏應(yīng)用廣泛,無處不在。如家庭各種電器設(shè)備。更常見是用于各種公共場合如體育館、廣場等商業(yè)用途。給我們傳遞一種更為直觀、生動的信息。從此我們的生活發(fā)生了巨大改變。巨大的應(yīng)用巨大的市場帶來了巨大的商機。基于FPGA的LCD顯示的3D影像是為了LCD顯示屏的信息量更多，滿足人需求。
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          • 關(guān)鍵字：
                        IP核  3D圖像處理器  FPGA  LCD  Verilog                          
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          如何用C語言描述AES256加密算法最高效？
          
                                                            
            
                    	
          • 高級加密標(biāo)準(zhǔn) (AES) 已經(jīng)成為很多應(yīng)用（諸如嵌入式系統(tǒng)中的應(yīng)用等）中日漸流行的密碼規(guī)范。
            • 
                    	                        
          • 關(guān)鍵字：
                        ASIC  AES  FPGA  嵌入式                          
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          可配置電源管理ASIC--當(dāng)今的系統(tǒng)黏合劑
          
                                                            
            
                    	
          • 上個世紀(jì)，在數(shù)字化思維主導(dǎo)設(shè)計領(lǐng)域時，系統(tǒng)是標(biāo)準(zhǔn)處理器，ASSP，模擬電路和黏合邏輯的混合物?！梆ず线壿嫛笔峭ㄟ^小型和中型集成電路把不同數(shù)字芯片的協(xié)議和總線連在一起。為了降低成本實現(xiàn)一體化，“黏合邏輯”曾經(jīng)風(fēng)靡整個ASIC業(yè)。
            • 
                    	                        
          • 關(guān)鍵字：
                        集成電路  ASIC  電源管理                          
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          基于FPGA的信息安全系統(tǒng)設(shè)計
          
                                                            
            
                    	
          • 本模塊采用xilinx公司的Spartan 3E系列XC3S500E型FPGA作為核心控制芯片，對采集到底模擬信號進(jìn)行數(shù)字轉(zhuǎn)換后通過3DES算法進(jìn)行加密、然后通過網(wǎng)絡(luò)傳輸，再經(jīng)過解密算法解密出明文數(shù)據(jù)。
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          • 關(guān)鍵字：
                        信息安全系統(tǒng)  RAM  IP核  FPGA  乒乓操作                          
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          MEMS麥克風(fēng)技術(shù)滿足音量市場的性能要求
          
                                                            
                                        
            
                    	
          • 隨著智能設(shè)備的迅猛發(fā)展，市場需要更高性能的麥克風(fēng)，而MEMS可以在緊湊的尺寸內(nèi)麥克風(fēng)提供高性能和保真度及可靠性，適用于便攜式設(shè)備。本文介紹了MEMS麥克風(fēng)的結(jié)構(gòu)和工作模式，并介紹了相關(guān)的MEMS麥克風(fēng)套件。
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          • 關(guān)鍵字：
                        MEMS  麥克風(fēng)  ASIC  201706                          
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          asic ip核介紹
          
      			
          
		      	
          
		      			      			      	您好，目前還沒有人創(chuàng)建詞條asic ip核!
           
		      	歡迎您創(chuàng)建該詞條，闡述對asic ip核的理解，并與今后在此搜索asic ip核的朋友們分享。    創(chuàng)建詞條
		      			      	
          
    		
          
  		
          
  		  		  		
  		  		  		
  		  		  		
  		  		            
          
        
          
            
          
              
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          熱門主題
          
      			
          
      			
          
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