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Cadence試產(chǎn)14nm測試芯片
- 近日，Cadence宣布，運用IBM FinFET制程技術(shù)所設(shè)計的 ARM Cortex-M0 處理器14nm測試晶片已投入試產(chǎn)。成功投產(chǎn)14nmSOI FinFET 技術(shù)歸功于三家廠商攜手建立的生態(tài)體系，在以 FinFET 為基礎(chǔ)的 14nm設(shè)計流程中，克服從設(shè)計到制造的各種新挑戰(zhàn)。 14nm生態(tài)系統(tǒng)與晶片是ARM、Cadence與IBM合作在14nm以上的先進制程開發(fā)系統(tǒng)晶片(SoCs)之多年期協(xié)議的重大里程碑。運用FinFET技術(shù)的14nm設(shè)計SoC實現(xiàn)了大幅減少耗電的承諾。 &ld
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Cadence宣布使用ARM和IBM工藝技術(shù)流片14納米測試芯片
- 全球電子設(shè)計創(chuàng)新領(lǐng)先企業(yè)Cadence設(shè)計系統(tǒng)公司(NASDAQ: CDNS)，日前宣布流片了一款14納米測試芯片，使用IBM的FinFET工藝技術(shù)設(shè)計實現(xiàn)了一顆ARM Cortex-M0處理器。這次成功流片是三家技術(shù)領(lǐng)先企業(yè)緊密合作的結(jié)果，他們一起建立了一個產(chǎn)品體系，解決基于14納米FinFET的設(shè)計流程中內(nèi)在的從設(shè)計到生產(chǎn)的過程中出現(xiàn)的新挑戰(zhàn)。
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Cortex-A50的希望：14nm ARM成功流片
- 電子設(shè)計企業(yè)Cadence Design Systems, Inc.今天宣布，借助IBM FinFET晶體管技術(shù)，已經(jīng)成功流片了14nm工藝的ARM Cortex-M0處理器試驗芯片。 ? Cadence、ARM、IBM三者之間已經(jīng)達成了多年的合作協(xié)議 Cadence、ARM、IBM三者之間已經(jīng)達成了多年的合作協(xié)議，共同開發(fā)14nm以及更先進的半導(dǎo)體工藝，14nm芯片和生態(tài)系統(tǒng)就是三方合作的一個重要里程碑。 這次的試驗芯片主要是用來對14nm工藝設(shè)計IP的
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CSR實現(xiàn)系統(tǒng)加速低功耗、混合信號芯片流片
- 全球電子設(shè)計創(chuàng)新領(lǐng)先企業(yè)Cadence設(shè)計系統(tǒng)公司(NASDAQ: CDNS)宣布，緊湊型、多媒體及云領(lǐng)域的創(chuàng)新芯片及軟件解決方案的全球供應(yīng)商CSR plc (LSE: CSR; NASDAQ: CSRE)使用Cadence Encounter Digital Implementation(EDI)系統(tǒng)、Cadence Incisive Enterprise Simulator(IES)以及Cadence Conformal Low Power(CLP)加速了一款復(fù)雜低功耗、混合信號芯片的流片。
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Cadence助力Denso大幅提升IC設(shè)計效率
- Cadence設(shè)計系統(tǒng)公司日前宣布，汽車零部件生產(chǎn)商Denso公司在改用了Cadence定制/模擬與數(shù)字流程之后，在低功耗混合信號IC設(shè)計方面實現(xiàn)了質(zhì)量與效率的大幅提升。將Cadence Encounter RTL-to-GDSII流程應(yīng)用于設(shè)計的數(shù)字部分之后，Denso表示比之前采用的流程減小了10%的面積，功耗降低了20% 。在設(shè)計的模擬部分，根據(jù)多次測試的數(shù)據(jù)結(jié)果，Denso使用Cadence Virtuoso定制/模擬流程(6.1版)實現(xiàn)了30%的效率提升，并預(yù)計在實際設(shè)計上也有相
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EDA仿真軟件Cadence
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Cadence Design Systems Inc.是全球最大的電子設(shè)計技術(shù)(Electronic Design Technologies)、程序方案服務(wù)和設(shè)計服務(wù)供應(yīng)商。其解決方案旨在提升和監(jiān)控半導(dǎo) [ 查看詳細 ]
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