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CADENCE PCB設(shè)計(jì)技術(shù)方案
- CADENCE PCB設(shè)計(jì)解決方案能為解決與實(shí)現(xiàn)高難度的與制造密切相關(guān)的設(shè)計(jì)提供完整的設(shè)計(jì)環(huán)境,該設(shè)計(jì)解決方案集成了從設(shè)計(jì)構(gòu)想至最終產(chǎn)品所需要的一切設(shè)計(jì)流程,包含設(shè)計(jì)輸入元件庫工具、PCB編輯器和一個自動/交互連布線
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Cadence宣布已助力一款20納米測試芯片成功流片
- 全球電子設(shè)計(jì)創(chuàng)新領(lǐng)先企業(yè)Cadence設(shè)計(jì)系統(tǒng)公司(NASDAQ: CDNS),日前宣布其已助力STMicroelectronics的一款20納米測試芯片成功流片,采用定制模擬與數(shù)字方法學(xué),實(shí)現(xiàn)20納米高級工藝節(jié)點(diǎn)的混合信號SoC設(shè)計(jì)。兩家公司的工程師緊密合作開發(fā)技術(shù),使用含有Cadence Encounter和Virtuoso平臺的方法進(jìn)行設(shè)計(jì)、實(shí)現(xiàn)與簽核,以及開發(fā)基礎(chǔ)IP和一個面向20納米工藝的基于SKILL的工藝設(shè)計(jì)包(PDK)。
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Nufront第三代處理器采用Cadence接口IP解決方案
- 全球電子設(shè)計(jì)創(chuàng)新領(lǐng)先企業(yè)Cadence設(shè)計(jì)系統(tǒng)公司 (NASDAQ: CDNS),日前宣布Nufront(新岸線)的NS115芯片組采用了Cadence可配置的DDR3/3L/LPDDR2存儲控制器與硬化PHY IP核,應(yīng)用于其雙核ARM Cortex –A9移動應(yīng)用處理器。TSMC 40LP工藝, 32位DDR3/LPDDR2接口的數(shù)據(jù)傳輸速率最高可達(dá)800Mbps,并能提供對超薄筆記本、平板電腦和智能手機(jī)等產(chǎn)品至關(guān)重要的基于數(shù)據(jù)流量的自動功耗管理。 Cadence 的DDR3/3L/LPDDR2 IP
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Cadence去年?duì)I收增長23%
- Cadence設(shè)計(jì)系統(tǒng)公司長期以來一直強(qiáng)調(diào)為當(dāng)?shù)乜蛻艉秃献骰锇榉?wù)的承諾,公司今日宣布其擴(kuò)大后的上海辦事處正式啟用,該辦事處包括300多名銷售、研發(fā)及技術(shù)支持員工。格科微、芯原微電子等到場祝賀。 Cadence總裁兼CEO陳立武說,“我們進(jìn)入中國已經(jīng)有20多年,從中獲得的經(jīng)驗(yàn)是Cadence公司獨(dú)一無二的優(yōu)勢,通過與客戶和合作伙伴的密切合作,Cadence將為上海的半導(dǎo)體和系統(tǒng)公司加速發(fā)展提供支持。”陳立武透露,通過近1-2年的調(diào)整,公司已重新步入收獲期,2011年銷售收
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Cadence Design Systems Inc.是全球最大的電子設(shè)計(jì)技術(shù)(Electronic Design Technologies)、程序方案服務(wù)和設(shè)計(jì)服務(wù)供應(yīng)商。其解決方案旨在提升和監(jiān)控半導(dǎo) [ 查看詳細(xì) ]
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