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cpld-pci接口文章進入cpld-pci接口技術社區(qū)

基于單片機及CPLD的B超檢測工裝設計

引言超聲在人體內(nèi)傳播，由于人體各種組織有聲學的特性差異，超聲波在兩種不同組織界面處會產(chǎn)生反射、折射、散射、繞射、衰減以及聲源與接收器相對運動產(chǎn)生多普勒頻移等物理特性。應用不同類型的超聲診斷儀，采用各
關鍵字：工裝設計檢測 CPLD 單片機基于

基于CPLD的IEEE1149.1 USB下載電纜設計

引言隨著片上系統(tǒng)(SoC，SystemonChip)時代的到來，包括復雜可編程邏輯器件(CPLD，ComplexProgrammab...
關鍵字： FPGA CPLD USB下載電纜 IEEE1149.1

用雙端口RAM實現(xiàn)與PCI總線接口數(shù)據(jù)通訊

采用雙端口RAM實現(xiàn)DSP與PCI總線芯片之間的數(shù)據(jù)交換接口電路。提出了一種使用CPLD解決雙端口RAM地...
關鍵字： PCI接口雙端口RAM 數(shù)據(jù)通訊 CPLD

基于CPLD的電動自行車充電系統(tǒng)的研究設計

電動車由于具有無廢氣污染、無噪音、輕便美觀等特點，受到眾多使用者的青睞。但使用中也暴露出它的局限性...
關鍵字： FPGA CPLD SPCE061A 充電系統(tǒng) 電動自行車

基于CPLD和ISA總線的數(shù)據(jù)采集系統(tǒng)設計

摘要：介紹一種基于復雜可編程邏輯器件(CPLD)的數(shù)據(jù)采集系統(tǒng)，并給出詳細的設計方案。計算機通過ISA總線實現(xiàn)與數(shù)據(jù)采集系統(tǒng)的指令和數(shù)據(jù)傳輸。通過VHDL編程實現(xiàn)CPLD對12位串行模數(shù)轉(zhuǎn)換器ADS7816的控制。最后，給出該
關鍵字： CPLD ISA 總線數(shù)據(jù)采集

CPLD在臭氧電源中的應用

摘要：利用壓控振蕩器CD4046和可編程邏輯器件EPM7128構(gòu)成控制系統(tǒng)，通過調(diào)節(jié)逆變輸出脈沖的占空比和頻率，實現(xiàn)臭氧電源輸出電壓和頻率的調(diào)節(jié)，從而達到對臭氧電源輸出功率的調(diào)節(jié)。調(diào)試結(jié)果表明該系統(tǒng)滿足實時性和功耗
關鍵字： CPLD 臭氧電源中的應用

TMS320F2812與CPLD的視頻采集系統(tǒng)接口設計

摘要：介紹基于TMS320F2812和CPLD的數(shù)字視頻采集系統(tǒng)的接口設計。該系統(tǒng)采用同步分離電路、TMS320F2812、EPM7128、TMS320C6416、IDE硬盤存儲器以及顯示器接口等芯片，利用TMs320F2812中的ADC采樣速度和轉(zhuǎn)換精度高的優(yōu)
關鍵字：接口設計系統(tǒng) 采集 CPLD 視頻 TMS320F2812

采用CPLD/FPGA的VHDL語言電路優(yōu)化原理設計

采用CPLD/FPGA的VHDL語言電路優(yōu)化原理設計,VHDL(Very High Speed Integrated Circuit Hardware Description Language)是IEEE工業(yè)標準硬件描述語言，是隨著可編程邏輯器件(PLD)的發(fā)展而發(fā)展起來的。它是一種面向設計、多層次的硬件描述語言，是集行為描述、RTL
關鍵字：優(yōu)化原理設計電路語言 CPLD/FPGA VHDL 采用

基于PC104總線和CPLD的測頻模件設計

摘要：根據(jù)某測試系統(tǒng)的需要，設計基于PCl04總線和CPLD的高精度測頻模件，采用多周期同步測頻法實現(xiàn)對所測頻段的等精度測量。設計了該測頻模件的硬件電路，并給出用CPLD實現(xiàn)數(shù)字頻率計的詳細VHDL源代碼。采用原理圖的
關鍵字： CPLD 104 PC 總線

基于CPLD的異步串行通訊控制器的研究與設計

本文在對異步串行通信協(xié)議進行分析的基礎上，根據(jù)實際工程的需要，對異步串行通信控制器進行了詳細設計，并結(jié)合CPLD器件，采用VHDL語言，對設計方案進行了實現(xiàn)和驗證，通過最后時序仿真的波形圖得出了設計方案的正確，而且加載了該設計程序的CPLD在實際工程中能夠很好地與處理器進行連接來收發(fā)數(shù)據(jù)，從而為那些沒有串行異步接口的處理器提供一個比較理想的設計方案。
關鍵字： CPLD 異步串行通訊控制器

基于CPLD/FPGA的VHDL語言電路優(yōu)化設計

VHDL(VeryHighSpeedIntegratedCircuitHardwareDescriptionLanguage)是IEEE工業(yè)標準硬件描述語言...
關鍵字： CPLD FPGA VHDL 電路優(yōu)化設計

基于CPLD的函數(shù)信號發(fā)生器設計

摘要：針對傳統(tǒng)信號源精度低的特點，提出一種新的函數(shù)信號發(fā)生器設計方案。這里介紹的函數(shù)信號發(fā)生器由CPLD、單片機控制模塊、鍵盤、LED顯示、D／A轉(zhuǎn)換模塊組成。采用直接數(shù)字頻率合成(DDFS)技術，用單片機控制CPLD的
關鍵字： CPLD 函數(shù)信號發(fā)生器

基于CPLD的數(shù)據(jù)采集與顯示接口電路仿真設計

摘要：常規(guī)數(shù)據(jù)采集與顯示方法是應用CPU或DSP通過軟件控制數(shù)據(jù)采集的模／數(shù)轉(zhuǎn)換，這樣將會頻繁中斷系統(tǒng)的運行，從而降低系統(tǒng)的運算速度，數(shù)據(jù)采集的速度也將受到限制。通過CPLD實現(xiàn)由硬件控制模／數(shù)轉(zhuǎn)換和數(shù)據(jù)顯示，
關鍵字： CPLD 數(shù)據(jù)采集電路仿真設計

基于CPLD的多次重觸發(fā)存儲測試系統(tǒng)設計

摘要：提出一種基于CPLD的多次重觸發(fā)存儲測試系統(tǒng)設計方案，詳細介紹系統(tǒng)硬件設計以及CPLD內(nèi)部控制原理，并對CPLD控制電路仿真。該系統(tǒng)體積小、功耗低，能夠?qū)崟r記錄多次重觸發(fā)信號，每次信號記錄均有負延遲，讀取出
關鍵字： CPLD 觸發(fā) 存儲測試系統(tǒng)設計

基于ARM和CPLD的開放式數(shù)控系統(tǒng)設計

基于ARM和CPLD的開放式數(shù)控系統(tǒng)設計,針對新一代開放式數(shù)控系統(tǒng)的特征要求，提出一種基于ARM和CPLD、以Windows CE為操作系統(tǒng)的開放式數(shù)控系統(tǒng)方案。介紹了系統(tǒng)的軟硬件平臺開發(fā)，重點討論了系統(tǒng)核心部分中斷控制的實現(xiàn)方案，包括Windows CE系統(tǒng)中斷服務、應用程序中斷響應和CPLD程序。
關鍵字：數(shù)控系統(tǒng) 設計開放式 CPLD ARM 基于通信協(xié)議

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cpld-pci接口介紹

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cpld-pci接口電路

利用CPLD實現(xiàn)多路數(shù)據(jù)采集
CPLD單穩(wěn)態(tài)電子電路設計詳解
采用CPLD電器定時開關控制系統(tǒng)電路
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