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cpld-pci接口
cpld-pci接口 文章 進(jìn)入cpld-pci接口技術(shù)社區(qū)
CPLD在無(wú)功補(bǔ)償控制儀鍵盤中的設(shè)計(jì)應(yīng)用
- 本控制儀以單片機(jī)80c196kc為核心,集無(wú)功補(bǔ)償、電度量計(jì)量、電能質(zhì)量監(jiān)測(cè)及通信于一體,能實(shí)時(shí)顯示電網(wǎng)的各項(xiàng)參數(shù),通過(guò)鍵盤可人工設(shè)定系統(tǒng)運(yùn)行的參數(shù)。單片機(jī)外圍芯片PSD8XX及復(fù)雜可編程邏輯器件(CPLD)的使用不僅使系統(tǒng)的硬件電路簡(jiǎn)化,而且使系統(tǒng)的性能提高。本文將討論用CPLD來(lái)實(shí)現(xiàn)控制儀的鍵盤系統(tǒng),給出了硬件電路和軟件設(shè)計(jì)方法。
- 關(guān)鍵字: 鍵盤擴(kuò)展 無(wú)功補(bǔ)償裝置 CPLD
基于CPLD及鎢錸熱電偶溫度傳感器的爆炸場(chǎng)溫度動(dòng)態(tài)測(cè)試
- 為了測(cè)量爆炸場(chǎng)等惡劣環(huán)境下溫度的動(dòng)態(tài)變化,分析炸藥或相關(guān)彈藥的爆炸參數(shù),設(shè)計(jì)了基于CPLD的低功耗溫度存儲(chǔ)式測(cè)試系統(tǒng);運(yùn)用鎢錸熱電偶溫度傳感器匹配先進(jìn)的電源管理模塊,并結(jié)合動(dòng)態(tài)存儲(chǔ)測(cè)試技術(shù),能夠應(yīng)用于環(huán)境條件比較差的惡劣環(huán)境中,在可靠可信、微功耗的基礎(chǔ)上能得到較好的實(shí)驗(yàn)數(shù)據(jù)。
- 關(guān)鍵字: 時(shí)序仿真 溫度測(cè)試 CPLD
基于ARM和CPLD的橫機(jī)機(jī)頭電路測(cè)試系統(tǒng)
- 為解決電腦橫機(jī)機(jī)頭控制系統(tǒng)信號(hào)的測(cè)試可靠性問(wèn)題,基于低成本、高效率的考慮,研究設(shè)計(jì)了機(jī)頭控制系統(tǒng)電路板的批量測(cè)試系統(tǒng)。該系統(tǒng)采用TI公司的LM 3S5R31芯片作為系統(tǒng)的核心部分,通過(guò)CPLD進(jìn)行I/O擴(kuò)展及輔助控制,使得系統(tǒng)功能靈活強(qiáng)大。將同一信號(hào)通路中的前后級(jí)元件信號(hào)進(jìn)行編碼,向待測(cè)板發(fā)送握手信號(hào)并使之發(fā)送反饋信號(hào),該系統(tǒng)將反饋信號(hào)進(jìn)行采樣并在程序中比較計(jì)算,制作了實(shí)物并進(jìn)行了大量實(shí)驗(yàn)。
- 關(guān)鍵字: 故障測(cè)試 I/O擴(kuò)展 CPLD
基于Verilog狀態(tài)機(jī)的PLC背板總線協(xié)議接口芯片設(shè)計(jì)
- 設(shè)計(jì)了一組基于CPLD的PLC背板總線協(xié)議接口芯片,協(xié)議芯片可以區(qū)分PLC的背板總線的周期性數(shù)據(jù)和非周期性數(shù)據(jù)。詳細(xì)介紹了通過(guò)Verilog HDL語(yǔ)言設(shè)計(jì)狀態(tài)機(jī)、協(xié)議幀控制器、FIFO控制器的過(guò)程,25MHz下背板總線工作穩(wěn)定的試驗(yàn)結(jié)果驗(yàn)證了協(xié)議芯片設(shè)計(jì)的可行性。
- 關(guān)鍵字: VerilogHDL PLC背板 CPLD
基于DSP+CPLD的嵌入式車牌識(shí)別系統(tǒng)硬件電路設(shè)計(jì)
- 基于數(shù)字信號(hào)處理器(DSP)TMS320VC5416和復(fù)雜可編程邏輯器件(CPLD)的嵌入式車牌識(shí)別系統(tǒng)的硬件設(shè)計(jì),利用視頻處理芯片SAA7111作為視頻A/D,在CPLD的控制下將采集到的圖像數(shù)據(jù)寫入幀存儲(chǔ)器中,DSP對(duì)圖像數(shù)據(jù)進(jìn)行實(shí)時(shí)分析處理。采用“乒乓”存儲(chǔ)結(jié)構(gòu),實(shí)現(xiàn)了圖像數(shù)據(jù)的采集和處理的并行運(yùn)行。識(shí)別結(jié)果通過(guò)串口傳到上位機(jī)或者保存在E2PROM中,實(shí)現(xiàn)了車牌識(shí)別系統(tǒng)脫機(jī)、聯(lián)機(jī)工作,在實(shí)時(shí)高速圖像處理系統(tǒng)中有廣泛的工程技術(shù)應(yīng)用前景。
- 關(guān)鍵字: 車牌識(shí)別系統(tǒng) 嵌入式 CPLD
基于ARM和CPLD的高速數(shù)據(jù)采集系統(tǒng)設(shè)計(jì)(圖)
- 數(shù)據(jù)采集系統(tǒng)是通過(guò)采樣電路將輸入的模擬信號(hào)轉(zhuǎn)換成離散信號(hào),并送入CPU、MCU或DSP進(jìn)行處理?,F(xiàn)在流行的基于PCI總線設(shè)計(jì)的采集卡是數(shù)據(jù)采集系統(tǒng)的主流,其優(yōu)點(diǎn)是可以利用PCI總線的研究成果快速的開發(fā)系統(tǒng)軟件,整體運(yùn)行速度快,能夠?qū)崿F(xiàn)實(shí)時(shí)采集實(shí)時(shí)處理。但在一些工業(yè)測(cè)控現(xiàn)場(chǎng)檢測(cè)大型設(shè)備時(shí),從現(xiàn)場(chǎng)到機(jī)房有一定的距離,模擬信號(hào)傳到安裝在PC內(nèi)的PCI數(shù)據(jù)采集卡會(huì)有不同程度的衰減,且易受工業(yè)環(huán)境的干擾。而單純用由微控制器(MCU)為核心的數(shù)據(jù)采集系統(tǒng)時(shí),把數(shù)據(jù)采集器置于被監(jiān)測(cè)的設(shè)備處,雖然可以避免模擬信號(hào)的衰減和
- 關(guān)鍵字: 數(shù)據(jù)采集 ARM μC/OS-II CPLD
在選用FPGA進(jìn)行設(shè)計(jì)時(shí)如何降低功耗
- 傳統(tǒng)意義上,ASIC和CPLD是低功耗競(jìng)爭(zhēng)中當(dāng)仁不讓的贏家。但是由于相對(duì)成本較高,且用戶對(duì)高端性能和額外邏輯的要求也越來(lái)越多,在低功耗應(yīng)用中使用CPLD正在失去優(yōu)勢(shì)。ASIC也面臨相同的風(fēng)險(xiǎn)。而例如FPGA這樣日益增長(zhǎng)的可編程半導(dǎo)體器件正逐步成為備受青睞的解決方案。
- 關(guān)鍵字: 低功耗 ASIC CPLD 可編程半導(dǎo)體器件
雙通道邏輯控制高速實(shí)時(shí)數(shù)據(jù)采集系統(tǒng)的設(shè)計(jì)
- 設(shè)計(jì)了一種全新構(gòu)架的高性能數(shù)據(jù)采集系統(tǒng)。采用平衡式雙通道對(duì)稱結(jié)構(gòu),可對(duì)32路輸入信號(hào)進(jìn)行靈活控制。系統(tǒng)中采用了高速A/D轉(zhuǎn)換器、大容量的FIFO SRAM、CPLD技術(shù)和PCI數(shù)據(jù)通信接口,實(shí)現(xiàn)了實(shí)時(shí)、高速的數(shù)據(jù)采集和處理。
- 關(guān)鍵字: 高速實(shí)時(shí)數(shù)據(jù)采集 平衡式雙通道 CPLD
7種LED點(diǎn)陣顯示屏及其控制系統(tǒng)的設(shè)計(jì)與實(shí)現(xiàn)
- LED點(diǎn)陣顯示屏是集微電子技術(shù)、計(jì)算機(jī)技術(shù)、信息處理技術(shù)于一體的大型顯示屏系統(tǒng)。它以其色彩鮮艷,動(dòng)態(tài)范圍廣,亮度高,壽命長(zhǎng),工作穩(wěn)定可靠等優(yōu)點(diǎn)而成為眾多顯示媒體以及戶外作業(yè)顯示的理想選擇。目前,已經(jīng)被廣泛應(yīng)用到軍事、車站、賓館、體育、新聞、金融、證券、廣告以及交通運(yùn)輸?shù)仍S多行業(yè)。
- 關(guān)鍵字: LED點(diǎn)陣 控制系統(tǒng) 發(fā)光管 FPGA CPLD
cpld-pci接口介紹
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歡迎您創(chuàng)建該詞條,闡述對(duì)cpld-pci接口的理解,并與今后在此搜索cpld-pci接口的朋友們分享。 創(chuàng)建詞條
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