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基于DDS的寄生電感測(cè)量?jī)x設(shè)計(jì)
- 中心議題： 基于DDS的寄生電感測(cè)量?jī)x的測(cè)量原理 寄生電感測(cè)量?jī)x的掃頻發(fā)生器設(shè)計(jì) 寄生電感測(cè)量?jī)x的諧振點(diǎn)檢測(cè)電路分析 寄生電感測(cè)量?jī)x的主要軟件流程設(shè)計(jì)解決方案： 基于DDS的寄生電感測(cè)量?jī)x的設(shè)計(jì)
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DDS+MCU實(shí)現(xiàn)運(yùn)算放大器參數(shù)測(cè)量系統(tǒng)
- DDS+MCU實(shí)現(xiàn)運(yùn)算放大器參數(shù)測(cè)量系統(tǒng),引言 為了方便用戶準(zhǔn)確掌握手中運(yùn)放的各項(xiàng)參數(shù),本文提供了一種采用可編程DDS芯片和MCU的測(cè)量系統(tǒng),可自動(dòng)測(cè)量集成運(yùn)放的5項(xiàng)基本參數(shù),以小液晶屏顯示測(cè)量結(jié)果,并可根據(jù)需要打印測(cè)量的結(jié)果,與現(xiàn)有的BJ3195等昂貴測(cè)試
- 關(guān)鍵字： 參數(shù) 測(cè)量 系統(tǒng) 放大器 運(yùn)算 MCU 實(shí)現(xiàn) DDS
一種新的實(shí)現(xiàn)DDS的AVR信號(hào)發(fā)生器
- 這是一個(gè)AVR DDS信號(hào)發(fā)生器V2.0新的實(shí)施，已經(jīng)在scienceprog.com出版。 很明顯，對(duì)于原原理圖和固件完全歸功于 ...
- 關(guān)鍵字： DDS AVR信號(hào)發(fā)生器
基于DDS的寬帶頻率合成器的設(shè)計(jì)方案
- 摘要：提出了基于DDS的寬帶頻率合成器的設(shè)計(jì)方案，給出了主要的硬件選擇，對(duì)頻率合成器的原理進(jìn)行了詳細(xì)的闡述，并且對(duì)該頻率合成器的雜波抑制和相位噪聲進(jìn)行了分析，最后對(duì)樣機(jī)的性能進(jìn)行了測(cè)試，結(jié)果表明該寬帶
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一種DDS的優(yōu)化設(shè)計(jì)
- 在高可靠應(yīng)用領(lǐng)域，如果設(shè)計(jì)得當(dāng)，將不會(huì)存在類似于MCU的復(fù)位不可靠和PC可能跑飛等問題。CPLD/FPGA的高可靠性還表現(xiàn)在，幾乎可將整個(gè)系統(tǒng)下載于同一芯片中，實(shí)現(xiàn)所謂片上系統(tǒng)，從而大大縮小了體積，易于管理和屏蔽。
- 關(guān)鍵字： DDS 優(yōu)化設(shè)計(jì)
基于FPGA的DDS+DPLL跳頻信號(hào)源設(shè)計(jì)
- 摘要：針對(duì)跳頻通信系統(tǒng)有固有噪聲的特點(diǎn)，結(jié)合DDS+DPLL高分辨率、高頻率捷變速度的優(yōu)點(diǎn)，并采用Altera公司的Quartus-Ⅱ_10．1軟件進(jìn)行設(shè)計(jì)綜合，提出了一種新型的跳頻信號(hào)源。結(jié)果表明，該設(shè)計(jì)中DPLL時(shí)鐘可達(dá)到12
- 關(guān)鍵字： FPGA DPLL DDS 跳頻信號(hào)源
IDT推出全球首款集成可編程時(shí)鐘發(fā)生器的音頻子系統(tǒng)
- 擁有模擬和數(shù)字領(lǐng)域的優(yōu)勢(shì)技術(shù)、提供領(lǐng)先的混合信號(hào)半導(dǎo)體解決方案的供應(yīng)商 IDT? 公司(Integrated Device Technology, Inc.; NASDAQ: IDTI) 面向便攜應(yīng)用推出全球首款集成可編程時(shí)鐘發(fā)生器的音頻子系統(tǒng)。新器件通過集成，可實(shí)現(xiàn)占板空間的最小化、降低系統(tǒng)成本，同時(shí)由于無需長(zhǎng)貨期的外部晶體和振蕩器，縮短產(chǎn)品上市時(shí)間。
- 關(guān)鍵字： IDT 音頻 PLL
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