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基于DDS的無線數(shù)據(jù)傳輸系統(tǒng)設(shè)計與實現(xiàn)

DDS 技術(shù)是近幾年來迅速發(fā)展的頻率合成技術(shù)，它采用全數(shù)字化的技術(shù)，具有集成度高、體積小、相對帶寬寬、頻率分辨率高、跳頻時間短、相位連續(xù)性好、可以寬帶正交輸出、可以外加調(diào)制的優(yōu)點，并方便與控制器接口構(gòu)
關(guān)鍵字：設(shè)計實現(xiàn) 傳輸系統(tǒng) 數(shù)據(jù) DDS 無線基于

PLL陷波濾波器用于阻攔不需要的頻率

經(jīng)常有要阻擋某些頻率信號的情況，其中最常見的是50Hz或60Hz的電力線工頻。圖1中的PLL陷波濾波器可以用于阻攔不需要的頻率。IC1 LM567C是一只音調(diào)解碼器。C1、R1A和R1B等元件決定了IC1探測的頻率F：F=1/[C1(R1A
關(guān)鍵字：需要頻率阻攔用于濾波器 PLL

AD9779A的寄存器配置及PLL頻帶優(yōu)化

隨著科學(xué)技術(shù)的發(fā)展，通信、測量等各個領(lǐng)域?qū)π盘栐吹囊笤絹碓礁撸咚偃我獠ㄐ伟l(fā)生器成為市場的熱點。高速DAC作為任意波形發(fā)生器的關(guān)鍵部分，其性能對高速信號有著極大的影響。AD9779A是目前國內(nèi)能買到的性能較
關(guān)鍵字：頻帶優(yōu)化 PLL 配置寄存器 AD9779A

基于FPGA和DDS技術(shù)的任意波形發(fā)生器設(shè)計

摘要：根據(jù)現(xiàn)代電子系統(tǒng)對信號源的頻率穩(wěn)定度、準(zhǔn)確度及分辨率越來越高的要求，結(jié)合直接數(shù)字式頻率合成器(DDS)的優(yōu)點，利用FPGA芯片的可編程性和實現(xiàn)方案易改動的特點，提出了一種基于FPGA和DDS技術(shù)的任意波形發(fā)生器
關(guān)鍵字： FPGA DDS 任意波形發(fā)生器

一種基于PLL的測試測量時鐘恢復(fù)方案

不管是放到測試設(shè)置中，還是作為被測設(shè)備的一部分，時鐘恢復(fù)都在進行準(zhǔn)確的測試測量時發(fā)揮著重要作用。由于...
關(guān)鍵字： PLL 時鐘恢復(fù) 測試測量

一種基于DDS和Qt的“所見即所得”波形發(fā)生器

提出一種基于直接數(shù)字頻率合成(DDS)技術(shù)和Qt鳊程的任意波形發(fā)生器(AWG)的整體設(shè)計方案。完成了DDS在FPGA中的硬件修改設(shè)計以及在Linux環(huán)境下Qt程序的軟件設(shè)計和內(nèi)核驅(qū)動程序的開發(fā)，并給出實驗結(jié)果。實驗結(jié)果表明：通過觸摸筆繪制任意波形，即可產(chǎn)生與所繪波形在時間和電壓上均相同的實際電信號，達到“所見即所得”的效果，以滿足各種測試和試驗的要求。
關(guān)鍵字： DDS 波形發(fā)生器

基于PLL技術(shù)的合成頻率源設(shè)計

1 引言　　頻率源是現(xiàn)代射頻和微波電子系統(tǒng)的心臟,其性能直接影響整個電子系統(tǒng)的功能，成為非常重要的部件?！　☆l率源分為二大類：自激振蕩源和合成頻率源。常見的自激振蕩源有晶體振蕩器、腔體振蕩器、介質(zhì)振蕩器、
關(guān)鍵字： PLL 合成頻率源

PLL-VCO設(shè)計及制作第二部分

VCO電路的設(shè)計VCO電路為使用上章的備注欄所介紹的庫拉普振蕩電路。將線圈與電容組合，使達到設(shè)計規(guī)格的40M~60 ...
關(guān)鍵字： PLL-VCO

PLL-VCO設(shè)計及制作第一部分

在此說明以晶體振蕩器做為基準(zhǔn)振蕩器，將其與VCO以及PLL電路組合成為信號產(chǎn)生器的情形也被稱為頻率合成器。此 ...
關(guān)鍵字： PLL-VCO

DDS的調(diào)頻信號發(fā)生器的硬件設(shè)計與仿真

DDS(直接數(shù)字頻率合成器)具有相位變換連續(xù)、頻率轉(zhuǎn)換速度快、頻率分辨率高、相位噪聲低、頻率穩(wěn)定度高、集 ...
關(guān)鍵字： DDS

基于PLL的測試測量時鐘恢復(fù)方案

　不管是放到測試設(shè)置中，還是作為被測設(shè)備的一部分，時鐘恢復(fù)都在進行準(zhǔn)確的測試測量時發(fā)揮著重要作用。由于大多數(shù)千兆位通信系統(tǒng)都是同步系統(tǒng)，因此系統(tǒng)內(nèi)部的數(shù)據(jù)都使用公共時鐘定時。不管是沿著幾英寸的電路板傳
關(guān)鍵字： PLL 測試測量時鐘恢復(fù) 方案

國家電網(wǎng)單相表DDS-GW解決方案

方案簡介隨著電子式電能表技術(shù)的迅速發(fā)展，電網(wǎng)的智能化和信息化成為一個必然的趨勢。因此，智能電表潛在著巨大的市場需求。為了更好的建設(shè)和發(fā)展國家電網(wǎng)，國家電網(wǎng)公司于2009年9月頒布了新的《智能電能表系列標(biāo)準(zhǔn)》
關(guān)鍵字：解決方案 DDS-GW 單相電網(wǎng) 國家

基于DDS的橢圓函數(shù)低通濾波器的設(shè)計

摘要：低通濾波器是直接數(shù)字頻率合成DDS的重要組成部分，其性能的好壞直接影響整個DDS的特性。提出一種基于DDS的橢圓函數(shù)低通濾波器的設(shè)計方案，該設(shè)計采用全新的歸一化方法，并使用EDA軟件Multisim2001進行仿真，確
關(guān)鍵字： DDS 橢圓函數(shù) 低通濾波器

直接數(shù)字頻率合成DDS原理及基于FPGA的實現(xiàn)

直接數(shù)字頻率合成技術(shù)(DirectDigitalSynthesis，DDS)是一種從相位概念出發(fā)直接合成所需要的波形的新的...
關(guān)鍵字： DDS FPGA 數(shù)字通信系統(tǒng)

DDS原理及基于FPGA的實現(xiàn)

本文主要介紹了DDS的原理及通過FPGA來實現(xiàn)。
關(guān)鍵字： FPGA DDS 原理

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以太網(wǎng)物理層芯片時鐘同步PLL的設(shè)計方案
寬帶低誤差矢量幅度(EVM)直接變頻發(fā)射機原理圖
采用M51728L的PLL電路
CD4046組成的PLL調(diào)頻解調(diào)

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如何根據(jù)基本的數(shù)據(jù)表規(guī)格估算出PLL的相位噪聲
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有什么芯片或電路可以實現(xiàn)檢測方波信號的有無？
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