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NI發(fā)布以太網(wǎng)供電視覺(jué)幀接收器幫助簡(jiǎn)化視覺(jué)系統(tǒng)設(shè)計(jì)
- · NI 發(fā)布了三款采用以太網(wǎng)供電(PoE)技術(shù)且配有基于FPGA I/O的最新GigE 視覺(jué)幀接收器。 PoE技術(shù)通過(guò)以太網(wǎng)總線為相機(jī)供電，因而不需要連接外部電源，從而簡(jiǎn)化了系統(tǒng)設(shè)計(jì)并減低布線復(fù)雜度。 幀接收器還具有多個(gè)高級(jí)觸發(fā)和同步選項(xiàng)，比如基于FPGA的網(wǎng)絡(luò)觸發(fā)器，用于通過(guò)以太網(wǎng)執(zhí)行確定性低延遲相機(jī)觸發(fā)。 新聞發(fā)布 - 2013年5月- 美國(guó)國(guó)家儀器公司(National Instruments, 簡(jiǎn)稱 NI)于近日發(fā)布了采用PoE技術(shù)的NI PCIe
- 關(guān)鍵字： NI FPGA 接收器
利用賽靈思FPGA輕松應(yīng)對(duì)內(nèi)窺鏡系統(tǒng)架構(gòu)挑戰(zhàn)
- 本文將對(duì)賽靈思FPGA進(jìn)行全面論述，介紹其如何幫助內(nèi)窺鏡制造商克服復(fù)雜的設(shè)計(jì)約束，生產(chǎn)出極具競(jìng)爭(zhēng)優(yōu)勢(shì)的產(chǎn)品;如何幫助他們成功構(gòu)建外形小巧的低功耗內(nèi)窺鏡攝像頭、高性價(jià)比的攝像機(jī)控制單元(CCU)，以及多功能、低成
- 關(guān)鍵字： FPGA 賽靈思 內(nèi)窺鏡 系統(tǒng)架構(gòu)
基于FPGA的AVS視頻解碼芯片仿真和驗(yàn)證平臺(tái)設(shè)計(jì)
- AVS是我國(guó)具備自主知識(shí)產(chǎn)權(quán)的第二代信源編碼標(biāo)準(zhǔn)，其編碼效率比MPEG-2高2～3倍，與AVC相當(dāng)，但技術(shù)方案簡(jiǎn)潔，芯片實(shí)現(xiàn)復(fù)雜度低，是一套包含系統(tǒng)、視頻、音頻和媒體版權(quán)管理在內(nèi)的完整標(biāo)準(zhǔn)體系，為數(shù)字音視頻產(chǎn)業(yè)提供
- 關(guān)鍵字： FPGA AVS 視頻解碼 平臺(tái)設(shè)計(jì)
SatixFy取得CEVA-XC DSP授權(quán)許可 將應(yīng)用在寬頻衛(wèi)星領(lǐng)域
- 硅產(chǎn)品智慧財(cái)產(chǎn)權(quán)（SIP）平臺(tái)解決方案和數(shù)位訊號(hào)處理器（DSP）內(nèi)核授權(quán)廠商CEVA公司宣佈，開(kāi)發(fā)高成本效益衛(wèi)星通訊SoC ...
- 關(guān)鍵字： SatixFy CEVA-XC DSP 授權(quán)許可 寬頻衛(wèi)星
如何在FPGA中實(shí)現(xiàn)狀態(tài)機(jī)
- 如何在FPGA中實(shí)現(xiàn)狀態(tài)機(jī), FPGA常常用于執(zhí)行基于序列和控制的行動(dòng)，比如實(shí)現(xiàn)一個(gè)簡(jiǎn)單的通信協(xié)議。對(duì)于設(shè)計(jì)人員來(lái)說(shuō)，滿足這些行動(dòng)和序列要求的最佳方法則是使用狀態(tài)機(jī)。狀態(tài)機(jī)是在數(shù)量有限的狀態(tài)之間進(jìn)行轉(zhuǎn)換的邏輯結(jié)構(gòu)。一個(gè)狀態(tài)機(jī)在某個(gè)特定
- 關(guān)鍵字： 狀態(tài) 實(shí)現(xiàn) FPGA 如何
一種基于FPGA的接口電路設(shè)計(jì)
- 一種基于FPGA的接口電路設(shè)計(jì), 摘 要：在航空電子系統(tǒng)中，經(jīng)常需要對(duì)1553B總線和ARINC429總線進(jìn)行雙向數(shù)據(jù)轉(zhuǎn)換以適應(yīng)不同電子設(shè)備的接口要求。由于兩種總線標(biāo)準(zhǔn)傳輸協(xié)議不同，傳輸速率和數(shù)據(jù)格式有較大差異，常規(guī)系統(tǒng)需要多種專業(yè)數(shù)據(jù)轉(zhuǎn)換芯片以
- 關(guān)鍵字： 電路設(shè)計(jì) 接口 FPGA 基于
DSP 在電源設(shè)計(jì)中的應(yīng)用
- DSP 在電源設(shè)計(jì)中的應(yīng)用,采用分立元件或CPLD、FPGA 進(jìn)行電源的信號(hào)發(fā)生和測(cè)量的設(shè)計(jì)，會(huì)增加硬件設(shè)計(jì)復(fù)雜程度，延長(zhǎng)開(kāi)發(fā)周期。為了簡(jiǎn)化電源信號(hào)發(fā)生及測(cè)量的硬件設(shè)計(jì)，縮短開(kāi)發(fā)周期，本文提出一種基于DSP 的嵌入式操作平臺(tái)，采用DDS( 直接數(shù)字式頻率合成器) 及乘法器矢量測(cè)量技術(shù)的設(shè)計(jì)方案。該方案利用DSP 的高速運(yùn)算能力，通過(guò)實(shí)時(shí)計(jì)算來(lái)實(shí)現(xiàn)分立元件或CPLD、FPGA 的硬件邏輯功能。實(shí)驗(yàn)結(jié)果表明該方案切實(shí)可行。
- 關(guān)鍵字： 電源 頻率 DSP
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