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FPGA：22年從配角到主角

任何一個(gè)從事后看來很成功的新事物從誕生到發(fā)展壯大都不可避免地經(jīng)歷過艱難的歷程并可能成為被研究的案例，F(xiàn)PGA也不例外。1985年，當(dāng)全球首款FPGA產(chǎn)品——XC2064誕生時(shí)，注定要使用大量芯片的PC機(jī)剛剛走出硅谷的實(shí)驗(yàn)室進(jìn)入商業(yè)市場(chǎng)，因特網(wǎng)只是科學(xué)家和政府機(jī)構(gòu)通信的神秘鏈路，無線電話笨重得像磚頭，日后大紅大紫的Bill Gates正在為生計(jì)而奮斗，創(chuàng)新的可編程產(chǎn)品似乎并沒有什么用武之地。　　事實(shí)也的確如此。最初，F(xiàn)PGA只是用于膠合邏輯，從膠合邏輯到算法
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TI達(dá)芬奇技術(shù)使視頻安全與監(jiān)控應(yīng)用獲得系統(tǒng)性能雙倍提升

日前，德州儀器(TI)針對(duì)視頻安全監(jiān)控應(yīng)用推出了TMS320DM647與TMS320DM648兩款全新達(dá)芬奇(DaVinci)技術(shù)數(shù)字信號(hào)處理器（DSPs）。 TI致力于通過領(lǐng)先的軟硬件技術(shù)、工具與支持不斷推動(dòng)數(shù)字視頻市場(chǎng)創(chuàng)新，以滿足包括數(shù)碼錄像機(jī)(DVR)、IP視頻服務(wù)器、機(jī)器視覺系統(tǒng)與高性能成像應(yīng)用等在內(nèi)的多通道視頻安全與基礎(chǔ)局端應(yīng)用的要求。兩款新品建立在TI最新TMS320C64x+ DSP內(nèi)核基礎(chǔ)上，為基于TMS320DM642
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數(shù)字差分BPSK擴(kuò)頻接收機(jī)的設(shè)計(jì)與FPGA實(shí)現(xiàn)

本文提出了一種全數(shù)字差分BPSK擴(kuò)頻接收機(jī)的實(shí)現(xiàn)方案，通過Simulink仿真驗(yàn)證了該方案具有較低的誤碼率。
關(guān)鍵字： FPGA 實(shí)現(xiàn) 設(shè)計(jì) 接收機(jī) BPSK 擴(kuò)頻數(shù)字差分

利用FPGA實(shí)現(xiàn)UART的設(shè)計(jì)

引言　　隨著計(jì)算機(jī)技術(shù)的發(fā)展和廣泛應(yīng)用，尤其是在工業(yè)控制領(lǐng)域的應(yīng)用越來越廣泛，計(jì)算機(jī)通信顯的尤為重要。串行通信雖然使設(shè)備之間的連線大為減少，但隨之帶來串／并轉(zhuǎn)換和位計(jì)數(shù)等問題，這使串行通信技術(shù)比并行通信技術(shù)更為復(fù)雜。串／并轉(zhuǎn)換可用軟件實(shí)現(xiàn)，也可用硬件實(shí)現(xiàn)。用軟件實(shí)現(xiàn)串行傳送大多采用循環(huán)移位指令將一個(gè)字節(jié)由高位到低位(或低位到高位)一位一位依次傳送，這種方法雖然簡(jiǎn)單但速度慢，而且大量占用CPU的時(shí)間，影響系統(tǒng)的性能。更為方便的實(shí)現(xiàn)方法是用硬件，目前微處理器串行接口常用的LSI 芯片是UART(通用異
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基于FPGA的八位RISC CPU的設(shè)計(jì)

1 引言　　隨著數(shù)字通信和工業(yè)控制領(lǐng)域的高速發(fā)展，要求專用集成電路（ASIC）的功能越來越強(qiáng)，功耗越來越低，生產(chǎn)周期越來越短，這些都對(duì)芯片設(shè)計(jì)提出了巨大的挑戰(zhàn)，傳統(tǒng)的芯片設(shè)計(jì)方法已經(jīng)不能適應(yīng)復(fù)雜的應(yīng)用需求了。SoC（System on a Chip）以其高集成度，低功耗等優(yōu)點(diǎn)越來越受歡迎。開發(fā)人員不必從單個(gè)邏輯門開始去設(shè)計(jì)ASIC，而是應(yīng)用己有IC芯片的功能模塊，稱為核（core），或知識(shí)產(chǎn)權(quán)（IP）宏單元進(jìn)行快速設(shè)計(jì)，效率大為提高。CPU 的IP
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定點(diǎn)DSP的準(zhǔn)確計(jì)時(shí)

數(shù)字信號(hào)處理（ＤＳＰ）是一門涉及許多學(xué)科而又廣泛應(yīng)用于許多領(lǐng)域的新興學(xué)科。２０世紀(jì)６０年代以來，隨著計(jì)算機(jī)技術(shù)和信息技術(shù)的飛速發(fā)展，數(shù)字信號(hào)處理技術(shù)應(yīng)運(yùn)而生，并得到迅速的發(fā)展。在過去的二十多年里，ＤＳＰ已經(jīng)在通信等領(lǐng)域得到極為廣泛的應(yīng)用，特別是在一些測(cè)量控制領(lǐng)域?熏應(yīng)用更是越來越廣泛。本文擬采用定點(diǎn)ＤＳＰ——ＴＭＳ３２０Ｆ２０６來測(cè)量一些物理量，如測(cè)交流信號(hào)的頻率、相位，但這些物理量的測(cè)量都離不開信號(hào)時(shí)間的測(cè)量，所以采用定點(diǎn)ＤＳＰ準(zhǔn)確地測(cè)量時(shí)間直接關(guān)系到這些物理量測(cè)量
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DSP和PBL3717A構(gòu)成的步進(jìn)電機(jī)的控制系統(tǒng)

　　摘要：介紹由美國(guó)TI公司的數(shù)字信號(hào)處理器TMS320LF2407A和SGS公司的步進(jìn)電機(jī)驅(qū)動(dòng)芯片PBL3717A構(gòu)成的兩相混合式步進(jìn)電機(jī)的控制系統(tǒng)。　　關(guān)鍵詞：PBL3717A DSP 步進(jìn)電機(jī) 控制系統(tǒng) 　　引言　　步進(jìn)電機(jī)是數(shù)字控制系統(tǒng)中的一種重要執(zhí)行元件，廣泛應(yīng)用于各種控制系統(tǒng)中。它是一種將電脈沖信號(hào)轉(zhuǎn)換為位移或轉(zhuǎn)速的控制電機(jī)，輸入一個(gè)脈沖信號(hào)，電機(jī)就轉(zhuǎn)動(dòng)一個(gè)角度或前進(jìn)一步。其機(jī)械角位移和轉(zhuǎn)速分別與輸入電機(jī)繞組的脈沖個(gè)數(shù)和脈沖頻率成比例，可以通過改變脈沖頻率在大范圍內(nèi)調(diào)速，易于與計(jì)算
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Altera首次實(shí)現(xiàn)了對(duì)關(guān)鍵工業(yè)以太網(wǎng)協(xié)議的FPGA IP支持

　　Altera公司日前宣布為工業(yè)自動(dòng)化應(yīng)用中的以太網(wǎng)通信協(xié)議提供FPGA支持，這些應(yīng)用包括ProfiNet、Ethernet/IP、Modbus-IDA、EtherCAT、SERCOS III接口和Ethernet Powerlink等。這些關(guān)鍵通信協(xié)議的知識(shí)產(chǎn)權(quán)(IP)內(nèi)核現(xiàn)在可以在Altera低成本Cyclone®系列FPGA中實(shí)現(xiàn)。　　設(shè)計(jì)人員利用工業(yè)以太網(wǎng)IP內(nèi)核可以在一塊電路板上實(shí)現(xiàn)任何標(biāo)準(zhǔn)，這不但減小了外形尺寸，而且節(jié)省了時(shí)間。系統(tǒng)OEM能夠以高性價(jià)比方式在其自動(dòng)化產(chǎn)品中增加工業(yè)
關(guān)鍵字：工業(yè)以太網(wǎng) FPGA IP 嵌入式工業(yè)控制

基于DSP技術(shù)的多路語音實(shí)時(shí)采集與壓縮處理系統(tǒng)

介紹一個(gè)多路語音實(shí)時(shí)采集與壓縮處理系統(tǒng)。該系統(tǒng)基于PC－ISA總線結(jié)構(gòu)，最大的特點(diǎn)是通過單片DSP高性能價(jià)格比實(shí)時(shí)地實(shí)現(xiàn)了多達(dá)10路的語音采集和10路語音實(shí)時(shí)壓縮及一路語音解壓處理。該系統(tǒng)已成功應(yīng)用于某語音記錄設(shè)備中。
關(guān)鍵字：壓縮處理理系采集實(shí)時(shí) DSP 技術(shù) 語音基于

一種基于DSP和采樣ADC的數(shù)字鎖定放大器

探討了用DSP（數(shù)字信號(hào)處理器）和采樣ADC（模數(shù)轉(zhuǎn)換器）實(shí)現(xiàn)數(shù)字鎖定放大器的一種方法。
關(guān)鍵字：鎖定放大器數(shù)字 ADC DSP 采樣基于

基于FPGA的智能控制器設(shè)計(jì)及測(cè)試方法研究

摘要：通過模糊自整定PID控制器的設(shè)計(jì)，本文提出了一種基于VHDL描述、DSP Builder和Modelsim混合仿真、FPGA實(shí)現(xiàn)的智能控制器設(shè)計(jì)及測(cè)試新方法。首先，通過MATLAB仿真，得出智能控制器的結(jié)構(gòu)和參數(shù)。然后，基于VHDL進(jìn)行智能控制器的數(shù)字化實(shí)現(xiàn)及其開環(huán)測(cè)試。在此基礎(chǔ)上，通過分析一般智能控制器的測(cè)試特點(diǎn)，采用DSP Builder構(gòu)建閉環(huán)測(cè)試系統(tǒng)，Modelsim運(yùn)行DSP Builder生成文件來驗(yàn)證QuartusII中所做VHDL設(shè)計(jì)的測(cè)試方法。實(shí)驗(yàn)表明，該測(cè)試方法能有效模擬控制器的
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DSP在無線傳感系統(tǒng)中的應(yīng)用

　　1. 引言　　在現(xiàn)代信息社會(huì)中，目標(biāo)辨識(shí)已經(jīng)得到了廣泛的應(yīng)用。例如超市中貨物的識(shí)別、圖書館中書刊的識(shí)別、銀行磁卡等都是目標(biāo)識(shí)別系統(tǒng)應(yīng)用的實(shí)例。尤其是近年來，自動(dòng)識(shí)別方法在許多服務(wù)領(lǐng)域、在貨物銷售與后勤分配方面、在商業(yè)部門、在生產(chǎn)企業(yè)和材料流通領(lǐng)域、在智能交通管理等方面得到了快速的普及和推廣。　　在幾年前，條形碼——紙帶在識(shí)別系統(tǒng)領(lǐng)域引起了一場(chǎng)革命并得到了廣泛的認(rèn)同與應(yīng)用。但是隨著現(xiàn)代社會(huì)的發(fā)展，這種技術(shù)在越來越多的情況下不能滿足人們的需求了。條形碼雖然便宜，但它的不足之處在于存儲(chǔ)能力小以及不能
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Stratix II FPGA系統(tǒng)電源設(shè)計(jì)

基于MAX1951的諸多特點(diǎn)，本文給出了采用該器件為Stratix II FPGA系統(tǒng)供電以降低其功耗的設(shè)計(jì)方案。
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基于VxWorks的多DSP系統(tǒng)的多任務(wù)程序設(shè)計(jì)

　　近年來，計(jì)算機(jī)產(chǎn)品的應(yīng)用領(lǐng)域越來越廣，數(shù)字信號(hào)處理器的發(fā)展表現(xiàn)得尤為明顯。DSP芯片制造商和DSP板開發(fā)商利用自身的優(yōu)勢(shì)不斷開發(fā)出多DSP結(jié)構(gòu)的產(chǎn)品來滿足這種需求。通常的DSP設(shè)備是與嵌入式系統(tǒng)相結(jié)合，來實(shí)時(shí)地完成某一特定任務(wù)。隨著信號(hào)采集速度和處理速度的要求越來越高，許多領(lǐng)域都需要進(jìn)行多處理器運(yùn)算，其中包括醫(yī)學(xué)、圖像處理、軍事、工業(yè)控制、電信等許多領(lǐng)域。多處理器系統(tǒng)可以根據(jù)所需實(shí)現(xiàn)的功能和處理器的性能來調(diào)節(jié)處理結(jié)點(diǎn)的數(shù)目，使系統(tǒng)達(dá)到最佳的性能價(jià)格比。　　實(shí)際上，只有從芯片開始仔細(xì)設(shè)計(jì)，才能方便
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Altera宣布其Cyclone III FPGA提供對(duì)EtherCAT IP支持

　　Altera公司日前宣布為EtherCAT技術(shù)協(xié)會(huì)的EtherCAT協(xié)議提供知識(shí)產(chǎn)權(quán)(IP)支持。此前IP是針對(duì)Cyclone® II器件，現(xiàn)在將針對(duì)Altera新的低成本、低功耗Cyclone III FPGA。　　EtherCAT技術(shù)協(xié)會(huì)執(zhí)行總監(jiān)Martin Rostan說：“在競(jìng)爭(zhēng)非常激烈的工廠自動(dòng)化設(shè)備市場(chǎng)上，企業(yè)正在尋找能夠迅速突出產(chǎn)品優(yōu)勢(shì)的新功能和特性。Cyclone III FPGA實(shí)現(xiàn)對(duì)EtherCAT的支持，使設(shè)計(jì)人員能夠以高性價(jià)比方式，輕松加入實(shí)時(shí)以太網(wǎng)功能?！? 　　
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