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賽靈思在中國IDF上展示全球性能最高的FPGA 加速模塊

　　賽靈思公司今天宣布將在本周舉辦的中國英特爾信息技術(shù)峰會（ Intel Developer Forum China）上展示全球性能最高的FPGA加速模塊。賽靈思計算加速平臺（ACP）采用基于FPGA的加速模塊滿足Intel基于FPGA的前端總線(FSB) 的要求并且展示了完全支持FSB的可插入Intel Xeon CPU插槽的Virtex-5 FPGA 模塊。　　賽靈思將展示通過Intel FSB總線在系統(tǒng)存儲器和最新的65nm Virtex&n
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Harris新視頻廣播路由器線路選用Altera Stratix II GX FPGA

　　Altera公司宣布，Harris公司在最近推出的Platinum™視頻廣播路由器線路中采用了Stratix® II GX開發(fā)套件和3Gbps串行數(shù)字接口(SDI)知識產(chǎn)權(quán)(IP) MegaCore®功能，使其開發(fā)時間縮短了幾個月。　　Harris廣播通信部總裁Tim Thorsteinson評論說：“Altera的SDI解決方案幫助我們節(jié)省了工程時間，保證了高清晰信號完整性。Altera為我們提供全面的開發(fā)支持，包括高質(zhì)量MegaCore，提高了我們工程團(tuán)隊的效能，使
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賽靈思推出新型低成本SPARTAN-DSP系列

　　賽靈思公司日前宣布推出首個低成本 Spartan™-DSP 系列產(chǎn)品以及相應(yīng)的開發(fā)板和增強(qiáng)設(shè)計軟件，極大地擴(kuò)展了其XtremeDSP™解決方案的產(chǎn)品線，并且在價格、性能和功耗三合一組合方面為數(shù)字信號處理樹立了新的標(biāo)桿。Spartan-DSP以業(yè)界最低的成本價格提供了高達(dá)20GMACS（每秒十億次乘法累計）的DSP功能，而價格不到30美元。與同類的其它高性能可配置DSP器件相比，該系列產(chǎn)品的動態(tài)功耗降低多達(dá)50%。　　新推出Spartan-DSP系列之后，XtremeDSP產(chǎn)
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基于DSP實現(xiàn)的無差拍控制逆變器

隨著計算機(jī)以及各種精密自動化設(shè)備、電子設(shè)備被廣泛應(yīng)用于通信、工業(yè)自動化控制、辦公自動化等領(lǐng)域, 逆變器作為 UPS的重要組成部分，近年來得到了迅速展。對逆變器的控制成為研究重點，即要求其輸出波形穩(wěn)態(tài)精度高、總諧波畸變率低和動態(tài)響應(yīng)快。目前，瞬時 PID控制、重復(fù)控制等技術(shù)都在應(yīng)用中占有重要地位。但這兩種技術(shù)都有難以克服的缺點，如瞬時PID控制難以實現(xiàn)數(shù)字化；重復(fù)控制的動態(tài)響應(yīng)慢。美國著名控制理論專家卡爾曼于60年代初提出了數(shù)字控制的無差拍控制思想。隨著電力電子技術(shù)的發(fā)展，80年代中期，無差拍控制被應(yīng)用于逆
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賽靈思推出65nm FPGA Virtex-5的PCI Express開發(fā)套件

賽靈思公司宣布推出基于業(yè)界第一個列入PCI SIG集成商列表的65nm FPGA- Virtex-5的 PCI Express開發(fā)套件。包括一個開發(fā)套件和協(xié)議包文件在內(nèi)的完全解決方案可幫助設(shè)計人員加快1-8路 PCIe 應(yīng)用的設(shè)計，可幫助客戶加快通信和網(wǎng)絡(luò)、視頻和廣播、存儲和計算、工業(yè)以及航空和國防等多種市場應(yīng)用的產(chǎn)品速度。該開發(fā)套件為設(shè)計人員評估并放心地利用賽靈思PCI Express端點模塊完成設(shè)計提供了所需要的一切。賽靈思Virtex-5 FPGA內(nèi)建PCI Express端點模塊和低功耗3.2G
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基于DSP和CPLD的低功耗多路數(shù)據(jù)處理系統(tǒng)設(shè)計

引言隨著電子技術(shù)的應(yīng)用和發(fā)展，數(shù)字信號處理內(nèi)容日益復(fù)雜，同時，很多情況下要求整個系統(tǒng)具有低功耗的特點。為滿足這種要求，DSP芯片設(shè)計技術(shù)也在向低功耗、高性能的方向發(fā)展。從處理速度來看，TMS320VC5502的運算能力已經(jīng)達(dá)到了600MMACS，即每秒鐘可以完成6億次乘加運算。從功耗來看，TMS320VC5502內(nèi)核電壓只有1.26V，整個芯片的功耗也大大降低了。本文介紹了基于TMS320VC5502和CPLD XC95144的低功耗多路數(shù)據(jù)處理系統(tǒng)。模擬信號的輸入經(jīng)過50Hz陷波電路(濾除工頻
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將低成本FPGA用于視頻和圖像處理

FPGA已經(jīng)存在了十幾年的時間，在傳統(tǒng)概念中，F(xiàn)PGA價格昂貴，設(shè)計門檻較高，多用于通信和高端工業(yè)控制領(lǐng)域。最近幾年，低成本FPGA不斷推陳出新。半導(dǎo)體工藝的進(jìn)步不僅帶來FPGA成本的降低，還使其性能顯著提升，同時不斷集成一些新的硬件資源，比如內(nèi)嵌DSP塊、內(nèi)嵌RAM塊、鎖相環(huán)(PLL)、高速外部存儲器接口(DDR/DDR2)、高速LVDS接口等。在Altera公司90nm的Cyclone II FPGA內(nèi)部，還可以集成一種軟處理器Nios II及其外設(shè)，它是目前FPGA中應(yīng)用最為廣泛的軟處理器系統(tǒng)。
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微機(jī)保護(hù)中DSP與時鐘DS12CR887的接口設(shè)計

系統(tǒng)中其他外圍電路的控制方法和原理與時鐘芯片完全類似，以此方法可以搭建一個通用性強(qiáng)、性能穩(wěn)定的硬件平臺，再通過各種具體的保護(hù)應(yīng)用軟件，從而實現(xiàn)各種具體功能的微機(jī)保護(hù)裝置。
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簡化FPGA測試和調(diào)試

引言　　隨著FPGA的設(shè)計速度、尺寸和復(fù)雜度明顯增長，使得整個設(shè)計流程中的驗證和調(diào)試成為當(dāng)前FPGA系統(tǒng)的關(guān)鍵部分。獲得FPGA內(nèi)部信號有限、FPGA封裝和印刷電路板(PCB)電氣噪聲，這一切使得設(shè)計調(diào)試和檢驗變成設(shè)計周期中最困難的流程。另一方面，幾乎當(dāng)前所有的像CPU、DSP、ASIC等高速芯片的總線，除了提供高速并行總線接口外，正迅速的向高速串行接口的方向發(fā)展，F(xiàn)PGA也不例外，每一條物理鏈路的速度從600Mbps到高達(dá)10Gbps，高速IO的測試和驗證更成為傳統(tǒng)專注于FPGA內(nèi)部邏輯設(shè)計的設(shè)計人
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Altera FPGA在Fairlight新媒體處理引擎中替代64片DSP

2007年4月10號，北京——澳大利亞悉尼的音頻產(chǎn)品系統(tǒng)專業(yè)公司Fairlight利用Altera® FPGA的靈活性以及數(shù)字信號處理(DSP)優(yōu)勢，將采用了8塊電路板和64片DSP的設(shè)計精簡為一塊Stratix® FPGA PCI卡。 Fairlight首席技術(shù)官Tino Fibaek說：“我們的水晶內(nèi)核(CC-1)體系結(jié)構(gòu)表明，Altera FPGA在DSP功能上的性價比非常優(yōu)異。采用了Altera的開發(fā)工具后，該項目成為我見過的進(jìn)展最為順利的項目。我們完成開發(fā)所花費的時間僅是DSP
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MCS-51單片機(jī)與CPLD/FPGA接口邏輯設(shè)計

在功能上，單片機(jī)與大規(guī)模CPLD有很強(qiáng)的互補(bǔ)性。單片機(jī)具有性能價格比高、功能靈活、易于人機(jī)對話、良好的數(shù)據(jù)處理能力濰點；CPLD/FPGA則具有高速、高可靠以及開發(fā)便捷、規(guī)范等優(yōu)點。以此兩類器件相結(jié)合的電路結(jié)構(gòu)在許多高性能儀器儀表和電子產(chǎn)品中仍將被廣泛應(yīng)用。本文就單片機(jī)與CPLD/FPGA的接口方式作一簡單介紹，希望對從事單片機(jī)和CPLD/FPGA研發(fā)的朋友能有所啟發(fā)。單片機(jī)與CPLD/FPGA的接口方式一般有兩種，即總線方式與獨立方式，分別說明
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Altera FPGA在Fairlight新媒體處理引擎中替代64片DSP

　　澳大利亞悉尼的音頻產(chǎn)品系統(tǒng)專業(yè)公司Fairlight利用Altera® FPGA的靈活性以及數(shù)字信號處理(DSP)優(yōu)勢，將采用了8塊電路板和64片DSP的設(shè)計精簡為一塊Stratix® FPGA PCI卡。　　Fairlight首席技術(shù)官Tino Fibaek說：“我們的水晶內(nèi)核(CC-1)體系結(jié)構(gòu)表明，Altera FPGA在DSP功能上的性價比非常優(yōu)異。采用了Altera的開發(fā)工具后，該項目成為我見過的進(jìn)展最為順利的項目。我們完成開發(fā)所花費的時間僅是DSP器件體系結(jié)構(gòu)設(shè)計的三分
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基于FPGA的簡易可存儲示波器設(shè)計

摘要：　本文介紹了一種基于FPGA的采樣速度60Mbit/s的雙通道簡易數(shù)字示波器設(shè)計，能夠?qū)崿F(xiàn)量程和采樣頻率的自動調(diào)整、數(shù)據(jù)緩存、顯示以及與計算機(jī)之間的數(shù)據(jù)傳輸。關(guān)鍵詞：數(shù)據(jù)采集；數(shù)字示波器；FPGA 引言　　傳統(tǒng)的示波器雖然功能齊全，但是體積大、重量重、成本高、等一系列問題使應(yīng)用受到了限制。有鑒于此，便攜式數(shù)字存儲采集器就應(yīng)運而生，它采用了LCD顯示、高速A/D采集與轉(zhuǎn)換、ASIC芯片等新技術(shù)，具有很強(qiáng)的實用性和巨大的市場潛力，也代表了當(dāng)代電子測量儀器的一種發(fā)展趨勢，即向功能多、體積小、重量輕、
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基于DSP的PCI總線數(shù)據(jù)采集系統(tǒng)的研究

1 引言隨著數(shù)字信號處理器性能的不斷提高及其成本與售價的大幅下降，數(shù)字信號處理應(yīng)用領(lǐng)域飛速擴(kuò)展，信號處理進(jìn)入了一個新的發(fā)展時期。同時隨著計算機(jī)技術(shù)以及互聯(lián)網(wǎng)絡(luò)技術(shù)的不斷發(fā)展，越來越多的數(shù)據(jù)需要經(jīng)過計算機(jī)來進(jìn)行處理、存儲、傳輸籌操作。計算機(jī)的應(yīng)用已經(jīng)遍及我們生活的每一個角落。由于計算機(jī)本身的特點，通用計算機(jī)通常僅負(fù)責(zé)沒有實時性要求的工作，而不適于進(jìn)行實時性要求很高的數(shù)字信號處理。將計算機(jī)和 DSP有機(jī)地結(jié)合起來，充分利用各自的優(yōu)點，它們將會相得益彰，滿足現(xiàn)實應(yīng)用中對數(shù)據(jù)實時處理能力、數(shù)據(jù)傳輸能力以及數(shù)
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