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多通道實時陣列信號處理系統(tǒng)的設(shè)計
- 摘要：以全數(shù)字化信號產(chǎn)生和數(shù)字波束形成處理為基礎(chǔ)的數(shù)字化陣列雷達已成為當(dāng)代相控陣雷達技術(shù)發(fā)展的一個重要趨勢，本文針對現(xiàn)代數(shù)字化陣列雷達對多通道數(shù)據(jù)采集和實時處理的需求，設(shè)計了一種基于FPGA的多通道實時陣
- 關(guān)鍵字： 陣列信號 多通道采集 FPGA 數(shù)字波束合成
完善FPGA系統(tǒng)設(shè)計的三原則
- 一，面積與速度的平衡互換原則這里的面積指的是FPGA的芯片資源，包括邏輯資源和I/O資源等;這里的速度指的是FPGA工作的最高頻率(和DSP或者ARM不同，F(xiàn)PGA設(shè)計的工作頻率是不固定的，而是和設(shè)計本身的延遲緊密相連)。
- 關(guān)鍵字： FPGA 系統(tǒng)設(shè)計 設(shè)計原則
三柵極技術(shù)給FPGA帶來突破性優(yōu)勢
- 本文考察了半導(dǎo)體制造業(yè)中晶體管設(shè)計從傳統(tǒng)平面向3D結(jié)構(gòu)轉(zhuǎn)化的影響，以及其對可編程邏輯器件性能的顯著提升。引言2013年2月，Altera公司與Intel公司共同宣布了Altera下一代最高性能FPGA產(chǎn)品的生產(chǎn)將獨家采用Intel的
- 關(guān)鍵字： 三柵極 FPGA 3D結(jié)構(gòu) 可編程邏輯器件
基于BF533和FPGA的雷達信號模擬器設(shè)計實現(xiàn)
- 隨著軍事技術(shù)的高速發(fā)展，現(xiàn)代雷達系統(tǒng)面臨著嚴峻的挑戰(zhàn)。為適應(yīng)新形勢，在現(xiàn)代數(shù)字信號處理技術(shù)和數(shù)字計算機高速發(fā)展的基礎(chǔ)上，計算機仿真技術(shù)得到廣泛應(yīng)用，這也促使雷達信號模擬技術(shù)快速發(fā)展。雷達信號模擬器是現(xiàn)
- 關(guān)鍵字： 雷達信號模擬器 DSP FPGA 數(shù)字頻率合成
基于FPGA非正弦波形發(fā)生器的電路設(shè)計
- 隨著直流輸電技術(shù)的應(yīng)用發(fā)展，高壓電纜線路和補償電容的增多，電力系統(tǒng)中的諧波分量將大大增加，它給電力設(shè)備和弱電系統(tǒng)帶來了諧波污染，并且電力電子裝置的日益增多，使電網(wǎng)中的高次諧波愈來愈嚴重。因此，檢驗諧波控制設(shè)備的性能，或者測試負載設(shè)備在收到擾動時的工作情況等，需要一些專門的諧波發(fā)生器來產(chǎn)生所需的諧波。
- 關(guān)鍵字： 非正弦波形發(fā)生器 FPGA LPM DA9708
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