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flash fpga 文章進(jìn)入flash fpga技術(shù)社區(qū)

用VHDL/VerilogHD語言開發(fā)PLD/FPGA的完整流程

用VHDL/VerilogHD語言開發(fā)PLD/FPGA的完整流程,用VHDL/VerilogHD語言開發(fā)PLD/FPGA的完整流程為：　　1.文本編輯：用任何文本編輯器都可以進(jìn)行，也可以用專用的HDL編輯環(huán)境。通常VHDL文件保存為.vhd文件，Verilog文件保存為.v文件　　2.功能仿真：將文件調(diào)入HDL仿真
關(guān)鍵字：完整流程 PLD/FPGA 開發(fā) 語言 VHDL/VerilogHD

基于FPGA的LED電視動(dòng)態(tài)背光系統(tǒng)設(shè)計(jì)

基于FPGA的LED電視動(dòng)態(tài)背光系統(tǒng)設(shè)計(jì),本文設(shè)計(jì)一款基于FPGA(現(xiàn)場(chǎng)可編程門陣列)的液晶電視動(dòng)態(tài)背光系統(tǒng)，采用LED側(cè)背光方式，符合當(dāng)前液晶電視LED背光應(yīng)用主流?！　‰娨晞?dòng)態(tài)背光　　以往的電視機(jī)主板將圖像信號(hào)通過LVDS(LowVoltageDifferentialSignal，低
關(guān)鍵字：背光系統(tǒng) 設(shè)計(jì) 動(dòng)態(tài) 電視 FPGA LED 基于

基于FPGA的IPV6數(shù)字包的分離與封裝的實(shí)現(xiàn)

基于FPGA的IPV6數(shù)字包的分離與封裝的實(shí)現(xiàn),筆者在參加國(guó)家“863”重大專題項(xiàng)目“高速密碼芯片及驗(yàn)證平臺(tái)系統(tǒng)”的過程中，遇到了將IPV6數(shù)據(jù)包的包頭和數(shù)據(jù)部分拆開，然后在數(shù)據(jù)部分送密碼芯片進(jìn)行加/解密處理，最后再將處理后的數(shù)據(jù)部分與
關(guān)鍵字：封裝實(shí)現(xiàn) 分離數(shù)字 FPGA IPV6 基于

FPGA進(jìn)入硅片融合時(shí)代

FPGA在經(jīng)過了從上世紀(jì)90年代到2000年的快速發(fā)展、隨后短期的泡沫破裂、以及近幾年的平穩(wěn)增長(zhǎng)的發(fā)展階段，未來會(huì)邁入硅片融合時(shí)代。 Altera公司資深副總裁兼首席技術(shù)官M(fèi)isha Burich 下面這張圖能夠很直觀的表示FPGA的演進(jìn)過程，結(jié)構(gòu)越來越復(fù)雜，功能越來越強(qiáng)大，應(yīng)用越來越廣泛。 F
關(guān)鍵字： Altera FPGA 硅片融合

基于FPGA狀態(tài)機(jī)的智能手推車多模式控制應(yīng)用

摘要：本設(shè)計(jì)采用XILINX Spartan-3E系列FPGA芯片，在基于FPGA(現(xiàn)場(chǎng)可編程門陣列)器件的設(shè)計(jì)中，狀態(tài)機(jī)是目前應(yīng)用最普遍的設(shè)計(jì)方法之一。
關(guān)鍵字： FPGA XILINX 201205

基于FPGA的實(shí)時(shí)數(shù)字化光纖傳輸系統(tǒng)

摘要提出一種實(shí)時(shí)數(shù)字化光纖傳輸系統(tǒng)，該系統(tǒng)分為發(fā)送端和接收端。發(fā)送端用A／D轉(zhuǎn)換器將輸入的模擬信號(hào)數(shù)字化，再用FPGA對(duì)數(shù)據(jù)進(jìn)行處理，并通過光纖傳輸。同時(shí)，F(xiàn)PGA還控制A／D轉(zhuǎn)換器的工作。接收端用串行收發(fā)器TLK
關(guān)鍵字： FPGA 實(shí)時(shí)數(shù)字光纖傳輸系統(tǒng)

開關(guān)磁阻電機(jī)全數(shù)字控制系統(tǒng)中FPGA的應(yīng)用

摘要：提出了基于數(shù)字信號(hào)處理器(DSP)和現(xiàn)場(chǎng)可編程門陣列(FPGA)的開關(guān)磁阻電動(dòng)機(jī)全數(shù)字控制系統(tǒng)，對(duì)DSP和FPGA的功能進(jìn)行了分配。根據(jù)開關(guān)磁阻電動(dòng)機(jī)的驅(qū)動(dòng)要求，分析控制邏輯，由FPGA實(shí)現(xiàn)了電流斬波、角度位置和PWM電
關(guān)鍵字： FPGA 開關(guān)磁阻電機(jī) 全數(shù)字控制系統(tǒng)

基于改進(jìn)的布斯算法FPGA嵌入式18×18乘法器

摘要：設(shè)計(jì)了一款嵌入FPGA的乘法器，該乘法器能夠滿足兩個(gè)18 b有符號(hào)或17 b無符號(hào)數(shù)的乘法運(yùn)算。該設(shè)計(jì)基于改進(jìn)的布斯算法，提出了一種新的布斯譯碼和部分積結(jié)構(gòu)，并對(duì)9-2壓縮樹和超前進(jìn)位加法器進(jìn)行了優(yōu)化。該乘法器
關(guān)鍵字： FPGA 算法嵌入式乘法器

基于FPGA的FFT算法優(yōu)化及其在磁共振譜儀中的應(yīng)用

摘要：提出了一種基于FPGA的依據(jù)核磁共振譜儀雙通道頻譜圖對(duì)其信號(hào)增益和相位差不平衡進(jìn)行調(diào)節(jié)的設(shè)計(jì)方案，詳細(xì)闡述了FFT算法在FPGA中的設(shè)計(jì)與實(shí)現(xiàn)方法。該模塊中的FFT處理器通過多個(gè)64點(diǎn)并行FFT模塊復(fù)用實(shí)現(xiàn)，復(fù)數(shù)乘
關(guān)鍵字： FPGA FFT 算法優(yōu)化磁共振

基于FPGA高階FIR濾波器的實(shí)現(xiàn)

摘要：從FIR數(shù)字濾波器的基本結(jié)構(gòu)模型出發(fā)，分析了FIR濾波器的設(shè)計(jì)思路及具體實(shí)現(xiàn)方法，詳細(xì)介紹了FIR濾波器的分布式算法(DA)結(jié)構(gòu)。通過分析計(jì)算，得到普通DA結(jié)構(gòu)實(shí)現(xiàn)高階濾波器會(huì)消耗大量的查找表資源，這樣的資源消
關(guān)鍵字： FPGA FIR 濾波器

如何用FPGA構(gòu)建更出色的DC/DC調(diào)節(jié)器

摘要：設(shè)計(jì)人員此前一直使用模擬元件來構(gòu)建開關(guān)模式DC/DC轉(zhuǎn)換器(定制型IC、運(yùn)算放大器、電阻、電容等)，控制反饋回路，并生成開關(guān)所需的脈寬調(diào)制。使用這種模擬元件時(shí)，我們必須考慮一系列因素，包括容差、電氣應(yīng)力、老化漂移以及溫度漂移，這樣才能確保設(shè)計(jì)方案的穩(wěn)定性?，F(xiàn)在，我們擁有低成本低功耗FPGA以及模數(shù)轉(zhuǎn)換器，使得FPGA能夠取代傳統(tǒng)的模擬設(shè)計(jì)方法。
關(guān)鍵字： DC/DC FPGA 轉(zhuǎn)換器 201205

一種矢量信號(hào)發(fā)生器設(shè)計(jì)與實(shí)現(xiàn)

摘要：充分利用DDR2 SDRAM速度快、FLASH掉電不消失、MATLAB/Simulink易產(chǎn)生矢量信號(hào)的特點(diǎn)，以FPGA為邏輯時(shí)序控制器，設(shè)計(jì)并實(shí)現(xiàn)了一種靈活、簡(jiǎn)單、低成本的矢量信號(hào)發(fā)生器。本文以產(chǎn)生3載波WCDMA為例，詳細(xì)介紹了矢量信號(hào)發(fā)生器的設(shè)計(jì)方案與實(shí)現(xiàn)過程，使用Verilog HDL描述并實(shí)現(xiàn)了DDR2 SDRAM的時(shí)序控制和FPGA的邏輯控制。
關(guān)鍵字： DDR2 SDRAM FLASH 201205

基于FPGA的森林防火統(tǒng)一通信平臺(tái)研究

摘要：隨著林業(yè)的不斷發(fā)展，森林的防火工作顯得尤為重要，當(dāng)火警發(fā)生時(shí)，一種及時(shí)有效的通信平臺(tái)對(duì)于救火工作顯得極為重要。為滿足森林救火統(tǒng)一通信的需求，研究了一種森林防火語音統(tǒng)一通信平臺(tái)，適用于森林救火，采用了FPGA高速信號(hào)處理芯片，可提高產(chǎn)品性能。
關(guān)鍵字： FPGA 通信 201205

基于DSP+FPGA的高精度程控交流電源設(shè)計(jì)

摘要：介紹了一種基于DSP+FPGA芯片技術(shù)的高精度程控交流電源的實(shí)現(xiàn)方法，利用FPGA實(shí)現(xiàn)了任意波形發(fā)生功能，并對(duì)功率逆變等電路進(jìn)行了詳細(xì)的分析和設(shè)計(jì)，最后給出了實(shí)驗(yàn)結(jié)果以及相關(guān)波形。關(guān)鍵詞：交流電源；程控；任
關(guān)鍵字： FPGA DSP 高精度程控

基于FPGA實(shí)現(xiàn)低成本、小體積PET系統(tǒng)

基于FPGA實(shí)現(xiàn)低成本、小體積PET系統(tǒng),隨著醫(yī)療成像系統(tǒng)不斷追求更高的性能，傳統(tǒng)的模擬及分立器件越來越難以滿足系統(tǒng)設(shè)計(jì)的要求，而采用數(shù)字信號(hào)處理技術(shù)DSP、FPGA已成為了必然的選擇。好處顯然易見，無論是從系統(tǒng)的集成度還是成本、性能上來看，都給設(shè)計(jì)
關(guān)鍵字： FPGA PET 體積系統(tǒng)

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基于FPGA的機(jī)載顯示系統(tǒng)架構(gòu)設(shè)計(jì)與優(yōu)化
基于FPGA+DSP遠(yuǎn)程監(jiān)控器設(shè)計(jì)與實(shí)現(xiàn)
基于FPGA的LCD顯示遠(yuǎn)程更新

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