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flash fpga 文章進入flash fpga技術(shù)社區(qū)

基于FPGA的UART接口模塊設計

基于FPGA的UART接口模塊設計,UART（UniversalAnynchronousReceiverTransmitter,通用異步接收發(fā)送器）是廣泛應用的串行數(shù)據(jù)傳輸協(xié)議之一，其應用范圍遍及計算機外設、工控自動化等場合。雖然USB傳輸協(xié)議比UART協(xié)議有更高的性能，但電路復雜開發(fā)難
關(guān)鍵字：模塊設計接口 UART FPGA 基于

直擴系統(tǒng)PN碼捕獲和跟蹤的FPGA實現(xiàn)

摘要：在數(shù)字匹配濾波器和超前滯后鑒相環(huán)路的理論基礎上，采用VHDL編程，在FPGA芯片上實現(xiàn)PN碼捕獲和跟蹤的電路。詳細討論了各電路模塊的設計實現(xiàn)方法。完成電路的仿真驗證，給出了仿真波形。結(jié)果表明電路工作正?？?/li>
關(guān)鍵字： FPGA 直擴系統(tǒng) PN碼

基于FPGA的電梯控制系統(tǒng)設計

摘要：介紹了基于FPGA的四層電梯控制系統(tǒng)的設計。該系統(tǒng)采用Altera公司的CycloneⅡ系列FPGA芯片EP2C5T144作為主控制芯片，采用Verilog-HDL編程描述，實現(xiàn)對電梯的智能控制，經(jīng)仿真驗證，完成所要求功能。該設計采用模
關(guān)鍵字： FPGA 電梯控制系統(tǒng)設計

用LabVIEW FPGA模塊實現(xiàn)不同時鐘域的數(shù)據(jù)連續(xù)傳輸

摘要：為了解決基于LabVIEWFPGA模塊的DMAFIFO深度設定不當帶來的數(shù)據(jù)不連續(xù)問題，結(jié)合LabVIEWFPGA的編程特點和DMA FIFO的工作原理，提出了一種設定FIFO深度的方法。對FIFO不同深度的實驗表明，采用該方法設定的FIFO深
關(guān)鍵字： LabVIEW FPGA 模塊傳輸

基于FPGA的高速自適應格型濾波器的實現(xiàn)

摘要：針對高速高靈敏度數(shù)字信號處理時對于自適應濾波器的數(shù)值特性和實時性的要求，在一種自適應格型聯(lián)合濾波器的基礎上提出算法改進，采用馳豫超前流水線技術(shù)和時序重構(gòu)技術(shù)，在損失較小濾波性能的情況下，在FPGA中
關(guān)鍵字： FPGA 濾波器

cpld fpga 區(qū)別

系統(tǒng)的比較,與大家共享：盡管ＦＰＧＡ和ＣＰＬＤ都是可編程ＡＳＩＣ器件,有很多共同特點,但由于ＣＰＬＤ和ＦＰＧＡ結(jié)構(gòu)上的差異,具有各自的特點:①ＣＰＬＤ更適 ...
關(guān)鍵字： cpld fpga

用一個時鐘在FPGA中計算直方圖

直方圖對數(shù)字數(shù)據(jù)的分析通常是一種有用的工具。不過，要從一個直方圖獲得可靠的結(jié)果，必須獲得大量數(shù)據(jù)，通常是要...
關(guān)鍵字： FPGA

基于FPGA的UART接口開發(fā)方案

由于FPGA的功能日益強大，開發(fā)周期短、可重復編程等優(yōu)點也越來越明顯，可以在FPGA芯片上集成UART功能模塊，從...
關(guān)鍵字： FPGA UART接口

紅外目標識別跟蹤系統(tǒng)的DSP+FPGA實現(xiàn)

紅外目標識別跟蹤系統(tǒng)的DSP+FPGA實現(xiàn),現(xiàn)場可編程門陣列(FPGA)是在專用ASIC的基礎上發(fā)展出來的，它克服了專用ASIC不夠靈活的缺點。與其他中小規(guī)模集成電路相比，其優(yōu)點主要在于它有很強的靈活性，即其內(nèi)部的具體邏輯功能可以根據(jù)需要配置，對電路的修改和
關(guān)鍵字： DSP FPGA 實現(xiàn) 系統(tǒng) 跟蹤目標識別紅外

FPGA實現(xiàn)OFDM水聲通信系統(tǒng)定時同步

FPGA實現(xiàn)OFDM水聲通信系統(tǒng)定時同步,引言　　正交頻分復用(Orthogonal Frequency Division Multiplexing，OFDM)技術(shù)是一種多載波調(diào)制技術(shù)，它將寬帶信道分解為相互正交的一組窄帶子信道，利用各個子信道進行并行數(shù)據(jù)傳輸，因此其頻譜利用率高、抗多徑衰
關(guān)鍵字：系統(tǒng) 定時同步通信水聲實現(xiàn) OFDM FPGA

一種基于FPGA的高速誤碼測試儀的設計

摘要：誤碼測試儀是檢測通信系統(tǒng)可靠性的重要設備。傳統(tǒng)的誤碼測試儀基于CPLD和CPU協(xié)同工作，不僅結(jié)構(gòu)復雜，價格昂貴，而且不方便攜帶?；贔PGA的高速誤碼測試儀，采用FPGA來完成控制和測試模塊的一體化設計，提高了
關(guān)鍵字： FPGA 誤碼測試儀的設計

基于FPGA的FIR濾波器的性能研究

摘要：目前FIR濾波器的一般設計方法比較繁瑣，開發(fā)周期長，如果采用設計好的FIR濾波器的IP核，則開發(fā)效率大為提高。本方案基于Altera公司的CycloneⅡ系列芯片EP2C8Q208C8N，首先利用MATLAB中的濾波器函數(shù)fir2得出需產(chǎn)
關(guān)鍵字： FPGA FIR 濾波器性能

基于FPGA的幅值可調(diào)信號發(fā)生器設計

摘要：針對信號發(fā)生器時輸出頻率精度高和幅值可調(diào)的要求，采用直接數(shù)字頻率合成(DDS)技術(shù)，提出一種基于FPGA的幅值、頻率均可調(diào)的、高分辨率、高穩(wěn)定度的信號發(fā)生器設計方案。采用AT89S52單片機為控制器，控制FPGA產(chǎn)
關(guān)鍵字： FPGA 幅值信號發(fā)生器

基于FPGA的QDPSK調(diào)制器的設計與實現(xiàn)

摘要：介紹了QDPSK信號的優(yōu)點，并分析了其實現(xiàn)原理，提出一種QDPSK高性能數(shù)字調(diào)制器的FPGA實現(xiàn)方案。采用自頂向下的設計思想，將系統(tǒng)分成串／并變換器、差分編碼器、邏輯選相電路、四相載波發(fā)生器等4大模塊，用原理圖
關(guān)鍵字： QDPSK FPGA 調(diào)制器

S2C為Xilinx原型驗證系統(tǒng)提供突破性驗證模塊技術(shù)

S2C 日前宣布其Verification Module技術(shù)（專利申請中）已可用于其基于Xilinx的FPGA原型驗證系統(tǒng)中。V6 TAI Verification Module可以實現(xiàn)在FPGA原型驗證環(huán)境和用戶驗證環(huán)境之間高速海量數(shù)據(jù)傳輸。用戶可以使用Xilinx ChipScope或者第三方調(diào)試環(huán)境，同時查看4個FPGA。另外，V6 TAI Verification Module還可以用于1.3M～4.7M ASIC門的原型設計。V6 TAI Verification Module具有PCIe G
關(guān)鍵字： S2C Xilinx FPGA

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利用FPGA資源和最小模擬電路發(fā)電進行開關(guān)電源設計的方法
基于FPGA的機載顯示系統(tǒng)架構(gòu)設計與優(yōu)化
基于FPGA+DSP遠程監(jiān)控器設計與實現(xiàn)
基于FPGA的LCD顯示遠程更新

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