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基于DS28E01的FPGA加密認(rèn)證系統(tǒng)的設(shè)計(jì)
- 在現(xiàn)在電子設(shè)計(jì)的成本越來越高的情況下，基于 SRAM的 FPGA由于自身限制，容易使得設(shè)計(jì)者的設(shè)計(jì)被復(fù)制，從而給設(shè)計(jì)者提出了設(shè)計(jì)具有加密功能的電子系統(tǒng)，由于 SHA-1 算法引擎的 DS28E01芯片作為加密認(rèn)證系統(tǒng)的核心芯片，并利用 DS28E01針對 Xilinx公司的 X3CS500E開發(fā)了實(shí)際的加密認(rèn)證系統(tǒng)，并將此系統(tǒng)應(yīng)用于實(shí)際的產(chǎn)品中，取得了良好的效果?！ ?br />
- 關(guān)鍵字： FPGA 28E E01 DS
FPGA實(shí)現(xiàn)的任意波形發(fā)生器的設(shè)計(jì)
- 運(yùn)用DDS原理，進(jìn)行任意波形發(fā)生器的設(shè)計(jì)，使得任意波形發(fā)生器兼顧DDS的優(yōu)點(diǎn)。設(shè)計(jì)中通過實(shí)現(xiàn)DDS模塊與單片機(jī)接口的控制部分將頻率控制字由單片輸入到輸入寄存器模塊，由相位累加器模塊對輸入頻率控制字進(jìn)行累加運(yùn)算，輸出作為雙口RAM的讀地址線，讀數(shù)據(jù)線上即輸出了波形幅度量化數(shù)據(jù)。其中雙口RAM的內(nèi)容由單片機(jī)進(jìn)行更新，從而實(shí)現(xiàn)任意波形的發(fā)生。本設(shè)計(jì)中的相位累加器采用了8級(jí)流水線結(jié)構(gòu)借助前5級(jí)的超前進(jìn)位的方法，使得編譯的最高工作頻率由317．97MHz提高到336．7 MHz，實(shí)現(xiàn)了任意波形的發(fā)生，節(jié)約了成本，提
- 關(guān)鍵字： FPGA 任意波形發(fā)生器
面向?qū)ΨQ體系結(jié)構(gòu)的FPGA仿真模型研究
- 緩慢的軟件模擬器給體系結(jié)構(gòu)研究帶來了極大不便，F(xiàn)PGA硬件仿真的模擬速度很快，但仿真系統(tǒng)的規(guī)模嚴(yán)重受限于FPGA的容量。較大規(guī)模的體系結(jié)構(gòu)系統(tǒng)仿真采用多片F(xiàn)PGA互連，不僅增加了設(shè)計(jì)的復(fù)雜性，也增加成本。因此提出一種面向?qū)ΨQ體系結(jié)構(gòu)的FPGA仿真模型。經(jīng)仿真系統(tǒng)評(píng)估，其仿真系統(tǒng)能夠增大FPGA芯片的仿真規(guī)模，減少仿真系統(tǒng)對FPGA資源的需求，有效支持在有限的FPGA資源上進(jìn)行大規(guī)模對稱體系結(jié)構(gòu)仿真研究。
- 關(guān)鍵字： FPGA 對稱 仿真 模型研究
基于FPGA+DSP技術(shù)的Bayer格式圖像預(yù)處理
- 提出一種針對CMOS圖像傳感器采集的Bayer格式圖像預(yù)處理系統(tǒng)，與傳統(tǒng)的DSP圖像處理系統(tǒng)相比，該系統(tǒng)利用Spartan-3系列的XC3S1 500和TMS320DM642型DSP相結(jié)合實(shí)現(xiàn)圖像捕獲、圖像預(yù)處理等功能，采用支持USB2．O的CY7C68013將圖像信息傳送給上位機(jī)。在FPGA中采用雙線性插值法將CMOS圖像傳感器采集的Bayer格式圖像數(shù)據(jù)轉(zhuǎn)換為RGB格式圖像數(shù)據(jù)，并轉(zhuǎn)換成Y亮度信號(hào)。實(shí)驗(yàn)結(jié)果表明，該系統(tǒng)能處理分辨率達(dá)500萬像素的Bayer圖像，并最終以20 Mb／s的帶寬將亮度信號(hào)傳
- 關(guān)鍵字： Bayer FPGA DSP 圖像預(yù)處理
基于FPGA的灰度形態(tài)學(xué)濾波器實(shí)現(xiàn)
- 摘要:闡述了灰度形態(tài)學(xué)濾波的原理和基本操作,給出了3×3結(jié)構(gòu)元素灰度形態(tài)學(xué)濾波器的硬件結(jié)構(gòu),詳細(xì)描...
- 關(guān)鍵字： FPGA 濾波器 灰度形態(tài)學(xué)
USB IP核的設(shè)計(jì)及FPGA驗(yàn)證
- USB IP核的設(shè)計(jì)及FPGA驗(yàn)證,介紹了一款可配置的USB IP核設(shè)計(jì)，重點(diǎn)描述USB IP核的結(jié)構(gòu)劃分，詳細(xì)闡述了各模塊的設(shè)計(jì)思想。為了提高USB lP的可重用性，本USB IP核設(shè)計(jì)了總線適配器，經(jīng)過簡單配置可以用于AMBA ASB總線或WishBone總線結(jié)構(gòu)的SoC中。
- 關(guān)鍵字： 驗(yàn)證 FPGA 設(shè)計(jì) IP USB
基于FPGA的CAN總線通信接口的設(shè)計(jì)
- 為實(shí)現(xiàn)CAN總線與計(jì)算機(jī)的通信，便于CAN總線系統(tǒng)調(diào)試，提出一種基于FPGA的CAN總線轉(zhuǎn)換USB接口設(shè)計(jì)方案。利用USB總線與計(jì)算機(jī)通信，詳細(xì)論述了FPGA對SJA1000與CY7C68013A的具體控制過程以及CAN總線的通信實(shí)現(xiàn)。這種方法數(shù)據(jù)傳輸速率高，設(shè)計(jì)靈活，可擴(kuò)展成多路總線的通信接口。目前已成功應(yīng)用于空間相機(jī)下住機(jī)系統(tǒng)的地面檢測設(shè)備中。
- 關(guān)鍵字： FPGA CAN 總線通信 接口的設(shè)計(jì)
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