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          基于DDS和FPGA技術(shù)的高動態(tài)擴(kuò)頻信號源的研究

          • 提出一種基于DDS和FPGA技術(shù)的高動態(tài)擴(kuò)頻仿真信號源的實現(xiàn)方案。采用了DDS技術(shù)的芯片AD9854和AD9850,能夠模擬多普勒頻移,實現(xiàn)高動態(tài)環(huán)境仿真。載波中心頻率變化范圍達(dá)到100kHz,變化率1.8kHz/s。
          • 關(guān)鍵字: FPGA  DDS  動態(tài)  擴(kuò)頻    

          一種基于FPGA的鎖相環(huán)位同步提取電路設(shè)計

          • 一般的位同步電路大多采用標(biāo)準(zhǔn)邏輯器件按傳統(tǒng)數(shù)字系統(tǒng)設(shè)計方法構(gòu)成,具有功耗大,可靠性低的缺點。用FPGA設(shè)計電路具有很高的靈活性和可靠性,可以提高集成度和設(shè)計速度,增強(qiáng)系統(tǒng)的整體性能。本文給出了一種基于fpga的數(shù)字鎖相環(huán)位同步提取電路。
          • 關(guān)鍵字: FPGA  鎖相環(huán)  電路設(shè)計  位同步    

          基于FPGA的數(shù)字脈沖壓縮系統(tǒng)實現(xiàn)

          • 針對采用線性調(diào)頻信號的寬帶雷達(dá)系統(tǒng),完成單通道高速數(shù)據(jù)采集和數(shù)字脈沖壓縮系統(tǒng)的工程實現(xiàn)。系統(tǒng)使用ADS5500完成14位、60 MSPS的數(shù)據(jù)采集,使用FPGA實現(xiàn)1 024點的數(shù)字脈沖壓縮。脈沖壓縮模塊采用快速傅里葉變換IP核進(jìn)行設(shè)計,可以在脈沖壓縮的不同階段對其進(jìn)行復(fù)用,分別完成FFT和IFFT運(yùn)算,從而使硬件規(guī)模大大減少。系統(tǒng)采用塊浮點數(shù)據(jù)格式以提高動態(tài)范圍,同時減小截斷(或舍入)誤差對輸出信噪比的影響。
          • 關(guān)鍵字: FPGA  數(shù)字脈沖  壓縮系統(tǒng)    

          中型組機(jī)器人運(yùn)動控制系統(tǒng)的FPGA設(shè)計

          • 以RoboCup中型組足球機(jī)器人為實驗平臺,提出一種基于FPGA的全方位移動足球機(jī)器人運(yùn)動控制系統(tǒng)的實現(xiàn)方法。首先分析和研究三輪全方位移動機(jī)器人的運(yùn)動學(xué)特性,建立其運(yùn)動控制模型,然后以FPGA為主要處理器,設(shè)計了PID速度閉環(huán)控制算法,實現(xiàn)了對機(jī)器人的精確控制。實驗發(fā)現(xiàn),該設(shè)計方法具有很好的實時性,能夠?qū)θ轿灰苿訖C(jī)器人進(jìn)行快速、準(zhǔn)確的控制。
          • 關(guān)鍵字: FPGA  設(shè)計  控制系統(tǒng)  運(yùn)動  機(jī)器人  中型  

          FPGA在PCI Express總線接口中的應(yīng)用

          • 隨著高速數(shù)據(jù)采集設(shè)備傳輸帶寬的日益提高,開發(fā)者需要采用新的計算機(jī)總線進(jìn)行數(shù)據(jù)傳輸。這里敘述了使用EP2SGX90系列FPGA完成PCI-Express協(xié)議轉(zhuǎn)換,多種DMA工作方式及相關(guān)寄存器的作用。以鏈?zhǔn)紻MA傳輸方式為例,詳細(xì)介紹該傳輸方式下的寄存器設(shè)置及在驅(qū)動程序中的實現(xiàn)范例。實驗表明,用FPGA實現(xiàn)協(xié)議轉(zhuǎn)換,總線持續(xù)傳輸速率最高可以達(dá)到1.2 Gb/s,滿足大多數(shù)高速數(shù)據(jù)采集設(shè)備的要求。在此摒棄了采用專用總線接口芯片的傳統(tǒng)方法,將開發(fā)者的邏輯設(shè)計和總線協(xié)議轉(zhuǎn)換放到同一個FPGA芯片中,不但節(jié)省了硬件
          • 關(guān)鍵字: Express  FPGA  PCI  總線接口    

          基于FPGA的SPI總線接口的實現(xiàn)

          • 在現(xiàn)代EDA外圍電子器件的接口中存在多種標(biāo)準(zhǔn),已知的一些接口協(xié)議存在速度慢、協(xié)議復(fù)雜等問題。SPI總線是能夠克服上述缺點的一種外圍串行總線,其能很好地滿足要求。通過使用Lattice公司的FPGA芯片以及工程開發(fā)軟件,特別是在線邏輯分析儀這一先進(jìn)的EDA工具,實現(xiàn)了基于FPGA的SPI接口的連接。將FPGA編程的靈活性和SPI總線的易用性結(jié)合,實現(xiàn)了FLASH的存取功能。同時也為同類型接口的芯片應(yīng)用提供了一個原型,為進(jìn)一步的工程設(shè)計提供了支持。
          • 關(guān)鍵字: FPGA  SPI  總線接口    

          愛特公司發(fā)布SmartFusion FPGA馬達(dá)控制參考設(shè)計

          •   愛特公司(Actel Corporation)宣布提供面向馬達(dá)控制應(yīng)用的SmartFusion™智能混合信號FPGA參考設(shè)計。這些靠單一SmartFusion器件中實現(xiàn)的參考設(shè)計詮釋了使用多種反饋方法的磁場定向控制(FOC),用于永磁同步馬達(dá)(permanent magnet synchronous motors, PMSM)。SmartFusion器件集成了一個FPGA、一個硬核ARM® Cortex™-M3微控制器和可編程模擬模塊,具有適合馬達(dá)控制應(yīng)用的獨(dú)特性能,可
          • 關(guān)鍵字: 愛特   FPGA  馬達(dá)控制  

          FPGA 28納米激戰(zhàn) 臺積電可望受惠

          •   可程序邏輯閘陣列芯片(FPGA)雙雄賽靈思(Xilinx)與阿爾特拉(Altera)先后推出28納米FPGA產(chǎn)品,不僅使FPGA市場戰(zhàn)火升溫,也讓晶圓代工市場激烈角逐,在Xilinx首度與臺積電攜手合作后,Altera在28納米產(chǎn)品的布局上亦相當(dāng)積極,近期亦展示在28納米 FPGA平臺上的25-Gbps收發(fā)器,F(xiàn)PGA雙雄的激烈競賽,預(yù)料臺積電將成為最大受惠者。   Altera指出,在28納米FPGA中展示25-Gbps收發(fā)器,是收發(fā)器產(chǎn)品的里程碑,該芯片是Altera用于在28納米FPGA上,成
          • 關(guān)鍵字: 臺積電  FPGA  28納米  

          基于FPGA的兩種DDS實現(xiàn)

          • 闡述了兩種DDS的原理,頻率合成方式(DDFS)和直讀方式(DDWS),給出了FPGA實現(xiàn)方式,分析了DDS的幾個關(guān)鍵的技術(shù)指標(biāo),并通過Matlab仿真。頻率合成方式是比較常用的DDS產(chǎn)生方式,對它做了詳細(xì)的原理性介紹和實現(xiàn)說明,重點通過仿真詳細(xì)對比了兩種實現(xiàn)方式在性能指標(biāo)上的優(yōu)劣,為后人的選擇提供技術(shù)參考。
          • 關(guān)鍵字: FPGA  DDS    

          基于FPGA的片上系統(tǒng)和嵌入式系統(tǒng)的遠(yuǎn)程監(jiān)控系統(tǒng)

          • 基于FPGA的片上系統(tǒng)和嵌入式系統(tǒng)的遠(yuǎn)程監(jiān)控系統(tǒng),本系統(tǒng)立足于利用Intemet實現(xiàn)核環(huán)境信息的遠(yuǎn)程采集。在實現(xiàn)上,采用了基于SOPC技術(shù)的嵌入式解決方案,通過在FPGA中嵌入NioslI軟核處理器和所需外設(shè)的IP Core(硅知識產(chǎn)權(quán)核),然后再配備相應(yīng)的網(wǎng)絡(luò)接口,實現(xiàn)利用互聯(lián)
          • 關(guān)鍵字: 系統(tǒng)  監(jiān)控系統(tǒng)  遠(yuǎn)程  嵌入式  基于  FPGA  

          基于FLASH的嵌入式存儲系統(tǒng)設(shè)計

          • 基于FLASH的嵌入式存儲系統(tǒng)設(shè)計,1 引言

            FLASH(閃速存儲器)作為一種安全、快速的存儲體,具有體積小、容量大、成本低、掉電數(shù)據(jù)不丟失等一系列優(yōu)點,已成為嵌入式系統(tǒng)中數(shù)據(jù)和程序最主要的載體。由于FLASH在結(jié)構(gòu)和操作方式上與硬盤、E2ROM等其
          • 關(guān)鍵字: 系統(tǒng)  設(shè)計  存儲  嵌入式  FLASH  基于  

          基于FPGA的太陽跟蹤器的設(shè)計及實現(xiàn)

          • 在簡要介紹地日運(yùn)行規(guī)律的基礎(chǔ)上,確定了視日運(yùn)動跟蹤法的計算模型及跟蹤裝置的機(jī)械結(jié)構(gòu)。采用FPGA芯片XC3S1500為處理器,以步進(jìn)電機(jī)為執(zhí)行機(jī)構(gòu),采用Verilog語言設(shè)計實現(xiàn)了高度角一方位角太陽跟蹤系統(tǒng)。根據(jù)系統(tǒng)的要求建立了計時模塊、太陽高度角方位角計算模塊、日出日落時間計算模塊和步進(jìn)電機(jī)脈沖控制模塊。通過實驗測試該系統(tǒng)能夠達(dá)到預(yù)期的性能指標(biāo),對提高太陽能的利用率具有重要的現(xiàn)實意義。
          • 關(guān)鍵字: FPGA  跟蹤器    

          基于FPGA芯片和頻率合成器ADF4360-4的GPS信號源的設(shè)計方案

          • 基于FPGA芯片和頻率合成器ADF4360-4的GPS信號源的設(shè)計方案, 頻率合成器是發(fā)射系統(tǒng)和接收系統(tǒng)中的核心器件,采用相位負(fù)反饋頻率控制技術(shù),具有良好的窄帶載波跟蹤性能和帶寬調(diào)制跟蹤性能,為系統(tǒng)上、下變頻提供本振信號,對相位噪聲和雜散具有很好的抑制作用,通過鎖相頻率合
          • 關(guān)鍵字: GPS  信號源  設(shè)計  方案  ADF4360-4  合成器  FPGA  芯片  頻率  

          基于FPGA的SoC和嵌入式系統(tǒng)的遠(yuǎn)程監(jiān)控系統(tǒng)

          • 本系統(tǒng)立足于利用Intemet實現(xiàn)核環(huán)境信息的遠(yuǎn)程采集。在實現(xiàn)上,采用了基于SOPC技術(shù)的嵌入式解決方案,通過...
          • 關(guān)鍵字: 遠(yuǎn)程監(jiān)控  SoC  嵌入式  FPGA  

          基于FPGA和頻率合成器的GPS信號源的設(shè)計

          • 頻率合成器是發(fā)射系統(tǒng)和接收系統(tǒng)中的核心器件,采用相位負(fù)反饋頻率控制技術(shù),具有良好的窄帶載波跟蹤性能和...
          • 關(guān)鍵字: ADF4360-4  FPGA  頻率合成器  GPS信號源  
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