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FPGA實現(xiàn)的FIR算法在汽車動態(tài)稱重儀中的應(yīng)用
- 引言 車輛在動態(tài)稱重時，作用在平臺上的力除真實軸重外，還有許多因素產(chǎn)生的干擾力，如：車速、車輛自身諧振、路面激勵、輪胎驅(qū)動力等，給動態(tài)稱重實現(xiàn)高精度測量造成很大困難。若在消除干擾的過程中采用模擬方法濾波，參數(shù)則不能過大，否則將產(chǎn)生過大的延遲導(dǎo)致不能實現(xiàn)實時處理，從而造成濾波后的信號仍然含有相當(dāng)一部分的噪聲。所以必須采用數(shù)字濾波消除干擾。 FIR濾波的原理及實現(xiàn) 本文采用FIR數(shù)字濾波，其原理如公式1所示。 Y(n)= (1) 其中h(k)為系統(tǒng)濾波參數(shù)，x(n)為采集的信
- 關(guān)鍵字： FPGA FIR
R&S將攜四大創(chuàng)新實驗室建設(shè)方案亮相2016年秋季第48屆全國高教儀器設(shè)備展示會
- 由中國高等教育學(xué)會主辦的“第48屆全國高教儀器設(shè)備展示會”將于2016年10月19日至21日在四川省成都市召開。作為全球最大的電子測量儀器公司之一，羅德與施瓦茨公司(Rohde & Schwarz，R&S公司)將攜四大創(chuàng)新實驗室建設(shè)方案參加。 R&S公司的四大創(chuàng)新實驗室建設(shè)方案主要為高校人才培養(yǎng)模式創(chuàng)新及實踐教學(xué)創(chuàng)新提供新的參考和實施途徑： 1.本科精英教學(xué)計劃：構(gòu)建研究型教學(xué)體系，培養(yǎng)敢于跨界創(chuàng)新并具有跨領(lǐng)域綜合集成能力的人才?；谠摻ㄔO(shè)方
- 關(guān)鍵字： R&S SOC
基于USB2．0協(xié)議的通用測控通信接口設(shè)計
- 隨著我國航空航天技術(shù)的迅速發(fā)展，對地面遙控遙測接收機的實時性和高速數(shù)據(jù)傳輸性能的要求越來越高。越來越多的遙測遙控地面信道處理器都采用了實時能力更強的高速DSP/FPGA架構(gòu)設(shè)計方案?；贒SP/FPGA架構(gòu)的設(shè)計方案
- 關(guān)鍵字： CY7C68013A 測控通信 FPGA USB固件設(shè)計
基于雙口RAM核監(jiān)測數(shù)字示波器設(shè)計研究
- 摘要：在核監(jiān)測中，常將各種傳感器輸出的信號通過A/D轉(zhuǎn)換器轉(zhuǎn)換為數(shù)字信號，然后利用數(shù)字信號處理技術(shù)對各種核信號進(jìn)行數(shù)字處理。為了準(zhǔn)確測量核信號數(shù)字波形的各種參數(shù)，對基于FPGA雙口RAM的數(shù)字示波器進(jìn)行了設(shè)計和
- 關(guān)鍵字： 核脈沖 數(shù)字示波器 數(shù)字波形 FPGA 雙口RAM
基于FPGA的數(shù)字通信實訓(xùn)平臺的設(shè)計與實現(xiàn)
- 摘要：本實訓(xùn)平臺著眼于提升高職層次學(xué)生的職業(yè)能力，圍繞典型的數(shù)字通信系統(tǒng)模型，設(shè)計了擴(kuò)展性強、可測性好的FPGA核心板，并開發(fā)了多個配套的功能模塊。憑借著FPGA強大的硬件可編程能力，創(chuàng)設(shè)了分層遞進(jìn)的實驗?zāi)Ｊ?/li>
- 關(guān)鍵字： FPGA 數(shù)字通信系統(tǒng) EP1C3T144 QuartusⅡ9．0 片上通信系統(tǒng)
基于FPGA的多路數(shù)字信號復(fù)接系統(tǒng)設(shè)計與實現(xiàn)
- 摘要 數(shù)字復(fù)分接技術(shù)是數(shù)字通信網(wǎng)中的一項重要技術(shù)，能將若干路低速信號合并為一路高速信號，以提高帶寬利用率和數(shù)據(jù)傳輸效率。文中在介紹數(shù)字復(fù)接系統(tǒng)的基礎(chǔ)上，采用VHDL對數(shù)字復(fù)分接系統(tǒng)進(jìn)行建模設(shè)計和實現(xiàn)。并利
- 關(guān)鍵字： 數(shù)字復(fù)接系統(tǒng) 乒乓操作 先進(jìn)先出存儲器 FPGA
JPEG2000數(shù)據(jù)壓縮的FPGA實現(xiàn)
- 高性能的數(shù)據(jù)壓縮可以有效的減少數(shù)據(jù)對存儲空間和通信帶寬的要求，降低通信成本。為解決圖像數(shù)據(jù)的高壓縮性能問題，本文提出了基于JPEG2000標(biāo)準(zhǔn)的數(shù)據(jù)壓縮系統(tǒng)的FPGA實現(xiàn)方案。相對于軟件算法實現(xiàn)和其他硬件方法，采用FPGA硬件實現(xiàn)可降低系統(tǒng)復(fù)雜度提高性能。最終設(shè)計的IP核具有資源占用少，性能良好和便于擴(kuò)展等優(yōu)點，能夠滿足通信傳輸和照相設(shè)備等應(yīng)用需求。
- 關(guān)鍵字： JPEG2000 數(shù)據(jù)壓縮 FPGA DWT
基于NiosⅡ的單點自適應(yīng)控制器設(shè)計研究
- 摘要 為了提高道路交叉口通行能力，設(shè)計了一種單點交叉口自適應(yīng)控制系統(tǒng)。系統(tǒng)采用SOPC方案，利用具有NiosⅡ軟核的FPGA芯片設(shè)計了控制器的硬件，井利用遺傳算法建立了信號配時優(yōu)化模型、VHDL語言進(jìn)行了遺傳算法的硬
- 關(guān)鍵字： NiosⅡ FPGA 單點交叉口 自適應(yīng)控制 遺傳算法硬件化
高速實際據(jù)采集智能控制器的設(shè)計與實現(xiàn)
- 摘要：文章以嵌入式和數(shù)據(jù)采集技術(shù)為基礎(chǔ)，研究設(shè)計并實現(xiàn)了基于ARM+FPGA體系架構(gòu)面向高速實時數(shù)據(jù)采集應(yīng)用的一種實用新型智能控制器。本文闡述了主處理器ARM最小系統(tǒng)、協(xié)處理器FPGA最小系統(tǒng)和ARM與FPGA通信接口等硬
- 關(guān)鍵字： ARM FPGA 智能控制器 高速實時數(shù)據(jù)采集
基于USB3．0協(xié)議的PC與FPGA通信系統(tǒng)的設(shè)計
- 摘要 針對USB2.0在高速數(shù)據(jù)采集系統(tǒng)中帶寬局限問題，設(shè)計了一款基于USB3.0總線的高速數(shù)據(jù)采集接口系統(tǒng)。通過對USB3.0的接口硬件系統(tǒng)、設(shè)備固件以及SLAVE FIFO與FPGA接口讀寫操作的設(shè)計，并經(jīng)過實驗測試，USB3.0硬
- 關(guān)鍵字： FPGA USB3．0固件 SLAVE FIFO 數(shù)據(jù)通信
星載計算機雙冗余CAN總線模塊設(shè)計與實現(xiàn)
- 摘要：隨著新型SoC(System On a Chip)集成技術(shù)在航天技術(shù)中的應(yīng)用越來越廣泛，傳統(tǒng)的星載板級設(shè)計轉(zhuǎn)為SoC芯片級設(shè)計逐漸成為趨勢?；贗P—cores(the integration of complex building blocks)復(fù)用的SoC技術(shù)
- 關(guān)鍵字： SoC IP―cores CAN總線 軟硬件協(xié)同
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