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UWB - 智能物聯(lián)的未來之星，你怎么看他？低功耗Wi-Fi解決方案在智能家居的應(yīng)用和發(fā)展結(jié)合超寬帶測距和雷達(dá)功能以實(shí)現(xiàn)高級(jí)IoT應(yīng)用來這里瞧瞧NXP技術(shù)培訓(xùn)視頻吧>>

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fpga soc 文章進(jìn)入fpga soc技術(shù)社區(qū)

Xilinx Spartan-3A FPGA 的DDR2接口設(shè)計(jì)

1 引言DDR2(Double DataRate2)SDRAM是由JEDEC(電子設(shè)備工程聯(lián)合委員會(huì))制定的新生代內(nèi)存技術(shù)標(biāo)準(zhǔn)，它與上一代DDR內(nèi)存技術(shù)標(biāo)準(zhǔn)最大的不同：雖然采用時(shí)鐘的上升／下降沿同時(shí)傳輸數(shù)據(jù)的基本方式，但DDR2卻擁有2倍的DDR
關(guān)鍵字： Spartan Xilinx FPGA DDR2

安富利X-fest研討會(huì)北京站打破參會(huì)人數(shù)記錄

X-fest 2012全球系列研討會(huì)北京站于7月10日舉辦，創(chuàng)下了單場活動(dòng)吸引上千名業(yè)內(nèi)人士參加的新記錄。X-fest是為期一天的全球性培訓(xùn)活動(dòng)，由安富利公司 (NYSE: AVT) 旗下安富利電子元件亞洲 (Avnet Electronics Marketing )主辦，深受FPGA、ARM MCU、DSP和嵌入式系統(tǒng)開發(fā)人員歡迎。
關(guān)鍵字：安富利 X-fest FPGA

一種基于FPGA的三坐標(biāo)測量機(jī)電機(jī)控制系統(tǒng)

1、控制系統(tǒng)概述隨著工業(yè)的發(fā)展，三坐標(biāo)測量機(jī)越來越顯示出其重要作用。而電機(jī)控制系統(tǒng)對(duì)三坐標(biāo)測量機(jī)的運(yùn)行有著非常重要的作用。由于FPGA可以現(xiàn)場可編程，可以實(shí)現(xiàn)專用集成電路，能滿足片上系統(tǒng)設(shè)計(jì)(SOC)的要求，使
關(guān)鍵字： FPGA 三坐標(biāo)測量機(jī) 電機(jī)控制系統(tǒng)

DDS調(diào)頻信號(hào)發(fā)生器的FPGA電路設(shè)計(jì)

關(guān)鍵字： DDS FPGA 信號(hào)發(fā)生器

新一代SoC整合音頻編解碼器的挑戰(zhàn)與設(shè)計(jì)實(shí)現(xiàn)

在當(dāng)今的多媒體系統(tǒng)芯片中整合進(jìn)經(jīng)過硅驗(yàn)證并針對(duì)特定音頻功能優(yōu)化過的音頻IP，有利于降低功耗、減少體積和縮減成本。但隨著下一代設(shè)計(jì)走向 28nm工藝技術(shù)，也隨之會(huì)出現(xiàn)新的挑戰(zhàn)。音頻編解碼器中的音頻設(shè)計(jì)包括了很多
關(guān)鍵字： SoC 音頻編解碼器設(shè)計(jì)實(shí)現(xiàn)

閥門簡易控制

溫度/壓力/流量/液位控制器通過簡單連接就可以直接控制電動(dòng)閥門（含電動(dòng)蝶閥與電動(dòng)球閥等），免去伺服放大器，可選...
關(guān)鍵字： FPGA IP 嵌入式 PLD CPLD SoC 數(shù)字信號(hào)處理消費(fèi)電子 FPGA

256 級(jí)灰度顯示 - 基于FPGA的OLED真彩色顯示設(shè)計(jì)

256 級(jí)灰度顯示 - 基于FPGA的OLED真彩色顯示設(shè)計(jì),摘要利用FPGA 控制模塊，設(shè)計(jì)了OLED 真彩色動(dòng)態(tài)圖像驅(qū)動(dòng)控制電路。介紹采用FPGA 實(shí)現(xiàn)OLED 外圍控制電路和256 級(jí)灰度的方法，并分析電路中模塊的作用及整個(gè)電路的工作過程。電路系統(tǒng)采用基于Altera 公司的FPGA技術(shù)進(jìn)行
關(guān)鍵字：顯示彩色設(shè)計(jì) OLED FPGA 基于級(jí)灰度

工程師分析實(shí)例，帶你走近Xilinx FPGA設(shè)計(jì)

工程師分析實(shí)例，帶你走近Xilinx FPGA設(shè)計(jì),一.概述　　本文主要幫助大家熟悉利用ISE進(jìn)行Xilinx 公司FPGA 代碼開發(fā)的基本流程。主要是幫助初學(xué)者了解和初步掌握 ISE 的使用，不需要 FPGA 的開發(fā)基礎(chǔ)，所以對(duì)每個(gè)步驟并不進(jìn)行深入的討論?！　”疚慕榻B的內(nèi)容從新
關(guān)鍵字： FPGA 設(shè)計(jì) Xilinx 走近分析實(shí)例工程師

采用FPGA與SRAM的大容量數(shù)據(jù)存儲(chǔ)的設(shè)計(jì)

采用FPGA與SRAM的大容量數(shù)據(jù)存儲(chǔ)的設(shè)計(jì),1 前言　針對(duì)FPGA中內(nèi)部BlockRAM有限的缺點(diǎn)，提出了將FPGA與外部SRAM相結(jié)合來改進(jìn)設(shè)計(jì)的方法，并給出了部分VHDL程序。　　2 硬件設(shè)計(jì)　　這里將主要討論以Xilinx公司的FPGA(XC2S600E-6fg456)和ISSI公司的SRAM(IS61LV
關(guān)鍵字：存儲(chǔ) 設(shè)計(jì) 數(shù)據(jù) 大容量 FPGA SRAM 采用

采用上位機(jī)與FPGA開發(fā)板的光纖通道接口適配器設(shè)計(jì)

采用上位機(jī)與FPGA開發(fā)板的光纖通道接口適配器設(shè)計(jì),隨著存儲(chǔ)技術(shù)的迅速發(fā)展，存儲(chǔ)容量得到了迅速的增長，存儲(chǔ)系統(tǒng)的數(shù)據(jù)傳輸速度成為了主要的瓶頸。光纖的傳輸具有其速度上的優(yōu)勢，然而，在光纖傳輸要受到光纖通道接口的限制，因此光纖通道應(yīng)用于高速數(shù)據(jù)傳輸?shù)囊粋€(gè)關(guān)
關(guān)鍵字：接口適配器設(shè)計(jì) 通道光纖上位 FPGA 開發(fā) 采用

SOC時(shí)序分析中的跳變點(diǎn)介紹

SOC時(shí)序分析中的跳變點(diǎn)介紹,　跳變點(diǎn)是所有重要時(shí)序分析工具中的一個(gè)重要概念。跳變點(diǎn)被時(shí)序分析工具用來計(jì)算設(shè)計(jì)節(jié)點(diǎn)上的時(shí)延與過渡值。跳變點(diǎn)的有些不同含義可能會(huì)被時(shí)序分析工程師忽略。而這在SOC設(shè)計(jì)后期，也就是要對(duì)時(shí)序簽字時(shí)可能會(huì)導(dǎo)致問
關(guān)鍵字：介紹分析時(shí)序 SOC

系統(tǒng)芯片ZSU32在SoC芯片設(shè)計(jì)中的應(yīng)用

系統(tǒng)芯片ZSU32在SoC芯片設(shè)計(jì)中的應(yīng)用,本文針對(duì)中山大學(xué)ASIC設(shè)計(jì)中心自主開發(fā)的一款系統(tǒng)芯片ZSU32，以Synopsys公司的Design Compiler為綜合工具，探索了對(duì)SoC芯片進(jìn)行綜合的設(shè)計(jì)流程和方法，特別對(duì)綜合過程的時(shí)序約束進(jìn)行了詳細(xì)討論，提出了有效的綜合約束
關(guān)鍵字：芯片應(yīng)用設(shè)計(jì) ZSU32 系統(tǒng) SoC

利用Java良好的移植特性的FPGA可編程嵌入式系統(tǒng)

利用Java良好的移植特性的FPGA可編程嵌入式系統(tǒng),傳統(tǒng)的嵌入式產(chǎn)品只能實(shí)現(xiàn)某種特定的功能，不能滿足用戶可變的豐富多彩的應(yīng)用需求。為解決這個(gè)問題，本文設(shè)計(jì)并實(shí)現(xiàn)了一種使用Java作為軟件平臺(tái)的基于FPGA的可編程嵌入式系統(tǒng)，以實(shí)現(xiàn)系統(tǒng)對(duì)多種本地應(yīng)用和網(wǎng)絡(luò)的支持
關(guān)鍵字：可編程嵌入式系統(tǒng) FPGA 特性 Java 良好移植利用

FPGA全局時(shí)鐘資源相關(guān)Xilinx器件原語及使用

FPGA全局時(shí)鐘資源相關(guān)Xilinx器件原語及使用,FPGA全局時(shí)鐘資源一般使用全銅層工藝實(shí)現(xiàn)，并設(shè)計(jì)了專用時(shí)鐘緩沖與驅(qū)動(dòng)結(jié)構(gòu)，從而使全局時(shí)鐘到達(dá)芯片內(nèi)部的所有可配置單元(CLB)、I/O單元(IOB)和選擇性塊RAM(Block Select RAM)的時(shí)延和抖動(dòng)都為最小。為了適應(yīng)復(fù)雜設(shè)
關(guān)鍵字： Xilinx 器件使用相關(guān) 資源全局時(shí)鐘 FPGA

FPGA/EPLD的自上而下設(shè)計(jì)方法及其優(yōu)缺點(diǎn)介紹

FPGA/EPLD的自上而下設(shè)計(jì)方法及其優(yōu)缺點(diǎn)介紹,FPGA/EPLD的自上而下(Top-Down)設(shè)計(jì)方法：　　傳統(tǒng)的設(shè)計(jì)手段是采用原理圖輸入的方式進(jìn)行的，如圖1所示。通過調(diào)用FPGA/EPLD廠商所提供的相應(yīng)物理元件庫，在電路原理圖中繪制所設(shè)計(jì)的系統(tǒng)，然后通過網(wǎng)表轉(zhuǎn)換產(chǎn)生某一特
關(guān)鍵字：缺點(diǎn) 介紹及其方法自上而下設(shè)計(jì) FPGA/EPLD

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fpga soc介紹

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fpga soc電路

利用FPGA資源和最小模擬電路發(fā)電進(jìn)行開關(guān)電源設(shè)計(jì)的方法
基于FPGA的機(jī)載顯示系統(tǒng)架構(gòu)設(shè)計(jì)與優(yōu)化
基于FPGA+DSP遠(yuǎn)程監(jiān)控器設(shè)計(jì)與實(shí)現(xiàn)
基于FPGA的LCD顯示遠(yuǎn)程更新

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FPGA設(shè)計(jì)--《成為Xilinx FPGA設(shè)計(jì)專家》(基礎(chǔ)篇)

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