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基于FPGAs的DSP性能分析
- 電子產(chǎn)品世界,為電子工程師提供全面的電子產(chǎn)品信息和行業(yè)解決方案,是電子工程師的技術(shù)中心和交流中心,是電子產(chǎn)品的市場(chǎng)中心,EEPW 20年的品牌歷史,是電子工程師的網(wǎng)絡(luò)家園
- 關(guān)鍵字： DSP FPGA 數(shù)字信號(hào)處理
基于FPGA+DSP技術(shù)的Bayer格式圖像處理
- 電子產(chǎn)品世界,為電子工程師提供全面的電子產(chǎn)品信息和行業(yè)解決方案,是電子工程師的技術(shù)中心和交流中心,是電子產(chǎn)品的市場(chǎng)中心,EEPW 20年的品牌歷史,是電子工程師的網(wǎng)絡(luò)家園
- 關(guān)鍵字： DSP FPGA TMS320DM642
2011年電視半導(dǎo)體市場(chǎng)增長(zhǎng)勢(shì)頭減弱
- 據(jù)IHS iSuppli公司的顯示器電子市場(chǎng)追蹤報(bào)告，由于價(jià)格壓力沉重和電視銷售低迷，去年電視主板上使用的半導(dǎo)體銷售額萎縮，并迫使一些知名供應(yīng)商永遠(yuǎn)退出該產(chǎn)業(yè)。 2011年電視系統(tǒng)芯片(SoC)銷售額為21.9億美元，比2010年的23.6億美元下降7.4%。除了這次經(jīng)濟(jì)衰退前不久的一年，該SoC市場(chǎng)一直保持增長(zhǎng)，2010年比2009年勁增22%，隨后于去年開始下滑。 電視主板上面的SoC通常把模擬與數(shù)字視頻解碼器、解調(diào)器、中央處理單元和圖像處理功能集成在單一的專用集成電路之中。 像
- 關(guān)鍵字： 電視半導(dǎo)體 SoC
如何在低成本FPGA中實(shí)現(xiàn)動(dòng)態(tài)相位調(diào)整
- 如何在低成本FPGA中實(shí)現(xiàn)動(dòng)態(tài)相位調(diào)整,在FPGA中，動(dòng)態(tài)相位調(diào)整(DPA)主要是實(shí)現(xiàn)LVDS接口接收時(shí)對(duì)時(shí)鐘和數(shù)據(jù)通道的相位補(bǔ)償，以達(dá)到正確接收的目的。ALTERA的高端FPGA，如STRATIX(r) 系列中自帶有DPA電路，但低端的FPGA，如CYCLONE(r)系列中是沒有的。本文主
- 關(guān)鍵字： 相位 調(diào)整 動(dòng)態(tài) 實(shí)現(xiàn) 成本 FPGA 如何
IIR數(shù)字濾波器設(shè)計(jì)-在FPGA上實(shí)現(xiàn)任意階IIR數(shù)字濾波器
- IIR數(shù)字濾波器設(shè)計(jì)-在FPGA上實(shí)現(xiàn)任意階IIR數(shù)字濾波器摘要：本文介紹了一種采用級(jí)聯(lián)結(jié)構(gòu)在FPGA上實(shí)現(xiàn)任意階I...
- 關(guān)鍵字： IIR數(shù)字濾波器 fpga
降低設(shè)備功耗的方法 - 精確測(cè)量
- 有人預(yù)言，全世界的能量需求很可能超出了所供給的能量。美國(guó)能源部估計(jì)，預(yù)計(jì)美國(guó)總的能源消耗在2035年將增加30...
- 關(guān)鍵字： SoC ADC 電路監(jiān)視
Round-Robin輪詢調(diào)度機(jī)制在多隊(duì)列處理中的應(yīng)用
- 本文主要介紹了虛擬化路由器的結(jié)構(gòu)以及其中的關(guān)鍵調(diào)度機(jī)制的算法和實(shí)現(xiàn)，通過多級(jí)的調(diào)度處理，實(shí)現(xiàn)了支持多個(gè)可靈活配置，線速轉(zhuǎn)發(fā)的路由實(shí)例的虛擬化路由器。本文所提到虛擬化路由器實(shí)際設(shè)計(jì)名稱為“IsoRouter”，它基于NetFPGA板卡，本文所介紹的調(diào)度機(jī)制不針對(duì)具體某一型號(hào)的FPGA，它可以在任何一款FPGA上實(shí)現(xiàn)。
- 關(guān)鍵字： 路由器 FPGA
FPGA基礎(chǔ)之時(shí)序設(shè)計(jì)
- FPGA設(shè)計(jì)一個(gè)很重要的設(shè)計(jì)是時(shí)序設(shè)計(jì)，而時(shí)序設(shè)計(jì)的實(shí)質(zhì)就是滿足每一個(gè)觸發(fā)器的建立(Setup)/保持(Hold)時(shí)間的要求。建立時(shí)間(Setup Time)：是指在觸發(fā)器的時(shí)鐘信號(hào)上升沿到來以前，數(shù)據(jù)穩(wěn)定不變的時(shí)間，如果建立時(shí)間
- 關(guān)鍵字： FPGA 基礎(chǔ) 時(shí)序設(shè)計(jì)
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