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【從零開始走進(jìn)FPGA】 玩轉(zhuǎn)VGA
- 一、VGA的誘惑 首先，VGA的驅(qū)動，這事，一般的單片機(jī)是辦不到的;由于FPGA的速度，以及并行的優(yōu)勢，加上可現(xiàn)場配置的優(yōu)勢，VGA的配置，只有俺們FPGA可以勝任，也只有FPGA可以隨心所欲地配置(當(dāng)然ARM也可以，應(yīng)用比較高吧)。 初學(xué)者就是喜歡看炫的效果，往往會忍不住想玩。尤其玩FPGA的，沒玩VGA就感到跟單片機(jī)沒啥提升，因此VGA的驅(qū)動也不得不講。Bingo當(dāng)年也是如此。擋不住VGA的誘惑，初學(xué)者問Bingo VGA問題的人也是灰常的多，也許一般教科書理論太強(qiáng)，實際應(yīng)用不是很身后
- 關(guān)鍵字： VGA FPGA
Altera宣布Stratix 10的創(chuàng)新全面刷新高端FPGA和SoC業(yè)界性能指標(biāo)記錄
- Altera公司今天發(fā)布其Stratix® 10 FPGA和SoC體系結(jié)構(gòu)和產(chǎn)品細(xì)節(jié)，這一下一代高端可編程邏輯器件在性能、集成度、密度和安全特性方面實現(xiàn)全面突破，勢必將云時代的網(wǎng)絡(luò)通信技術(shù)推向又一個巔峰。 Stratix 10 FPGA和SoC采用了Altera革命性的HyperFlex™ FPGA架構(gòu)，由Intel® 14 nm三柵極工藝技術(shù)制造，內(nèi)核性能是前一代FPGA的2倍。業(yè)界性能最好、密度最高、具有先進(jìn)的嵌入式處理功能的FPGA與GPU級別浮點計算性能和異構(gòu)
- 關(guān)鍵字： Altera FPGA
FPGA開發(fā)外設(shè)子板模塊電路設(shè)計詳解
- FPGA(Field-Programmable Gate Array)，即現(xiàn)場可編程門陣列，它是在PAL、GAL、CPLD等可編程器件的基礎(chǔ)上進(jìn)一步發(fā)展的產(chǎn)物。它是作為專用集成電路(ASIC)領(lǐng)域中的一種半定制電路而出現(xiàn)的，既解決了定制電路的不足，又克服了原有可編程器件門電路數(shù)有限的缺點。FPGA的開發(fā)相對于傳統(tǒng)PC、單片機(jī)的開發(fā)有很大不同。FPGA以并行運算為主，以硬件描述語言來實現(xiàn);相比于PC或單片機(jī)(無論是馮諾依曼結(jié)構(gòu)還是哈佛結(jié)構(gòu))的順序操作有很大區(qū)別，也造成了FPGA開發(fā)入門較難。目前國內(nèi)有專
- 關(guān)鍵字： FPGA A/D
基于FPGA的915MHz射頻讀卡器設(shè)計
- 射頻識別(RFID)技術(shù)是一種非接觸式的自動識別技術(shù)，通過射頻信號自動識別目標(biāo)對象并獲取相關(guān)信息。通常RFID系統(tǒng)主要由應(yīng)用軟件、射頻卡以及讀卡器三部分構(gòu)成[1]。相對于低頻段的RFID系統(tǒng)，工作在860 MHz～960 MHz的超高頻段(UHF)RFID系統(tǒng)有著讀取距離遠(yuǎn)、閱讀速度快等優(yōu)點，是目前國際上RFID技術(shù)發(fā)展的熱點[2]。讀卡器的設(shè)計是RFID系統(tǒng)設(shè)計中的關(guān)鍵部分，設(shè)計方案有很多種。FPGA[3]具有開發(fā)簡單、靜態(tài)可重復(fù)編程和動態(tài)在線編程的特點，已經(jīng)成為當(dāng)今應(yīng)用最廣泛的可編程專用集成電路。
- 關(guān)鍵字： FPGA 讀卡器
FPGA的系統(tǒng)架構(gòu)組成和器件互聯(lián)問題
- 通常來講，“一個好漢三個幫”，一個完整的嵌入式系統(tǒng)中由單獨一個FPGA使用的情況較少。通常由多個器件組合完成，例如由一個FPGA+CPU來構(gòu)成。通常為一個FPGA+ARM，ARM負(fù)責(zé)軟件配置管理，界面輸入外設(shè)操作等操作，F(xiàn)PGA負(fù)責(zé)大數(shù)據(jù)量運算，可以看做CPU的專用協(xié)處理器來使用，也常會用于擴(kuò)展外部接口。常用的有ARM+FPGA，DSP+FPGA，或者網(wǎng)絡(luò)處理器+FPGA等種種架構(gòu)形式，這些架構(gòu)形式構(gòu)成整個高速嵌入式設(shè)備的處理形態(tài)。 不得不說的是，隨著技術(shù)的進(jìn)步，現(xiàn)在CP
- 關(guān)鍵字： ARM FPGA
Ramon Chips獲CEVA-X DSP授權(quán)許可用于太空應(yīng)用的高性能計算
- 全球領(lǐng)先的蜂窩通信、多媒體和連接性DSP IP平臺授權(quán)廠商CEVA公司宣布專注開發(fā)獨特太空應(yīng)用抗輻射加固ASIC解決方案的無晶圓廠半導(dǎo)體提供商Ramon Chips公司已經(jīng)獲得CEVA-X1643的授權(quán)許可，用于其瞄準(zhǔn)高性能太空計算的RC64 64核并行處理器。Ramon將在RC64處理器中集成64個CEVA-X1643 DSP，為用于通信、地球觀測、科學(xué)和其它許多應(yīng)用的新一代衛(wèi)星實現(xiàn)計算能力的巨大飛躍。 RC64是65nm CMOS并行處理器，提供384 GOPS、38 GFLOPS和60 G
- 關(guān)鍵字： CEVA DSP
從數(shù)字PWM信號獲得準(zhǔn)確、快速穩(wěn)定的模擬電壓
- 引言 脈寬調(diào)制(PWM)是從微控制器或FPGA等數(shù)字器件產(chǎn)生模擬電壓的一種常用方法。大多數(shù)微控制器都具有內(nèi)置的專用PWM產(chǎn)生外設(shè)，而且其僅需幾行RTL代碼即可從FPGA產(chǎn)生一個PWM信號。如果模擬信號的性能要求不是太嚴(yán)格，那么這就是一種簡單和實用的方法，因為它只需要一個輸出引腳，而且與具有一個SPI或I2C接口的數(shù)模轉(zhuǎn)換器(DAC)相比，其代碼開銷是非常低。圖1示出了一款典型應(yīng)用，其采用一個經(jīng)濾波的數(shù)字輸出引腳來產(chǎn)生一個模擬電壓。 該方案的諸多不足之處您不必深究就能發(fā)現(xiàn)。理想情況下，一個1
- 關(guān)鍵字： PWM FPGA
FPGA和DDS在信號源中的應(yīng)用
- 1引言 DDS同DSP(數(shù)字信號處理)一樣，是一項關(guān)鍵的數(shù)字化技術(shù)。DDS是直接數(shù)字式頻率合成器(DirectDigitalSynthesizer)的英文縮寫。與傳統(tǒng)的頻率合成器相比，DDS具有低成本、低功耗、高分辨率和快速轉(zhuǎn)換時間等優(yōu)點，廣泛使用在電信與電子儀器領(lǐng)域，是實現(xiàn)設(shè)備全數(shù)字化的一個關(guān)鍵技術(shù)。在各行各業(yè)的測試應(yīng)用中，信號源扮演著極為重要的作用。但信號源具有許多不同的類型，不同類型的信號源在功能和特性上各不相同，分別適用于許多不同的應(yīng)用。目前，最常見的信號源類型包括任意波形發(fā)生器，函數(shù)發(fā)
- 關(guān)鍵字： FPGA DDS
DSP在MEMS陀螺儀信號處理平臺的應(yīng)用
- 陀螺儀是一種能夠精確地確定運動物體方位的儀器，它是現(xiàn)代航空、航海、航天和國防工業(yè)中廣泛使用的一種慣性導(dǎo)航儀器，它的發(fā)展對一個國家的工業(yè)，國防和其他高科技的發(fā)展具有十分重要的戰(zhàn)略意義。 近年來隨著MEMS(微機(jī)電系統(tǒng))技術(shù)的發(fā)展，MEMS陀螺儀的研究與發(fā)展受到了廣泛的重視。MEMS陀螺儀具有體積少、重量輕、可靠性好、易于系統(tǒng)集成等優(yōu)點，應(yīng)用范圍廣闊。但是目前MEMS陀螺儀的精度還不是很高，要想大范圍應(yīng)用必須對MEMS陀螺儀的信號進(jìn)行處理。 本文選用TI公司的TMS320VC33作為MEMS陀
- 關(guān)鍵字： DSP MEMS
基于DSP的MEMS陀螺儀信號處理平臺系統(tǒng)的設(shè)計
- 陀螺儀是一種能夠精確地確定運動物體方位的儀器，它是現(xiàn)代航空、航海、航天和國防工業(yè)中廣泛使用的一種慣性導(dǎo)航儀器，它的發(fā)展對一個國家的工業(yè)，國防和其他高科技的發(fā)展具有十分重要的戰(zhàn)略意義。 近年來隨著MEMS(微機(jī)電系統(tǒng))技術(shù)的發(fā)展，MEMS陀螺儀的研究與發(fā)展受到了廣泛的重視。MEMS陀螺儀具有體積少、重量輕、可靠性好、易于系統(tǒng)集成等優(yōu)點，應(yīng)用范圍廣闊。但是目前MEMS陀螺儀的精度還不是很高，要想大范圍應(yīng)用必須對MEMS陀螺儀的信號進(jìn)行處理。 本文選用TI公司的TMS320VC33作為MEMS陀
- 關(guān)鍵字： DSP MEMS
基于FPGA的光纖陀螺儀模擬表頭及其測試系統(tǒng)
- 光纖陀螺是激光陀螺的一種，是慣性技術(shù)和光電子技術(shù)緊密結(jié)合的產(chǎn)物。它利用Sagnac干涉效應(yīng)，用光纖構(gòu)成環(huán)形光路，并檢測出隨光纖環(huán)的轉(zhuǎn)動而產(chǎn)生的兩路超輻射光束之間的相位差，由此計算出光纖環(huán)旋轉(zhuǎn)的角速度。光纖陀螺儀主要由兩個部分組成。伺服于表頭的調(diào)制解調(diào)電路根據(jù)輸進(jìn)的電信號，經(jīng)過相應(yīng)的變換后形成反饋信號送至表頭的相位調(diào)制器中。在實際的應(yīng)用過程中，相應(yīng)的調(diào)制解調(diào)電路應(yīng)該根據(jù)溫度、振動等情況做出相應(yīng)的改變，才能最大限度地保證陀螺的精度要求。本文設(shè)計了一種基于FPGA的測試系統(tǒng)，模擬光纖陀螺儀的表頭，并檢測調(diào)制
- 關(guān)鍵字： FPGA 陀螺儀
基于Nios II的機(jī)器人視覺伺服控制器的研究與設(shè)計
- 引言 Altera公司的Nios II處理器是可編程邏輯器件的軟核處理器。NiosII軟核處理器和存儲器、I/O接口等外設(shè)可嵌入到FPGA中，組成一個可編程單芯片系統(tǒng)(SOPC)，大大降低了系統(tǒng)的成本、體積和功耗。適合網(wǎng)絡(luò)、電信、數(shù)據(jù)通信、嵌入式和消費市場等各種嵌入式應(yīng)用場合。 本文提出一個基于Nios II處理器結(jié)構(gòu)的系統(tǒng)用于實現(xiàn)機(jī)器人實時運動檢測跟蹤，使用線性卡爾曼濾波器算法來快速完成運動估計及進(jìn)一步分析和校正，算法中的乘除利用MATLAB/DSP Builder生成的模塊作為Nios
- 關(guān)鍵字： Nios II FPGA
基于DSP+CPLD的伺服控制卡的設(shè)計
- 0 引 言 隨著先進(jìn)制造技術(shù)的迅速發(fā)展，對運動控制的精度要求也越來越高，而運動伺服控制系統(tǒng)的性能很大程度上取決于伺服控制算法，通過運動控制與智能控制的融合，從改進(jìn)傳統(tǒng)的PID控制，到現(xiàn)代的最優(yōu)控制、自適應(yīng)控制、智能控制技術(shù)，應(yīng)用先進(jìn)的智能控制策略達(dá)到高質(zhì)量的運動控制效果，已經(jīng)成為當(dāng)前研究的一個熱點。 由于運動伺服控制系統(tǒng)中存在負(fù)載模型參數(shù)的變化，機(jī)械摩擦、電機(jī)飽和等非線性因素，造成受控對象的非線性和模型不確定性，使得需要依靠精確的數(shù)學(xué)模型，系統(tǒng)模型參數(shù)的常規(guī)PID控制很難獲得超高精度、快響
- 關(guān)鍵字： DSP CPLD
基于DSP NNC-PID的電液位置伺服控制系統(tǒng)設(shè)計
- 在汽車制造過程中，大量應(yīng)用電液位置伺服式機(jī)械手(焊裝、噴漆)、機(jī)床(沖、壓)以及其他加工裝置。電液位置伺服系統(tǒng)具有功率大、響應(yīng)快、精度高的特點，這就要求控制系統(tǒng)不僅有良好的定位精度，而且要有好的伺服跟蹤性能，因此是控制領(lǐng)域中的一個重要組成部分。電液位置伺服控制系統(tǒng)的典型特征是非線性、不確定性、時變性、外界干擾和交叉耦合干擾等，系統(tǒng)精確的數(shù)學(xué)模型不易建立。因此，對電液系統(tǒng)的控制一直是一個復(fù)雜控制系統(tǒng)問題。 常規(guī)PID控制器具有結(jié)
- 關(guān)鍵字： DSP NNC-PID
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