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          基于ARM7和CPLD的數(shù)字公交站亭系統(tǒng)設計

          • 基于ARM7和CPLD的數(shù)字公交站亭系統(tǒng)設計, 摘要:提出了一種基于ARM7 和CPLD 架構的數(shù)字公交站亭系統(tǒng)。系統(tǒng)通過GPRS 模塊與公交控制中心實時通信,使用CA 認證保證通信的安全性,采用兩塊SRAM 組成具有“乒乓邏輯”的高速緩存確保顯示數(shù)據(jù)的連續(xù)性
          • 關鍵字: ARM  DSP  CPLD  

          多相濾波的數(shù)字相干檢波原理及FPGA實現(xiàn)

          • 多相濾波是實現(xiàn)數(shù)字下變頻及數(shù)字相干檢波的關鍵技術,是雷達、聲納和通信等系統(tǒng)中為數(shù)字信號處理提供高質量的正交信號的有效手段。文中討論了多相濾波的基本原理,給出了采用多相濾波的方法對中頻帶限信號處理的仿真分析,并結合一款脈沖壓縮雷達中頻數(shù)字化接收機的實現(xiàn)方案進行工程驗證,結果表明,在技術指標上可有效克服正交通道不一致問題,具有較高的應用價值。
          • 關鍵字: FPGA  多相濾波  數(shù)字  相干檢波    

          基于FPGA的音樂播放控制電路設計

          • 基于FPGA的音樂播放控制電路設計,  隨著電子技術發(fā)展,電子電路的形式趨向復雜化,面對這一狀況,人們已經(jīng)清醒地認識到,要分析和設計復雜的電子系統(tǒng)人工的方法已不適用。依靠傳統(tǒng)的實驗教學已遠不能滿足社會對高新技術人才的培養(yǎng)需要。本文就一個
          • 關鍵字: 控制  電路設計  播放  音樂  FPGA  基于  

          基于FMC標準的FPGA夾層卡I/O設計

          • 基于FMC標準的FPGA夾層卡I/O設計, 面對似乎層出不窮的新 I/O 標準,目前嵌入式系統(tǒng)設計人員繼續(xù)依靠 FPGA 來部署系統(tǒng)日益重要的外部 I/O 接口,這點絲毫不足為奇。FPGA 可提供大量可配置的 I/O,能在適當 IP 基礎上支持幾乎無限多種高度復雜的 I/O
          • 關鍵字: I/O  設計  夾層  FPGA  FMC  標準  基于  

          基于閃爍存儲器的DSP并行引導裝載方法

          • 基于閃爍存儲器的DSP并行引導裝載方法,TMS3.0VC5409 是TI公司推出的第一代的高性能、低價位、低功耗數(shù)字信號處理器(DSP)。與現(xiàn)在流行的TMS320C5409相比,性能提高了60%,功耗效率提高了 50%。它的應用對象大多是要求能脫機運行的內嵌式系統(tǒng),如機頂盒(
          • 關鍵字: 引導  裝載  方法  并行  DSP  閃爍  存儲器  基于  

          DSP在交流異步電動機變頻調速中的應用

          • DSP在交流異步電動機變頻調速中的應用, 目前交流調速電氣傳動已經(jīng)成為電氣調速傳動的主流。隨著現(xiàn)代交流電機調速控制理論的發(fā)展和電力電子裝置功能的完善,特別是微型計算機及大規(guī)模集成電路的發(fā)展,交流電機調速取得了突破性的進展?! 『銐侯l比(U/F=常
          • 關鍵字: 應用  變頻調速  異步電動機  交流  DSP  

          基于ARM的可定制MCU可承擔FPGA的工作

          • 基于ARM的可定制MCU可承擔FPGA的工作,如今的產(chǎn)品生命周期可能短至六個月,因此在這種情況下要想取得定制ASIC的低成本、低功耗和高性能優(yōu)勢幾乎是不可能的。定制ASIC的設計周期通常要一年左右,這通常要比終端產(chǎn)品的生命周期還要長。另外,標準單元ASIC還
          • 關鍵字: ARM  MCU  FPGA  

          音頻信號采集與AGC算法的DSP設計方案

          • 過去,對大音頻信號采用限幅方式,即對大信號進行限幅輸出,小信號不予處理。這樣,仍然存在音頻信號過小時,用戶自行調節(jié)音量,也會影響用戶的收聽效果。隨著電子技術,計算機技術和通信技術的迅猛發(fā)展,數(shù)字信號處
          • 關鍵字: DSP  設計  方案  算法  AGC  信號  采集  音頻  

          如何實現(xiàn)FPGA到DDR3 SDRAM存儲器的連接

          • 采用90nm工藝制造的DDR3 SDRAM存儲器架構支持總線速率為600 Mbps-1.6 Gbps (300-800 MHz)的高帶寬,工作電壓低至1.5V,因此功耗小,存儲密度更可高達2Gbits。該架構無疑速度更快,容量更大,單位比特的功耗更低,但問
          • 關鍵字: SDRAM  FPGA  DDR3  存儲器    

          基于FPGA的寬帶數(shù)字接收機變帶寬數(shù)字下變頻器設計

          • 摘 要: 基于FPGA芯片Stratix II EP2S60F672C4設計了一個適用于寬帶數(shù)字接收機的帶寬可變的數(shù)字下變頻器(VB-DDC)。該VB-DDC結合傳統(tǒng)數(shù)字下變頻結構與多相濾波結構的優(yōu)點,實現(xiàn)了對輸入中頻信號的高效高速處理,同
          • 關鍵字: FPGA  寬帶數(shù)字  接收機  帶寬    

          基于FPGA和IP Core的定制緩沖管理的實現(xiàn)

          • 隨著通信協(xié)議的發(fā)展及多樣化,協(xié)議處理部分PE在硬件轉發(fā)實現(xiàn)方面,普遍采用現(xiàn)有的商用芯片NP(Network Processor,網(wǎng)絡處理器)來完成,流量管理部分需要根據(jù)系統(tǒng)的需要進行定制或采用商用芯片來完成。在很多情況下NP
          • 關鍵字: FPGA  Core  定制    

          基于FPGA的DDFS與DDWS兩種實現(xiàn)方式

          • DDS(DirectDigitalFreqiaencySynthesizers)廣泛應用于雷達系統(tǒng)、數(shù)字通信、電子對抗、電子測量等民...
          • 關鍵字: DDFS  DDWS  FPGA  

          基于FPGA原型的GPS基帶驗證系統(tǒng)設計與實現(xiàn)

          • 隨著SoC設計復雜度的提高,驗證所需時間已經(jīng)占到整個設計周期的70%以上,如何減少驗證時間成為一個十分重要...
          • 關鍵字: GPS  基帶驗證系統(tǒng)  FPGA  SoC  

          FPGA與MCU/模擬技術整合提速

          •   繼賽靈思今年年初發(fā)布了與ARM的合作計劃之后,Altera近日發(fā)布了與ARM、英特爾等的合作計劃,Actel則被模擬/混合信號公司Microsemi收購,這一系列事件都預示著在微控制器、模擬IC和FPGA領域正出現(xiàn)一些多層次的整合趨勢。針對這些整合趨勢,F(xiàn)PGA業(yè)內的另一些企業(yè)如Lattice、SiliconBlue、Acrhonix、Quicklogic和InPa未來會如何?   
          • 關鍵字: ARM  FPGA  MCU  
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