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fpga：quartusⅡ 文章進(jìn)入fpga：quartusⅡ技術(shù)社區(qū)

強(qiáng)化協(xié)作生態(tài) SoC FPGA成攻城利器

Altera公司意欲通過更先進(jìn)的制程工藝和更緊密的產(chǎn)業(yè)合作，正逐步強(qiáng)化FPGA協(xié)同處理器，大幅提升SoC FPGA的整體性 ...
關(guān)鍵字： SoC FPGA

基于FPGA的通用位同步器設(shè)計(jì)方案（二）

2.2.2 定時(shí)誤差檢測(cè)設(shè)計(jì)　　定時(shí)誤差檢測(cè)程序采用獨(dú)立于載波相位偏差的GA-TED算法。該算法每個(gè)符號(hào)周期只 ...
關(guān)鍵字： FPGA 通用位同步器

基于FPGA的通用位同步器設(shè)計(jì)方案(一)

本文主要是先闡述傳統(tǒng)Gardner算法的原理，然后給出改進(jìn)后的設(shè)計(jì)和FPGA實(shí)現(xiàn)方法，最后對(duì)結(jié)果進(jìn)行仿真和分析，證明 ...
關(guān)鍵字： FPGA 位同步器

基于FPGA的基帶64×64數(shù)據(jù)分配矩陣設(shè)計(jì)方案

本文采用FPGA作為實(shí)現(xiàn)控制邏輯的核心部件，提出了基于FPGA的基帶64×64 數(shù)據(jù)分配矩陣設(shè)計(jì)方案，并介紹了上位機(jī) ...
關(guān)鍵字： FPGA 數(shù)據(jù)分配矩陣設(shè)計(jì)

基于FPGA的多普勒測(cè)振計(jì)信號(hào)采集與處理系統(tǒng)設(shè)計(jì)方案

0 引言　　傳統(tǒng)的淺海地形測(cè)量以船只為平臺(tái)，采用聲納技術(shù)進(jìn)行，這種測(cè)量方法對(duì)于一些船只難以駛?cè)氲膮^(qū)域便形 ...
關(guān)鍵字： FPGA 多普勒測(cè)振計(jì) 信號(hào)采集

高效能64位SoC FPGA問世大舉進(jìn)攻通信等市場(chǎng)

業(yè)界首顆64位系統(tǒng)單芯片（SoC）現(xiàn)場(chǎng)可編程門陣列（FPGA）搶先亮相。Altera宣布將以英特爾（Intel）14納米（nm）三門極（Tri-g ...
關(guān)鍵字：高效能 SoC FPGA

基于FPGA的TDICCD8091 驅(qū)動(dòng)時(shí)序電路設(shè)計(jì)

0引言時(shí)間延時(shí)積分電荷耦合器件(TimeDelayandIntegra-tionChargeCoupledDevices,TDICCD)易于實(shí)現(xiàn)實(shí)...
關(guān)鍵字： FPGA TDICCD8091 驅(qū)動(dòng)時(shí)序

基于FPGA的FIR數(shù)字濾波器設(shè)計(jì)方案（二）

模型搭建好之后，需要確定16階FIR數(shù)字濾波器的系數(shù)，在這使用Matlab中的FDATool濾波器設(shè)計(jì)工具來確定。確定好濾 ...
關(guān)鍵字： FPGA FIR 數(shù)字濾波器

基于FPGA的FIR數(shù)字濾波器設(shè)計(jì)方案(一)

在Matlab/Simulink環(huán)境下，采用DSP Builder模塊搭建FIR模型，根據(jù)FDATool工具對(duì)FIR濾波器進(jìn)行了設(shè)計(jì)，然后進(jìn)行系 ...
關(guān)鍵字： FPGA FIR 數(shù)字濾波器

最新FPGA所需求的電源IC

近年來，電子設(shè)備(應(yīng)用)的多樣化與高性能化以驚人的速度不斷發(fā)展?？梢哉f，這種趨勢(shì)使各產(chǎn)品的開發(fā)周期縮短，并給...
關(guān)鍵字： FPGA 電源IC

基于ARM+FPGA的1394總線在TFT-LCD檢測(cè)系統(tǒng)中的應(yīng)用

IEEE1394是最初由Apple公司提出的高速串行總線，1995年IEEE(電氣和電子工程師協(xié)會(huì))將其認(rèn)可為IEEE1394－1995規(guī) ...
關(guān)鍵字： IEEE1394總線 ARM FPGA TFT-LCD

Altera推出首款基于FPGA的智能交通視頻分析解決方案

Altera公司 (NASDAQ: ALTR) 日前在2013年中國(guó)國(guó)際公共安全博覽會(huì) (安博會(huì)) 上宣布，北京動(dòng)視元科技有限公司(簡(jiǎn)稱：動(dòng)視元)采用Altera基于FPGA的最新視頻分析成功推出首個(gè)基于FPGA的智能交通視頻分析解決方案——?jiǎng)右曉令Ｏ盗薪煌顩r視頻分析儀。
關(guān)鍵字： Altera FPGA 視頻分析

PSoC 5LP：帶CPLD的可靠ARM嵌入式處理器

您是不是需要復(fù)雜可編程邏輯器件(CPLD)但又不愿放棄固件?或者說您希望最好在單個(gè)芯片中同時(shí)集成微控制器和CPLD?PSoC? 5LP是賽普拉斯半導(dǎo)體公司的最新片上可編程系統(tǒng)，當(dāng)它用作CPU時(shí)，它就是一款32位的67 MHz ARM Cortex-M3處理器，而用作CPLD時(shí)，其可編程邏輯提供的基于LUT的FPGA門，相當(dāng)于20,000多個(gè)門。
關(guān)鍵字： ARM 嵌入式 FPGA PSoC UDB

十一條金律！搞定DC/DC電源轉(zhuǎn)換方案設(shè)計(jì)

搞嵌入式的工程師們往往把單片機(jī)、ARM、DSP、FPGA搞的得心應(yīng)手，而一旦進(jìn)行系統(tǒng)設(shè)計(jì)，到了給電源系統(tǒng)供電，雖然也能讓其精心設(shè)計(jì)的程序運(yùn)行起來，但對(duì)于新手來說，有時(shí)可能效率低下，往往還有供電電流不足或過大引起這樣那樣的問題，本文十大金律輕松搞定DCDC電源轉(zhuǎn)換電路設(shè)計(jì)。
關(guān)鍵字： DC/DC FPGA DSP 穩(wěn)壓器

FPGA攻略之Testbench篇

Testbench，就是測(cè)試平臺(tái)的意思，具體概念就多不介紹了，相信略懂FPGA的人都知道，編寫Testbench的主要目的是為了對(duì)使用硬件描述語言(HDL)設(shè)計(jì)的電路進(jìn)行仿真驗(yàn)證，測(cè)試設(shè)計(jì)電路的功能、部分性能是否與預(yù)期的目標(biāo)相符。
關(guān)鍵字： FPGA Quartus Testbench 開發(fā)板異步復(fù)位

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fpga：quartusⅡ介紹

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fpga：quartusⅡ電路

利用FPGA資源和最小模擬電路發(fā)電進(jìn)行開關(guān)電源設(shè)計(jì)的方法
基于FPGA的機(jī)載顯示系統(tǒng)架構(gòu)設(shè)計(jì)與優(yōu)化
基于FPGA+DSP遠(yuǎn)程監(jiān)控器設(shè)計(jì)與實(shí)現(xiàn)
基于FPGA的LCD顯示遠(yuǎn)程更新

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