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fpga-pwm 文章 進(jìn)入fpga-pwm技術(shù)社區(qū)
基于Atmega48太陽(yáng)能路燈控制器研究
- 摘要：太陽(yáng)能控制器是太陽(yáng)能路燈系統(tǒng)中的核心部分，設(shè)計(jì)了一種基于Atmega48單片機(jī)的太陽(yáng)能路燈控制器。該控制器采用PWM脈沖調(diào)制控制技術(shù)通過(guò)對(duì)蓄電池電壓、充電電流等參數(shù)進(jìn)行檢測(cè)，控制開(kāi)關(guān)管的關(guān)斷，來(lái)實(shí)現(xiàn)充放電控
- 關(guān)鍵字： 太陽(yáng)能控制器 Atmega48單片機(jī) PWM 充放電控制
基于SoPC的狀態(tài)監(jiān)測(cè)裝置的嵌入式軟硬件協(xié)同設(shè)計(jì)
- 基于SoPC的狀態(tài)監(jiān)測(cè)裝置的嵌入式軟硬件協(xié)同設(shè)計(jì),摘要：首先介紹了軟硬件協(xié)同設(shè)計(jì)方法的發(fā)展過(guò)程和狀態(tài)監(jiān)測(cè)裝置開(kāi)發(fā)的背景資料，然后利用該方法設(shè)計(jì)了一款新型的高性能狀態(tài)監(jiān)測(cè)裝置，并分別從硬件和軟件2個(gè)角度對(duì)設(shè)計(jì)方法進(jìn)行了深入說(shuō)明。該裝置已成功集成于水電機(jī)組
- 關(guān)鍵字： 軟硬件協(xié)同 SoPC 狀態(tài)監(jiān)測(cè) Linux FPGA PLC
ZigBee+GPRS的LED路燈監(jiān)控系統(tǒng)
- 摘要：將ZigBee技術(shù)和GPRS移動(dòng)通信技術(shù)相結(jié)合，設(shè)計(jì)了一種基于ZigBee+GPRS的LED路燈照明遠(yuǎn)程監(jiān)控系統(tǒng)。系統(tǒng)采用兩級(jí)雙網(wǎng)組網(wǎng)模型和簇-鏈型網(wǎng)絡(luò)拓?fù)浣Y(jié)構(gòu)，通過(guò)網(wǎng)絡(luò)化、智能化控制，實(shí)現(xiàn)了燈具的遙測(cè)、遙控。此外，提出
- 關(guān)鍵字： ZigBee GPRS LED照明系統(tǒng) PWM
Microsemi公司開(kāi)發(fā)的RTAX-DSP FPGA已獲準(zhǔn)用于航空領(lǐng)域
- 據(jù)報(bào)道，Microsemi公司SoC產(chǎn)品集團(tuán)(原Actel公司)開(kāi)發(fā)的RTAX-DSP現(xiàn)場(chǎng)可編程門(mén)陣列(FPGA)器件已獲得合格制造商清單(QML)V類和Q類資格認(rèn)證，這意味著該FPGA器件獲準(zhǔn)用于衛(wèi)星、載人飛船和其他空間應(yīng)用。 公司官方表示，Microsemi的抗輻射QML-V FPGA在不同程度上能夠承受空間自然輻射影響，并對(duì)每個(gè)特定晶片都進(jìn)行2,000小時(shí)的壽命測(cè)試，對(duì)每個(gè)特定組件都進(jìn)行破壞性物理分析。 RTAX-DSP FPGA將復(fù)雜數(shù)字信號(hào)處理(DSP)功能集成到單一設(shè)備，滿足高
- 關(guān)鍵字： Microsemi FPGA
短波擴(kuò)頻猝發(fā)通信系統(tǒng)的DSP+FPGA實(shí)現(xiàn)方案
- 引言短波通信是一種能進(jìn)行遠(yuǎn)距離傳輸，而對(duì)電臺(tái)的要求相對(duì)較低的通信系統(tǒng)。短波具有的遠(yuǎn)距離通信能力和電臺(tái)具有的較高機(jī)動(dòng)性等特點(diǎn)，使其在軍事通信領(lǐng)域中具有重要的應(yīng)用價(jià)值。然而，短波信道頻帶窄，傳播特性不穩(wěn)定
- 關(guān)鍵字： FPGA DSP 短波擴(kuò)頻 通信系統(tǒng)
基于FPGA的IIR數(shù)字濾波器的快捷設(shè)計(jì)
- 0 引言IIR數(shù)字濾波器在很多領(lǐng)域中都有著廣闊的應(yīng)用。與FIR數(shù)字濾波器相比，IIR數(shù)字濾波器可以用較低的階數(shù)獲得較高的選擇性，而且所用存儲(chǔ)單元少，經(jīng)濟(jì)效率高。一個(gè)N階IIR數(shù)字濾波器的系統(tǒng)函數(shù)為： 其線性常系數(shù)差分
- 關(guān)鍵字： FPGA IIR 數(shù)字濾波器
解析FPGA設(shè)計(jì)流程及其布線資源
- FPGA/CPLD的設(shè)計(jì)流程 1、電路設(shè)計(jì)與輸入 電路設(shè)計(jì)與輸入是指通過(guò)某些規(guī)范的描述方式，將工程師電路構(gòu)思輸入給EDA工具。常用的設(shè)計(jì)方法有硬件描述語(yǔ)言（HDL）和原理圖設(shè)計(jì)輸入方法等。原理圖設(shè)計(jì)輸入法在早期應(yīng)用得比
- 關(guān)鍵字： FPGA 設(shè)計(jì)流程 布線 資源
基于ARM+FPGA的運(yùn)動(dòng)控制器設(shè)計(jì)與實(shí)現(xiàn)
- 摘要：本文以微控制器AT91RM9200 和EP1C6Q240C8 為核心，對(duì)工業(yè)CT 機(jī)的運(yùn)動(dòng)控制器進(jìn)行了設(shè)計(jì)，從硬件和軟件兩個(gè)方 ...
- 關(guān)鍵字： ARM FPGA 運(yùn)動(dòng)控制器
基于ARM/FPGA的高速同步數(shù)據(jù)采集方案
- 大多數(shù)的勘探、觀測(cè)工作都是在嚴(yán)苛的環(huán)境中進(jìn)行的，對(duì)數(shù)據(jù)的準(zhǔn)確性、實(shí)時(shí)性都有著較高的要求，并且大多情況 ...
- 關(guān)鍵字： ARM FPGA 同步數(shù)據(jù)采集
后發(fā)者如何制人？Altera與ARM戰(zhàn)略合作細(xì)節(jié)公布
- 2012年12月13日，Altera聯(lián)合ARM召開(kāi)發(fā)布會(huì)，共同宣布發(fā)售其首款28nm FPGA SoC器件，包含雙核ARM Cortex-A9 800MHz處理器，此時(shí)，賽靈思的類似產(chǎn)品Zynq已經(jīng)發(fā)售一年有余。 客觀來(lái)說(shuō)，Altera的SoC產(chǎn)品進(jìn)展比賽靈思緩慢許多，2010年，賽靈思就放出了與ARM合作開(kāi)發(fā)下一代SoC器件的消息，而與之對(duì)應(yīng)的Altera只是公布了與MIPS的合作藍(lán)圖，又聯(lián)合Intel宣布X86與FPGA的融合技術(shù)，直到2011年年中，Altera與ARM的合作計(jì)劃才姍姍來(lái)遲
- 關(guān)鍵字： Altera FPGA
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