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美高森美發(fā)布Libero SoC v11.8軟件為FPGA設(shè)計(jì)人員提供混合語(yǔ)言仿真和同級(jí)最佳調(diào)試功能

　　致力于在功耗、安全、可靠性和性能方面提供差異化半導(dǎo)體技術(shù)方案的領(lǐng)先供應(yīng)商美高森美公司(Microsemi Corporation)發(fā)布Libero系統(tǒng)級(jí)芯片(SoC)軟件的 v11.8最新版本。這是一款綜合性可編程邏輯器件(FPGA)設(shè)計(jì)工具，具有混合語(yǔ)言仿真等重要性能改進(jìn)，還有同級(jí)最佳調(diào)試功能，以及一個(gè)全新網(wǎng)表視圖。除此以外，美高森美還提供免費(fèi)的 License，讓用戶評(píng)估美高森美基于Flash的FPGA和SoC FPGA器件?！　∶栏呱繪ibero&nbs
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從PCB設(shè)計(jì)到軟件處理談單片機(jī)系統(tǒng)的電磁兼容性設(shè)計(jì)

　　一、影響EMC的因數(shù) 　　1、電壓：電源電壓越高，意味著電壓振幅越大，發(fā)射就更多，而低電源電壓影響敏感度。　　2、頻率：高頻產(chǎn)生更多的發(fā)射，周期性信號(hào)產(chǎn)生更多的發(fā)射。在高頻單片機(jī)系統(tǒng)中，當(dāng)器件開(kāi)關(guān)時(shí)產(chǎn)生電流尖峰信號(hào);在模擬系統(tǒng)中，當(dāng)負(fù)載電流變化時(shí)產(chǎn)生電流尖峰信號(hào)。　　3、接地：在所有EMC題目中，主要題目是不適當(dāng)?shù)慕拥匾鸬?。有三種信號(hào)接地方法：?jiǎn)吸c(diǎn)、多點(diǎn)和混合。在頻率低于1MHz時(shí)，可采用單點(diǎn)接地方法，但不適宜高頻;在高頻應(yīng)用中，最好采用多點(diǎn)接地?；旌辖拥厥堑皖l用單點(diǎn)接地，而高頻用多點(diǎn)接
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兩大兩小廠商或易主或易“容” FPGA將何去何從？

FPGA廠商的易主或戰(zhàn)略的改變，也勢(shì)必影響FPGA本身的命運(yùn)。雖然FPGA架構(gòu)在不斷演進(jìn)，但顯然步伐已在放緩。
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硬件設(shè)計(jì)如何選擇連接器

　　電子產(chǎn)品的設(shè)計(jì)越來(lái)越趨向于模塊化，不同功能模塊經(jīng)過(guò)有機(jī)結(jié)合可快速打造出優(yōu)質(zhì)、性能各異的產(chǎn)品，而其中模塊的連接就顯得尤為重要，下面是一位資深硬件工程師分享的一些關(guān)于連接器選擇的經(jīng)驗(yàn)?！　∵B接器就像程序的函數(shù)接口，設(shè)計(jì)合理了，將來(lái)產(chǎn)品維護(hù)、升級(jí)、移植都會(huì)事半功倍，使產(chǎn)品保持持久的生命力;設(shè)計(jì)不合理，造成將來(lái)維護(hù)、升級(jí)時(shí)困難重重，牽一發(fā)而動(dòng)全身，最終使產(chǎn)品失去競(jìng)爭(zhēng)力，連接器的重要性不言而喻。　　連接器，也就是工程師俗稱的接插件，用于把兩個(gè)電路板或電子設(shè)備連接起來(lái)，實(shí)現(xiàn)電源或信號(hào)的傳輸。通過(guò)連接器，可以使電路
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【E問(wèn)E答】英特爾的CPU+FPGA能否打敗谷歌TPU？

　　近日，英特爾宣布與科大訊飛達(dá)成技術(shù)合作，共同優(yōu)化在機(jī)器學(xué)習(xí)與深度學(xué)習(xí)領(lǐng)域的離線訓(xùn)練與在線預(yù)測(cè)，并在上周舉辦電博會(huì)上進(jìn)行了展示。本文是網(wǎng)易智能對(duì)英特爾技術(shù)專家與科大訊飛深度學(xué)習(xí)平臺(tái)研發(fā)總監(jiān)張致江的采訪，值得一讀。　　英特爾AI芯片技術(shù)布局：CPU+FPGA 　　據(jù)了解，2016年11月，英特爾和訊飛簽署了一個(gè)為期是三年的人工智能技術(shù)合作框架。英特爾與科大訊飛的技術(shù)合作涵蓋了深度學(xué)習(xí)的完整流程，包括數(shù)據(jù)采集，離線訓(xùn)練(Traning)，在線預(yù)測(cè)(Inferencing)，采集新數(shù)據(jù)組，進(jìn)行新的離線訓(xùn)
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【E課堂】幾組實(shí)用FPGA原理設(shè)計(jì)圖

　　FPGA(Field-Programmable?Gate?Array)，即現(xiàn)場(chǎng)可編程門陣列，它是在PAL、GAL、CPLD等可編程器件的基礎(chǔ)上進(jìn)一步發(fā)展的產(chǎn)物。它是作為專用集成電路(ASIC)領(lǐng)域中的一種半定制電路而出現(xiàn)的，既解決了定制電路的不足，又克服了原有可編程器件門電路數(shù)有限的缺點(diǎn)。FPGA的開(kāi)發(fā)相對(duì)于傳統(tǒng)PC、單片機(jī)的開(kāi)發(fā)有很大不同。FPGA以并行運(yùn)算為主，以硬件描述語(yǔ)言來(lái)實(shí)現(xiàn);相比于PC或單片機(jī)(無(wú)論是馮諾依曼結(jié)構(gòu)還是哈佛結(jié)構(gòu))的順序操作有很大區(qū)別，也造成了FPGA開(kāi)發(fā)入
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【E問(wèn)E答】如何正確使用PCB的分層和堆疊？

　　1.概述　　多層印制板為了有更好的電磁兼容性設(shè)計(jì)。使得印制板在正常工作時(shí)能滿足電磁兼容和敏感度標(biāo)準(zhǔn)。正確的堆疊有助于屏蔽和抑制EMI?！　?.多層印制板設(shè)計(jì)基礎(chǔ)?！　《鄬佑≈瓢宓碾姶偶嫒莘治隹梢曰诳讼；舴蚨珊头ɡ陔姶鸥袘?yīng)定律?！　「鶕?jù)克?；舴蚨?，任何時(shí)域信號(hào)由源到負(fù)載的傳輸都必須有一個(gè)最低阻抗的路徑。見(jiàn)圖一。圖中I=I′,大小相等，方向相反。圖中I我們稱為信號(hào)電流，I′稱為映象電流，而I′所在的層我們稱為映象平面層。如果信號(hào)電流下方是電源層(POWER)，此時(shí)的映象電流回路是通過(guò)電容耦合所達(dá)到
關(guān)鍵字： PCB 堆疊

FPGA學(xué)習(xí)筆記之mif文件生成方法總結(jié)

　　方法1：利用Quartus自帶的mif編輯器　　優(yōu)點(diǎn)：對(duì)于小容量RAM可以快速方便的完成mif文件的編輯工作，不需要第三方軟件的編輯;　　缺點(diǎn)：一旦數(shù)據(jù)量過(guò)大，一個(gè)一個(gè)的輸入會(huì)使人崩潰;　　使用方法：在quartus中，【file】/【new】，選擇Memory?Initialization?file，彈出如下窗口：　　Number?of?words：可尋址的存儲(chǔ)單元數(shù)，對(duì)于8bit地址線，此處選擇256;　　words?size：存儲(chǔ)單元寬度，8bi
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詳解人工智能芯片 CPU/GPU/FPGA有何差異？

CPU與GPU在各自領(lǐng)域都可以高效地完成任務(wù)，但當(dāng)同樣應(yīng)用于通用基礎(chǔ)計(jì)算領(lǐng)域時(shí)，設(shè)計(jì)架構(gòu)的差異直接導(dǎo)致了兩種芯片性能的差異。
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快速檢測(cè)出PCB板故障問(wèn)題的方法

　　制作PCB板并非簡(jiǎn)單的按流程來(lái)做完板子，鉆個(gè)孔打上元器件就好了。PCB的制作并不難，難的在于制作完成后的故障排查。無(wú)論是個(gè)人愛(ài)好者還是行業(yè)工程師，對(duì)于PCB電路板在調(diào)試的時(shí)候遇到問(wèn)題也是相當(dāng)?shù)念^疼，就好比程序員遇到BUG一樣。　　有些人對(duì)于調(diào)試PCB電路板有著濃厚的興趣，就像程序員在解決BUG一樣，常見(jiàn)的PCB電路板問(wèn)題并不少，常見(jiàn)的問(wèn)題除了電路板設(shè)計(jì)、電子元器件的損壞、線路短路、元器件的質(zhì)量、PCB電路板斷線故障不在少數(shù)。　　損壞的二極管環(huán)色電阻　　常見(jiàn)的PCB電路板故障主要還是集中
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開(kāi)關(guān)電源PCB設(shè)計(jì)要點(diǎn)

　　在開(kāi)關(guān)電源設(shè)計(jì)中，PCB設(shè)計(jì)是非常關(guān)鍵的一步，它對(duì)電源的性能，EMC要求，可靠性，可生產(chǎn)性都影響很大。隨著電子技術(shù)的發(fā)展，開(kāi)關(guān)電源的體積越來(lái)越小，工作頻率也越來(lái)越高，內(nèi)部器件的密集度也越來(lái)越高，這對(duì)PCB布局布線的抗干擾要求也越來(lái)越嚴(yán)，合理的，科學(xué)的PCB設(shè)計(jì)會(huì)讓你的工作事半功倍?！　?、布局要求　　PCB布局是比較講究的，不是說(shuō)隨便放上去，擠得下就完事的。一般PCB布局要遵循幾點(diǎn)：　　(1)布局的首要原則是保證布線的布通率，移動(dòng)器件時(shí)注意飛線的連接，把有連線關(guān)系的器件放在一起?！　?2)以每個(gè)功能電
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FPGA外圍電路集成運(yùn)算放大器實(shí)用電路分析（四）

　　首先，我們簡(jiǎn)單來(lái)介紹下比較器　　?? ?　　1.12?過(guò)零比較器　　?? ?　　1.13?一般單限比較器　　?? ?　　1.14?滯回比較器　　?? ?　　1.15?窗口比較器　　?? ?　　本次專題到此結(jié)束，謝謝大家閱讀，希望對(duì)大家有所幫助
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魏少軍關(guān)于《中國(guó)IC設(shè)計(jì)業(yè)宏觀分析和未來(lái)發(fā)展方向》報(bào)告

　　清華大學(xué)微納電子學(xué)系主任暨中國(guó)半導(dǎo)體行業(yè)協(xié)會(huì)IC設(shè)計(jì)分會(huì)理事長(zhǎng)魏少軍教授，一如繼往地對(duì)于中國(guó)IC設(shè)計(jì)產(chǎn)業(yè)給出他獨(dú)家的宏觀分析，以及魏教授本人對(duì)于中國(guó)IC產(chǎn)業(yè)的未來(lái)發(fā)展方向的點(diǎn)評(píng)。　　　　　　　　　　　　　　　　　　
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FPGA外圍電路集成運(yùn)算放大器實(shí)用電路分析（三）

　　今天繼續(xù)更新FPGA外圍電路集成運(yùn)算放大器的信號(hào)產(chǎn)生電路，let's?go~~　　?? ?　　1.11?方波發(fā)生電路　　?? 　　今天的信號(hào)產(chǎn)生電路部分就到這了，下節(jié)將會(huì)介紹電壓比較器部分，敬請(qǐng)期待!
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