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信號(hào)完整性：PCB走線寬度變化產(chǎn)生的反射
- 在進(jìn)行PCB布線時(shí)，經(jīng)常會(huì)發(fā)生這樣的情況：走線通過(guò)某一區(qū)域時(shí)，由于該區(qū)域布線空間有限，不得不使用更細(xì)的線條，通過(guò)這一區(qū)域后，線條再恢復(fù)原來(lái)的寬度。走線寬度變化會(huì)引起阻抗變化，因此發(fā)生反射，對(duì)信號(hào)產(chǎn)生影響。
- 關(guān)鍵字： PCB 信號(hào)完整性 變化 反射
PCB設(shè)計(jì)的一般原則
- 要使電子電路獲得最佳性能，元器件的布局及導(dǎo)線的布設(shè)是很重要的。為了設(shè)計(jì)質(zhì)量好、成本低的PCB，應(yīng)遵循以下一般性原則?！ 。?）特殊元器件布局 首先，要考慮PCB尺寸的大?。篜CB尺寸過(guò)大時(shí)，印刷線條長(zhǎng)，阻抗增
- 關(guān)鍵字： PCB
基于CPLD的多DSP及FPGA遠(yuǎn)程加載設(shè)計(jì)
- 摘要：介紹了一種以CPLD為基礎(chǔ)的對(duì)多DSP和FPCA芯片實(shí)現(xiàn)程序遠(yuǎn)程更新、加載的設(shè)計(jì)方法。詳細(xì)分析了軟硬件架構(gòu)及具體實(shí)施方案，對(duì)以DSP+FPCA為架構(gòu)的信號(hào)處理模塊實(shí)現(xiàn)遠(yuǎn)程更新、加載，有重要的使用價(jià)值。
關(guān)鍵詞：遠(yuǎn)程 - 關(guān)鍵字： CPLD FPGA DSP 遠(yuǎn)程加載
FPGA/CPLD中常見(jiàn)模塊設(shè)計(jì)精華集錦（一）
- 一、智能全數(shù)字鎖相環(huán)的設(shè)計(jì) 1 引言 數(shù)字鎖相環(huán)路已在數(shù)字通信、無(wú)線電電子學(xué)及電力系統(tǒng)自動(dòng)化等領(lǐng)域中得到了極為廣泛的應(yīng)用。隨著集成電路技術(shù)的發(fā)展，不僅能夠制成頻率較高的單片集成鎖相環(huán)路，而且可以把整
- 關(guān)鍵字： FPGA CPLD 模塊設(shè)計(jì) 集錦
基于FPGA的數(shù)字激光自動(dòng)功率控制系統(tǒng)設(shè)計(jì)
- 摘要：半導(dǎo)體激光器的自動(dòng)功率控制是解決激光器閾值漂移的重要手段，本文設(shè)計(jì)了一個(gè)基于FPGA的數(shù)字激光自動(dòng)功率控制系統(tǒng)，該控制系統(tǒng)主要由光電檢測(cè)、A／D轉(zhuǎn)換、SOC控制、APC判定、PWM反饋輸出及低通濾波幾個(gè)部分組成
- 關(guān)鍵字： FPGA 數(shù)字激光 自動(dòng)功率控制 系統(tǒng)設(shè)計(jì)
基于遺傳算法的組合邏輯電路設(shè)計(jì)的FPGA實(shí)現(xiàn)
- 摘要：基于遺傳算法的組合邏輯電路的自動(dòng)設(shè)計(jì)，依據(jù)給出的真值表，利用遺傳算法自動(dòng)生成符合要求的組合邏輯電路。由于遺傳算法本身固有的并行性，采用軟件實(shí)現(xiàn)的方法在速度上往往受到本質(zhì)是串行計(jì)算的計(jì)算機(jī)制約，因
- 關(guān)鍵字： FPGA 算法 電路設(shè)計(jì) 組合邏輯
基于ARM和FPGA的靶場(chǎng)破片測(cè)速系統(tǒng)的設(shè)計(jì)
- 破片速度是戰(zhàn)斗部爆炸效能*估的一個(gè)重要參數(shù)。傳統(tǒng)的靶場(chǎng)破片測(cè)速系統(tǒng)多使用多路數(shù)據(jù)采集卡設(shè)置好的參數(shù)現(xiàn)場(chǎng)采集標(biāo)靶的試驗(yàn)波形，試驗(yàn)完成后再交由計(jì)算機(jī)進(jìn)行后期處理和解讀以獲取破片速度等參數(shù)。但隨著軍事科技的日
- 關(guān)鍵字： FPGA ARM 靶場(chǎng)破片測(cè)速 系統(tǒng)
Altera發(fā)布最新版Quartus II開(kāi)發(fā)軟件
- Altera公司(Nasdaq: ALTR)日前發(fā)布業(yè)界成熟可靠的最新版Quartus? II開(kāi)發(fā)軟件——對(duì)于FPGA設(shè)計(jì)，性能和效能在業(yè)界首屈一指的軟件。Quartus II軟件12.0版進(jìn)一步提高了用戶的效能和性能優(yōu)勢(shì)，例如，對(duì)于高性能28-nm設(shè)計(jì)，編譯時(shí)間縮短了4倍。其他更新包括擴(kuò)展28-nm器件支持，初次支持Altera SoC FPGA，增強(qiáng)Qsys系統(tǒng)集成和DSP Builder工具，以及經(jīng)過(guò)改進(jìn)的知識(shí)產(chǎn)權(quán)(IP)內(nèi)核等。
- 關(guān)鍵字： Altera FPGA Quartus
Xilinx攜手科通啟動(dòng)Zynq-7000 EPP全國(guó)6地巡回專(zhuān)題研討會(huì)
- 自賽靈思Zynq?-7000 EPP系列平臺(tái)發(fā)布以來(lái)，其強(qiáng)大靈活的處理能力便受到廣大嵌入式工程師的矚目，為了早日將這一創(chuàng)新產(chǎn)品引入本土設(shè)計(jì)，科通集團(tuán)現(xiàn)正式宣布聯(lián)手All Programmable技術(shù)和器件的全球領(lǐng)先企業(yè)賽靈思公司(Xilinx, Inc. (NASDAQ:XLNX)聯(lián)合宣布將在全國(guó)六大城市舉辦“2012年賽靈思&科通全球首款可擴(kuò)展處理平臺(tái)—Zynq?-7000系列專(zhuān)題研討會(huì)”。6月 19日該研討會(huì)將從武漢拉開(kāi)帷幕，之后覆蓋上海、北京、成都、深圳、廣州。
- 關(guān)鍵字： 賽靈思 FPGA Zynq-7000
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