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Achronix以創(chuàng)新FPGA技術(shù)推動智能汽車與先進出行創(chuàng)新
- 全球領(lǐng)先的高性能現(xiàn)場可編程門陣列（FPGA）和嵌入式FPGA（eFPGA）半導(dǎo)體知識產(chǎn)權(quán)（IP）提供商Achronix Semiconductor公司宣布，該公司參加了由私募股權(quán)和風(fēng)險投資公司Baird Capital舉辦的“Baird車技術(shù)與出行大會（Baird Vehicle Technology & Mobility Conference）”。Achronix此舉是為了聯(lián)絡(luò)更多的創(chuàng)新者和投資者，共同推動更加先進的FPGA技術(shù)更廣泛地應(yīng)用于智能汽車、自動駕駛、ADAS和其他先進出行方式。Bai
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英特爾成立獨立FPGA公司Altera
- 3月1日，英特爾宣布，成立全新的FPGA（現(xiàn)場可編程門陣列）半導(dǎo)體公司Altera，并計劃在未來兩到三年內(nèi)為Altera進行股票發(fā)行。據(jù)了解，2015年，英特爾斥資167億美元收購Altera，也是迄今為止該公司最大額的并購交易。Altera將致力于提供端到端的FPGA解決方案、易于使用的AI以及軟件工具，同時也加強了供應(yīng)鏈的韌性，以在FPGA市場繼續(xù)保持領(lǐng)先地位。英特爾表示，Altera的產(chǎn)品組合將更加多元化，包含業(yè)界唯一內(nèi)置AI能力的FPGA。Altera FPGA在云端運算、數(shù)據(jù)中心、工業(yè)自動化、通
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芯原業(yè)界領(lǐng)先的嵌入式GPU IP賦能先楫高性能的HPM6800系列RISC-V MCU
- 2024年3月4日，中國上海——芯原股份（芯原，股票代碼：688521.SH）今日宣布先楫半導(dǎo)體（簡稱“先楫”）的HPM6800系列新一代數(shù)字儀表顯示及人機界面系統(tǒng)應(yīng)用平臺采用了芯原的高性能2.5D圖形處理器（GPU）IP。HPM6800系列產(chǎn)品基于RISC-V CPU內(nèi)核，具備高算力、低功耗、高集成度和出色的多媒體功能，適用于汽車儀表、人機交互界面（HMI），以及電子后視鏡（CMS）等需要復(fù)雜圖形處理、高分辨率顯示和高性能多媒體用戶界面的應(yīng)用。 芯原支持OpenVG的2.5D GPU IP能夠
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半導(dǎo)體公司如何填補不斷擴大的人才缺口
- 半導(dǎo)體行業(yè)正處于一場高風(fēng)險競賽的中心，人們普遍認(rèn)識到芯片將是下一波增長和創(chuàng)新的引擎。從韓國到德國再到美國，公司紛紛宣布了大規(guī)模新工廠的計劃?？傆?，從2023年到2030年，預(yù)計將有近1萬億美元的投資。這場全球擴張的狂潮可能會重新塑造這個行業(yè)，并在全球范圍內(nèi)分散力量平衡。然而，制造能力只是方程式的一部分。在這個不斷發(fā)展的行業(yè)中，人才將是方程式的關(guān)鍵組成部分。公司必須確保他們能夠吸引和留住足夠的人才，以確保新建工廠在開始生產(chǎn)時能夠全力運轉(zhuǎn)。我們先前已經(jīng)指出了半導(dǎo)體公司在吸引和留住人才方面面臨的挑戰(zhàn)。然而，有太
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英特爾宣布成立全新獨立運營的FPGA公司——Altera
- 今天，英特爾宣布成立全新獨立運營的FPGA公司——Altera。在FPGA Vision線上研討會期間，首席執(zhí)行官Sandra Rivera和首席運營官Shannon Poulin進行了分享，展示其在超過550億美元的市場中保持領(lǐng)先性的戰(zhàn)略規(guī)劃，強調(diào)將通過打造集成AI功能的FPGA等舉措，進一步豐富公司的產(chǎn)品組合，同時亦表明將持續(xù)助力客戶應(yīng)對不斷增加的挑戰(zhàn)。會上，Altera也作為新公司的品牌正式對外公布。Altera首席執(zhí)行官Sandra Rivera表示，“現(xiàn)階段，客戶正面臨日益復(fù)雜的技術(shù)挑戰(zhàn)，而我們
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CPLD/FPGA 內(nèi)部結(jié)構(gòu)與原理
- 可編程邏輯器件（Programmable Logic Device，PLD）起源于20世紀(jì)70年代，是在專用集成電路（ASIC）的基礎(chǔ)上發(fā)展起來的一種新型邏輯器件，是當(dāng)今數(shù)字系統(tǒng)設(shè)計的主要硬件平臺，其主要特點就是完全由用戶通過軟件進行配置和編程，從而完成某種特定的功能，且可以反復(fù)擦寫。在修改和升級PLD時，不需額外地改變PCB電路板，只是在計算機上修改和更新程序，使硬件設(shè)計工作成為軟件開發(fā)工作，縮短了系統(tǒng)設(shè)計的周期，提高了實現(xiàn)的靈活性并降低了成本，因此獲得了廣大硬件工程師的青睞，形成了巨大的PLD產(chǎn)業(yè)規(guī)模
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SPI協(xié)議，MCP2515裸機驅(qū)動詳解，收藏吧用得著
- SPI概述Serial Peripheral interface 通用串行外圍設(shè)備接口是Motorola首先在其MC68HCXX系列處理器上定義的。SPI接口主要應(yīng)用在 EEPROM，F(xiàn)LASH，實時時鐘，AD轉(zhuǎn)換器，還有數(shù)字信號處理器和數(shù)字信號解碼器之間。SPI，是一種高速的，全雙工，同步的通信總線，并且在芯片的管腳上只占用四根線，節(jié)約了芯片的管腳，同時為PCB的布局上節(jié)省空間。SPI特點采用主-從模式(Master-Slave) 的控制方式SPI 規(guī)定了兩個 SPI 設(shè)備之間通信必須由主設(shè)備 (Mas
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ESP32的功耗如何降低？
- ESP32 是一款集成了 Wi-Fi 和藍(lán)牙功能的低功耗芯片，它可以根據(jù)不同的工作模式和配置選項來調(diào)節(jié)其功耗。根據(jù)我搜索到的信息ESP32 功耗的要點：ESP32 提供了五種可配置的電源模式，分別是活動模式、調(diào)制解調(diào)器睡眠模式、淺睡眠模式、深度睡眠模式和休眠模式。每種電源模式都有其獨特的功能和節(jié)能特性，例如在深度睡眠模式下，ESP32 的功耗可以降低到約 0.15 mA1，而在休眠模式下，ESP32 的功耗可以降低到約 2.5 μA。ESP32 的功耗還受到其時鐘源、CPU 主頻、外圍設(shè)備、Wi-Fi 和
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淺談因電遷移引發(fā)的半導(dǎo)體失效
- 前言半導(dǎo)體產(chǎn)品老化是一個自然現(xiàn)象，在電子應(yīng)用中，基于環(huán)境、自然等因素，半導(dǎo)體在經(jīng)過一段時間連續(xù)工作之后，其功能會逐漸喪失，這被稱為功能失效。半導(dǎo)體功能失效主要包括：腐蝕、載流子注入、電遷移等。其中，電遷移引發(fā)的失效機理最為突出。技術(shù)型授權(quán)代理商Excelpoint世健的工程師Wolfe Yu在此對這一現(xiàn)象進行了分析。?1、?背景從20世紀(jì)初期第一個電子管誕生以來，電子產(chǎn)品與人類的聯(lián)系越來越緊密，特別是進入21世紀(jì)以來，隨著集成電路的飛速發(fā)展，人們對電子產(chǎn)品的需求也變得愈加豐富。隨著電子
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2024年FPGA將如何影響AI？
- 隨著新一年的到來，科技界有一個話題似乎難以避開：人工智能。事實上，各家公司對于人工智能談?wù)摰萌绱酥啵瑳]有熱度才不正常！在半導(dǎo)體領(lǐng)域，大部分對于AI的關(guān)注都集中在GPU或?qū)Ｓ肁I加速器芯片（如NPU和TPU）上。但事實證明，有相當(dāng)多的組件可以直接影響甚至運行AI工作負(fù)載。FPGA就是其中之一。對于那些了解FPGA靈活性和可編程性的人來說，這并不令人驚訝，但對許多其他人來說，這兩者之間的聯(lián)系可能并不明顯。問題的關(guān)鍵在于通過軟件讓一些經(jīng)典的AI開發(fā)工具（如卷積神經(jīng)網(wǎng)絡(luò)（CNN））針對FPGA支持的可定制電路設(shè)
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Verilog HDL基礎(chǔ)知識9之代碼規(guī)范示例
- 2.Verilog HDL 代碼規(guī)范 模板示例//******************************************************** // // Copyright(c)2016, ECBC // All rights reserved // // File name
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Verilog HDL基礎(chǔ)知識9之代碼規(guī)范
- 1.RTL CODE 規(guī)范1.1標(biāo)準(zhǔn)的文件頭在每一個版塊的開頭一定要使用統(tǒng)一的文件頭，其中包括作者名，模塊名，創(chuàng)建日期，概要，更改記錄，版權(quán)等必要信息。 統(tǒng)一使用以下的文件頭：其中*為必需的項目//******************************************************** // // Copyright(c)2016, ECBC // All rights&nbs
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詳解CPLD/FPGA架構(gòu)與原理
- 可編程邏輯器件（Programmable Logic Device，PLD）起源于20世紀(jì)70年代，是在專用集成電路（ASIC）的基礎(chǔ)上發(fā)展起來的一種新型邏輯器件，是當(dāng)今數(shù)字系統(tǒng)設(shè)計的主要硬件平臺，其主要特點就是完全由用戶通過軟件進行配置和編程，從而完成某種特定的功能，且可以反復(fù)擦寫。在修改和升級PLD時，不需額外地改變PCB電路板，只是在計算機上修改和更新程序，使硬件設(shè)計工作成為軟件開發(fā)工作，縮短了系統(tǒng)設(shè)計的周期，提高了實現(xiàn)的靈活性并降低了成本，因此獲得了廣大硬件工程師的青睞，形成了巨大的PLD產(chǎn)業(yè)規(guī)模
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MCX A：新的通用MCU和資源豐富的FRDM開發(fā)平臺
- 恩智浦正式發(fā)布MCX A14x和A15x系列“通用”微控制器。MCX A隸屬于MCX產(chǎn)品組合，基于Arm? Cortex?-M33內(nèi)核平臺。MCX的理念是將主流恩智浦器件的卓越特色與創(chuàng)新功能結(jié)合起來，打造下一代智能邊緣設(shè)備。可擴展性是MCX產(chǎn)品組合的一個重要優(yōu)勢。MCX A系列在該產(chǎn)品組合中發(fā)揮著重要作用，是各類應(yīng)用的基礎(chǔ)。它面向多個市場的廣泛應(yīng)用，包括：? 工業(yè)通信? 智能計量? 自動化與控制? 傳感器?&n
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Verilog HDL基礎(chǔ)知識8之綜合語句
- 可綜合語句1.要保證Verilog HDL賦值語句的可綜合性，在建模時應(yīng)注意以下要點：2.不使用initial。3.不使用#10。4.不使用循環(huán)次數(shù)不確定的循環(huán)語句，如forever、while等。5.不使用用戶自定義原語（UDP元件）。6.盡量使用同步方式設(shè)計電路。7.除非是關(guān)鍵路徑的設(shè)計，一般不采用調(diào)用門級元件來描述設(shè)計的方法，建議采用行為語句來完成設(shè)計。8.用always過程塊描述組合邏輯，應(yīng)在敏感信號列表中列出所有的輸入信號。9.所有的內(nèi)部寄存器都應(yīng)該能夠被復(fù)位，在使用FPGA實現(xiàn)設(shè)計時，應(yīng)盡量使
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