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借助SC Express減少結(jié)構(gòu)化測(cè)試次數(shù)

對(duì)飛機(jī)、火車、軍用車輛和土建結(jié)構(gòu)等大型復(fù)雜的結(jié)構(gòu)進(jìn)行測(cè)試對(duì)于確保這些結(jié)構(gòu)的安全性和高性能至關(guān)重要。這些測(cè)試通常是生產(chǎn)的一大難題。要確保設(shè)計(jì)按時(shí)間進(jìn)度進(jìn)行，必須正確配置和執(zhí)行測(cè)試，且數(shù)據(jù)采集系統(tǒng)提供的數(shù)據(jù)對(duì)設(shè)計(jì)團(tuán)隊(duì)來說精確、可靠和及時(shí)。
關(guān)鍵字： NI 結(jié)構(gòu)化測(cè)試 Express

應(yīng)用領(lǐng)域：石油工業(yè)、石油管工程、重型試驗(yàn)機(jī)、集中式控制與數(shù)據(jù)采集挑戰(zhàn)：石油管復(fù)合擠毀試驗(yàn)機(jī)用于對(duì)油管和套管施加軸向載荷(拉伸或壓縮)、側(cè)向彎曲、外壓及內(nèi)壓，模擬石油管柱在井下所受復(fù)合載荷工況。該設(shè)備載荷
關(guān)鍵字：復(fù)合試驗(yàn)機(jī) 控制石油管平臺(tái) NI PXI Express 基于

PCI-EXPRESS能為我們帶來什么好處呢?前面的3DMARK03和3DMARK05似乎在告訴我們,現(xiàn)階段的PCI-EXPRESS在個(gè)人電...
關(guān)鍵字： PCIE AGP總線圖形性能測(cè)試

引言近年來軟件無線電(SDR)得到了飛速的發(fā)展，在很多領(lǐng)域已顯示出其優(yōu)越性。本文的項(xiàng)目背景是通過軟件無線電方式實(shí)現(xiàn)數(shù)字音頻廣播(DAB)的基帶信號(hào)處理，這要求軟件無線電平臺(tái)具有高速實(shí)時(shí)數(shù)字信號(hào)處理與傳輸能力。高
關(guān)鍵字： Virtex FPGA PCIe 模式

隨著計(jì)算機(jī)技術(shù)的發(fā)展，以及大數(shù)據(jù)量交互的需要，硬件系統(tǒng)對(duì)PC總線傳輸速率、數(shù)據(jù)完整性提出了越來越高的應(yīng)用要求。傳統(tǒng)的PCI總線技術(shù)雖然經(jīng)過不斷的改進(jìn)，開發(fā)出64b，66MHz的并行協(xié)議PCI-X標(biāo)準(zhǔn)，但由于并行總線整體
關(guān)鍵字： Express Virtex PCI 高速采集

艾默生網(wǎng)絡(luò)能源(Emerson Network Power)是艾默生集團(tuán)(紐約證券交易所代號(hào)：EMR)的其中一個(gè)業(yè)務(wù)部門，這家在關(guān)鍵業(yè)務(wù)全保障(Business-Critical ContinuityTM)技術(shù)方面全球領(lǐng)先的公司宣布，客戶只需在其媒體服務(wù)器上添加其全新的媒體處理加速卡，就可以將系統(tǒng)的媒體處理性能提升至一個(gè)全新的高度。
關(guān)鍵字：艾默生嵌入式 PCIE-8120

引言　　近年來軟件無線電（SDR）得到了飛速的發(fā)展，在很多領(lǐng)域已顯示出其優(yōu)越性。本文的項(xiàng)目背景是通過軟件無線電方式實(shí)現(xiàn)數(shù)字音頻廣播（DAB）的基帶信號(hào)處理，這要求軟件無線電平臺(tái)具有高速實(shí)時(shí)數(shù)字信號(hào)處理與傳輸
關(guān)鍵字： Express FPGA PCI 模式

摘要：稱為第3代I／O接口技術(shù)的PCI Express總線規(guī)范的出現(xiàn)，從結(jié)構(gòu)上解決了帶寬不足的問題，有著極為廣闊的發(fā)展前景?；赩erilog HDL硬件描述語言及可綜合化設(shè)計(jì)理念，完成了PCI Express IP核RTL代碼的設(shè)計(jì)。IP核代
關(guān)鍵字： Express PCI 協(xié)議

一、接收機(jī)測(cè)試及環(huán)回工作模式（Loopback ）隨著信號(hào)速率的不斷提升，只對(duì)高速信號(hào)的發(fā)送端物理層測(cè)試已經(jīng)不能夠完全反應(yīng)系統(tǒng)的特性，因此接收機(jī)測(cè)試也已成為了高速信號(hào)的必測(cè)項(xiàng)目，尤其是對(duì)于信號(hào)速率高于5Gbps 以
關(guān)鍵字： PCIE 3.0 接收機(jī) 測(cè)試方案

一、PCIE 3.0中使用的動(dòng)態(tài)均衡概念因?yàn)镻CIE 3.0信號(hào)的速率可以達(dá)到8Gb/s，而且鏈路通道走線也可能會(huì)很長(zhǎng)，這可能會(huì)導(dǎo)致高速信號(hào)衰減過大，在接收端無法得到張開的眼圖。因此在PCIE 3.0的Tx和Rx端均使用了均衡設(shè)置，以
關(guān)鍵字： PCIE 3.0 動(dòng)態(tài)均衡測(cè)試

一、PCIE 3.0與 PCIE 2.0PCIE 3.0相對(duì)于它的前一代PCIE 2.0的最主要的一個(gè)區(qū)別是速率由5GT/s提升到了8GT/s。為了保證數(shù)據(jù)傳輸密度和直流平衡以及時(shí)鐘恢復(fù)，PCIE 2.0中使用了8B/10B編碼，即將每8位有效數(shù)據(jù)編碼為10位
關(guān)鍵字： PCIE 3.0 發(fā)射機(jī) 物理層測(cè)試

新漢目前已成功推出COM Express設(shè)計(jì)項(xiàng)目，該COM-E項(xiàng)目的成功實(shí)施很大程度上了得力于專業(yè)的技術(shù)支持。在整個(gè)開發(fā)周期階段，新漢COM技術(shù)服務(wù)中心(CCC)提供的一系列開發(fā)工具包和專業(yè)的技術(shù)支持，使每一項(xiàng)設(shè)計(jì)都勝券在握。
關(guān)鍵字：新漢 COM Express

　　在嵌入式設(shè)計(jì)中，RapidIO是一個(gè)重要的、并得到廣泛應(yīng)用的接口標(biāo)準(zhǔn)。帶著對(duì)RapidIO的技術(shù)本身及其未來前景的疑問，筆者借RTA年會(huì)的機(jī)會(huì)專訪了據(jù)RapidIO行業(yè)協(xié)會(huì)創(chuàng)始人兼執(zhí)行董事Sam Fuller先生。 RapidIO行業(yè)協(xié)會(huì)創(chuàng)始人兼執(zhí)行董事Sam Fuller先生　　RapidIO行業(yè)協(xié)會(huì)誕生于2000年，其主要目標(biāo)是為嵌入式系統(tǒng)開發(fā)可靠的、高性能、基于包交換的互連技術(shù)，2001年正式發(fā)表了第一代RapidIO基本規(guī)范，到現(xiàn)在已發(fā)布RapidIO 2.2正式規(guī)范，第三的規(guī)范
關(guān)鍵字： RapidIO IDT PCIe