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集成式比特誤碼率測(cè)試儀在FPGA中的應(yīng)用
- 隨著高速數(shù)字系統(tǒng)的發(fā)展，高速串行數(shù)據(jù)被廣泛使用，內(nèi)嵌高速串行接口的FPGA也得到大量應(yīng)用，相應(yīng)的高速串行信號(hào)質(zhì)量的測(cè)試也越來越頻繁和重要。通常用示波器觀察信號(hào)波形、眼圖、抖動(dòng)來衡量信號(hào)的質(zhì)量，Xilinx提供的
- 關(guān)鍵字： FPGA 集成式 比特 誤碼率測(cè)試儀
基于FPGA的TCP／IP通信協(xié)議與Matlab通信系統(tǒng)的研究
- O 引言 近年來，隨著信息技術(shù)的發(fā)展，網(wǎng)絡(luò)化日加普遍，以太網(wǎng)被廣泛應(yīng)用到各個(gè)領(lǐng)域。例如在數(shù)據(jù)采集領(lǐng)域，一些小型監(jiān)測(cè)設(shè)備需要增加網(wǎng)絡(luò)實(shí)現(xiàn)遠(yuǎn)程數(shù)據(jù)傳輸?shù)墓δ?，只要那些設(shè)備上增加一個(gè)網(wǎng)絡(luò)接口并實(shí)現(xiàn)了TCP／IP協(xié)
- 關(guān)鍵字： 通信 Matlab 系統(tǒng) 研究 協(xié)議 基于 TCP IP FPGA
基于FPGA的DDS基本信號(hào)發(fā)生器的設(shè)計(jì)
- 摘要：本設(shè)計(jì)基于DDS原理和FPGA技術(shù)按照順序存儲(chǔ)方式，將對(duì)正弦波、方波、三角波、鋸齒波四種波形的取樣數(shù)據(jù)依次全部存儲(chǔ)在ROM波形表里，通過外接設(shè)備撥扭開關(guān)和鍵盤控制所需波形信號(hào)的輸出，最終將波形信息顯示在LC
- 關(guān)鍵字： FPGA DDS 信號(hào)發(fā)生器
便攜式測(cè)試設(shè)備的FPGA設(shè)計(jì)
- 過去，TMOEM設(shè)計(jì)的儀器都是根據(jù)某種標(biāo)準(zhǔn)完成測(cè)試過程。這樣，當(dāng)一個(gè)新的標(biāo)準(zhǔn)或修訂后的標(biāo)準(zhǔn)發(fā)布出來時(shí)，他...
- 關(guān)鍵字： 便攜式 測(cè)試設(shè)備 FPGA
基于FPGA核心的數(shù)字化儀模塊設(shè)計(jì)
- PXI總線是NI公司在計(jì)算機(jī)外設(shè)總線PCI的基礎(chǔ)上實(shí)現(xiàn)的新一代儀器總線，已經(jīng)成為業(yè)界開放式總線的標(biāo)準(zhǔn)，基于PXI總線的數(shù)字化儀模塊是現(xiàn)代測(cè) 試系統(tǒng)中重要的一種數(shù)據(jù)記錄與處理設(shè)備。設(shè)計(jì)一個(gè)雙通道12 bit/250 MHz采樣頻
- 關(guān)鍵字： FPGA 核心 數(shù)字化儀 模塊設(shè)計(jì)
基于FPGA的星載計(jì)算機(jī)自檢EDAC電路設(shè)計(jì)
- 摘要：為了消除空間環(huán)境中單粒子翻轉(zhuǎn)(SEU)的影響,目前星載計(jì)算機(jī)中均對(duì)RAM存儲(chǔ)單元采用檢錯(cuò)糾錯(cuò)(EDAC)設(shè)計(jì)。隨著FPGA在航天領(lǐng)域的廣泛應(yīng)用,FPGA已成為EDAC功能實(shí)現(xiàn)的最佳硬件手段。本文介紹了EDAC的編碼和實(shí)現(xiàn),提出一
- 關(guān)鍵字： FPGA EDAC 星載 計(jì)算機(jī)
基于FPGA 的UART 擴(kuò)展總線設(shè)計(jì)和應(yīng)用
- 摘要：現(xiàn)在嵌入式系統(tǒng)的功能越來越集合化,需要控制大量外設(shè)。外設(shè)模塊普遍采用UART作為通信接口,但是通常處理器都會(huì)自帶一個(gè)UART串口。實(shí)際應(yīng)用中一個(gè)串口往往不夠用,需要對(duì)系統(tǒng)進(jìn)行擴(kuò)展。本文所介紹的就是以FPGA為實(shí)
- 關(guān)鍵字： FPGA UART 總線設(shè)計(jì)
基于FPGA的高精度時(shí)差測(cè)量系統(tǒng)設(shè)計(jì)
- 摘要：在時(shí)差定位(TDOA)技術(shù)中，高精度的時(shí)差測(cè)量是準(zhǔn)確定位的關(guān)鍵。針對(duì)這一需要， 提出一種基于FPGA 的高精度時(shí)差測(cè)量系統(tǒng)的實(shí)現(xiàn)方案。本系統(tǒng)的時(shí)差測(cè)算單元以Altera 公司Cyclone 系列的EP1C3T144 芯片為核心，并提
- 關(guān)鍵字： FPGA 高精度 時(shí)差測(cè)量 系統(tǒng)設(shè)計(jì)
基于FPGA的軟件無線電平臺(tái)設(shè)計(jì)
- 0 引 言軟件無線電的出現(xiàn)，是無線電通信從模擬到數(shù)字、從固定到移動(dòng)后，由硬件到軟件的第三次變革。簡單地說，軟件無線電就是一種基于通用硬件平臺(tái)，并通過軟件可提供多種服務(wù)的、適應(yīng)多種標(biāo)準(zhǔn)的、多頻帶多模式的、可
- 關(guān)鍵字： FPGA 軟件無線電 平臺(tái)設(shè)計(jì)
基于EDA 技術(shù)（FPGA）的自動(dòng)門控制系統(tǒng)設(shè)計(jì)
- 引 言門和人類文明是孿生的，它伴隨著人類文明的發(fā)展而躍動(dòng)。21 世紀(jì)的今天，門更加突出了安全理念，強(qiáng)調(diào)了有效性：有效地防范、通行、疏散，同時(shí)還突出了建筑藝術(shù)的理念，強(qiáng)調(diào)門與建筑以及周圍環(huán)境整體的協(xié)調(diào)、和諧
- 關(guān)鍵字： FPGA EDA 自動(dòng)門 控制系統(tǒng)設(shè)計(jì)
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