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Altera通過早期使用計劃，讓客戶提前了解面向FPGA的OpenCL效能優(yōu)勢
- Altera公司(NASDAQ: ALTR)今天發(fā)布其面向FPGA的OpenCL (開放計算語言)早期使用計劃(EAP)，支持客戶提前了解Altera面向FPGA的OpenCL解決方案。采用這一開放標準，設(shè)計團隊可以在高級C語言框架中面向FPGA設(shè)計他們自己的系統(tǒng)和算法，大大簡化了FPGA的開發(fā)。作為EAP計劃的一部分，客戶能夠預(yù)先了解Altera的OpenCL解決方案，參加面向FPGA的OpenCL培訓(xùn)課程，獲得相關(guān)資料，觀看其技術(shù)演示。 OpenCL是一種開放編程標準，能夠跨CPU、GPU和
- 關(guān)鍵字： Altera FPGA OpenCL
基于FPGA嵌入式系統(tǒng)的雷達信號模擬器設(shè)計
- 摘 要： 結(jié)合FPGA嵌入式系統(tǒng)具有硬件電路高并行度和軟件編程控制簡單的特點，設(shè)計了一套基于FPGA嵌入式系統(tǒng)的雷達信號模擬器，能夠完成雷達中頻和視頻信號、雜波和干擾信號的模擬，實現(xiàn)雷達系統(tǒng)在不具備實際接收前端
- 關(guān)鍵字： FPGA 嵌入式系統(tǒng) 雷達 信號模擬器
基于FPGA在彈上信息處理機中的應(yīng)用
- 引言信息處理機(圖1)用于完成導(dǎo)彈上多路遙測信息的采集、處理、組包發(fā)送。主要功能包括高速1553B總線的數(shù)據(jù)收發(fā) 、422接口設(shè)備的數(shù)據(jù)加載與檢測、多路數(shù)據(jù)融合和數(shù)據(jù)接收、處理、組包發(fā)送的功能。其中，總線數(shù)據(jù)和其
- 關(guān)鍵字： FPGA 信息處理 中的應(yīng)用
基于Spartan-3 FPGA的視頻采集系統(tǒng)設(shè)計
- 引言視頻采集的主流實現(xiàn)方案有兩種：一是基于ASIC，該方案一般采用意法、AMD等公司的專用視頻處理芯片；二是基于DSP，主要采用TI、ADI等公司的DSP信號處理器。它們作為輔處理器，可在主CPU控制下進行視頻信號的采集壓
- 關(guān)鍵字： Spartan FPGA 視頻采集 系統(tǒng)設(shè)計
基于FPGA的數(shù)字中頻接收和恢復(fù)系統(tǒng)設(shè)計
- 摘要 介紹一種數(shù)字中頻恢復(fù)系統(tǒng)，該系統(tǒng)分為光纖接收單元、FPGA核心單元和QDUC單元。光纖接收單元采用高速串行器／解串器TLK1501，完成高速串行數(shù)據(jù)的串行轉(zhuǎn)換。FPGA核心單元對數(shù)據(jù)進行解碼、檢驗、配置TLK1501和AD9
- 關(guān)鍵字： FPGA 數(shù)字中頻 恢復(fù)系統(tǒng)
IBERT在FPGA中的應(yīng)用
- 摘要 IBERT即集成式比特誤碼率測試儀，是Xilinx專門用于具有高速串行接口的FPGA芯片的調(diào)試和交互式配置工具。文中介紹了IBTERT基本功能、實現(xiàn)原理，并結(jié)合實例闡述用IBTERT調(diào)試FPGA時的具體方法和調(diào)試步驟。
關(guān)鍵詞 - 關(guān)鍵字： IBERT FPGA 中的應(yīng)用
基于FPGA的數(shù)據(jù)嵌入式圖像采集系統(tǒng)
- 摘要 介紹了以FPGA為核心的邏輯控制模塊的數(shù)據(jù)采集系統(tǒng)的設(shè)計可以滿足實時性要求，設(shè)計中采用自頂向下的設(shè)計方法，根據(jù)不同的功能將整個系統(tǒng)劃分為若干模塊進行設(shè)計，并介紹了每個模塊的功能和實現(xiàn)方法。在設(shè)計中采用
- 關(guān)鍵字： FPGA 數(shù)據(jù) 嵌入式 圖像采集系統(tǒng)
NI基于FPGA的控制系統(tǒng)為智能電網(wǎng)電力電子系統(tǒng)帶來革新
- .NISingle-BoardRIO通用逆變器控制器(GeneralPurposeInverterController,GPIC)提供個了一個革命性...
- 關(guān)鍵字： FPGA NI 智能電網(wǎng)電力電子
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