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基于ARM的可定制MCU可替代FPGA
- 關(guān)鍵字： ARM FPGA MPCF技術(shù) 控制器
基于FPGA的數(shù)據(jù)中繼器設(shè)計
- 1前言高速以太網(wǎng)可以滿足新的容量需求，解決了低帶寬接入、高帶寬傳輸?shù)钠款i問題，擴(kuò)大了應(yīng)用范圍，并...
- 關(guān)鍵字： FPGA 數(shù)據(jù)中繼器
FPGA需求大幅增長
- 幾乎每一家分析研究公司都毫無例外的預(yù)測FPGA市場2011年以及未來會有較大的增長，例如，IMS研究公司預(yù)測2014年年度收益達(dá)到10億美元以上，IBS有限公司聲稱，F(xiàn)PGA解決方案日益完善，功能越來越強(qiáng)，2015年，其增長率要超過IC市場。2009年全年增長率在60%到65%之間，遠(yuǎn)遠(yuǎn)超出了半導(dǎo)體行業(yè)最初的預(yù)測。繼40 nm產(chǎn)品大獲成功之后，Altera所有產(chǎn)品在2010年的收益都有顯著增長，我們預(yù)計今后會繼續(xù)增長。
- 關(guān)鍵字： FPGA 3G LTE
基于DS28E01的FPGA加密認(rèn)證系統(tǒng)的設(shè)計
- 在現(xiàn)在電子設(shè)計的成本越來越高的情況下，基于 SRAM的 FPGA由于自身限制，容易使得設(shè)計者的設(shè)計被復(fù)制，從而給設(shè)計者提出了設(shè)計具有加密功能的電子系統(tǒng)，由于 SHA-1 算法引擎的 DS28E01芯片作為加密認(rèn)證系統(tǒng)的核心芯片，并利用 DS28E01針對 Xilinx公司的 X3CS500E開發(fā)了實際的加密認(rèn)證系統(tǒng)，并將此系統(tǒng)應(yīng)用于實際的產(chǎn)品中，取得了良好的效果?！ ?br />
- 關(guān)鍵字： FPGA 28E E01 DS
FPGA實現(xiàn)的任意波形發(fā)生器的設(shè)計
- 運用DDS原理，進(jìn)行任意波形發(fā)生器的設(shè)計，使得任意波形發(fā)生器兼顧DDS的優(yōu)點。設(shè)計中通過實現(xiàn)DDS模塊與單片機(jī)接口的控制部分將頻率控制字由單片輸入到輸入寄存器模塊，由相位累加器模塊對輸入頻率控制字進(jìn)行累加運算，輸出作為雙口RAM的讀地址線，讀數(shù)據(jù)線上即輸出了波形幅度量化數(shù)據(jù)。其中雙口RAM的內(nèi)容由單片機(jī)進(jìn)行更新，從而實現(xiàn)任意波形的發(fā)生。本設(shè)計中的相位累加器采用了8級流水線結(jié)構(gòu)借助前5級的超前進(jìn)位的方法，使得編譯的最高工作頻率由317．97MHz提高到336．7 MHz，實現(xiàn)了任意波形的發(fā)生，節(jié)約了成本，提
- 關(guān)鍵字： FPGA 任意波形發(fā)生器
面向?qū)ΨQ體系結(jié)構(gòu)的FPGA仿真模型研究
- 緩慢的軟件模擬器給體系結(jié)構(gòu)研究帶來了極大不便，F(xiàn)PGA硬件仿真的模擬速度很快，但仿真系統(tǒng)的規(guī)模嚴(yán)重受限于FPGA的容量。較大規(guī)模的體系結(jié)構(gòu)系統(tǒng)仿真采用多片F(xiàn)PGA互連，不僅增加了設(shè)計的復(fù)雜性，也增加成本。因此提出一種面向?qū)ΨQ體系結(jié)構(gòu)的FPGA仿真模型。經(jīng)仿真系統(tǒng)評估，其仿真系統(tǒng)能夠增大FPGA芯片的仿真規(guī)模，減少仿真系統(tǒng)對FPGA資源的需求，有效支持在有限的FPGA資源上進(jìn)行大規(guī)模對稱體系結(jié)構(gòu)仿真研究。
- 關(guān)鍵字： FPGA 對稱 仿真 模型研究
基于FPGA+DSP技術(shù)的Bayer格式圖像預(yù)處理
- 提出一種針對CMOS圖像傳感器采集的Bayer格式圖像預(yù)處理系統(tǒng)，與傳統(tǒng)的DSP圖像處理系統(tǒng)相比，該系統(tǒng)利用Spartan-3系列的XC3S1 500和TMS320DM642型DSP相結(jié)合實現(xiàn)圖像捕獲、圖像預(yù)處理等功能，采用支持USB2．O的CY7C68013將圖像信息傳送給上位機(jī)。在FPGA中采用雙線性插值法將CMOS圖像傳感器采集的Bayer格式圖像數(shù)據(jù)轉(zhuǎn)換為RGB格式圖像數(shù)據(jù)，并轉(zhuǎn)換成Y亮度信號。實驗結(jié)果表明，該系統(tǒng)能處理分辨率達(dá)500萬像素的Bayer圖像，并最終以20 Mb／s的帶寬將亮度信號傳
- 關(guān)鍵字： Bayer FPGA DSP 圖像預(yù)處理
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