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          一種新的混沌RNG的實現(xiàn)方案及FPGA實現(xiàn)

          • 一種新的混沌RNG的實現(xiàn)方案及FPGA實現(xiàn),在SoC(System on Chip)廣泛應用的今天,如何設計一個基于Ic的RiNG就成為安全通信應用的急切需要。隨機噪聲源(如熱噪聲和發(fā)射噪聲)存在于IC中卻總是被人為地屏蔽掉了。因此,利用電路噪聲放大的商用RNG設計需要專門的
          • 關鍵字: 實現(xiàn)  FPGA  方案  混沌  RNG  

          基于FPGA的雷達數(shù)字脈沖壓縮技術

          • 基于FPGA的雷達數(shù)字脈沖壓縮技術,脈沖壓縮技術是指對雷達發(fā)射的寬脈沖信號進行調(diào)制(如線性調(diào)頻、非線性調(diào)頻、相位編碼),并在接收端對回波寬脈沖信號進行脈沖壓縮處理后得到窄脈沖的實現(xiàn)過程。脈沖壓縮有效地解決了雷達作用距離與距離分辨率之間的矛
          • 關鍵字: 壓縮  技術  脈沖  數(shù)字  FPGA  雷達  基于  

          System C特點及FPGA設計

          • System C特點及FPGA設計,一、概述   

            SYSTEM C 是由 Synospy Inc. 提出的,目前最新的版本為V2.0。它提出的目的就是以一種系統(tǒng)設計的思想進行系統(tǒng)設計。它將軟件算法與硬件實現(xiàn)很好的結合在一起,提高了整個系統(tǒng)設計的效率和正確性。
          • 關鍵字: 設計  FPGA  特點  System  

          標準單元ASIC和FPGA的權衡及結構化ASIC

          • 標準單元ASIC和FPGA的權衡及結構化ASIC,多種制造FPGA的深亞微米工藝,如Xilinx公司最新Spartan-3系列產(chǎn)品采用的90納米工藝(參考文獻1),使每塊芯片上的門電路數(shù)量變得越來越大。如果您的設計使用FPGA的嵌入式存儲器陣列和擴散式模擬及數(shù)字功能模塊,如DL
          • 關鍵字: ASIC  結構化  權衡  FPGA  標準  單元  

          FPGA Editor應用技巧

          • FPGA Editor應用技巧,工程師在設計過程中,經(jīng)常需要一定的創(chuàng)造力(你不妨稱之為數(shù)字管道膠帶)才能夠保證設計的順利完成。過去8年時間里,我曾經(jīng)目睹許多優(yōu)秀工程師利用這一方法出色地完成了許多工作,而他們采用的最主要工具就是FPGA Ed
          • 關鍵字: 應用技巧  Editor  FPGA  

          Xilinx發(fā)布Spartan-6 FPGA和Virtex-6 FPGA DSP開發(fā)套件

          •   全球可編程平臺領導廠商賽靈思公司 (Xilinx, Inc. (NASDAQ:XLNX) )宣布推出三款新型開發(fā)套件,進一步提升數(shù)字信號處理開發(fā)人員的實力,幫助他們方便地應用 FPGA,進而實現(xiàn)最高信號處理性能,成本與功耗優(yōu)化,并通過協(xié)處理技術解決系統(tǒng)瓶頸。因為賽靈思目標設計平臺是與業(yè)界領先的分銷商、設計服務、工具和硬件合作伙伴密切合作推出的,因此,賽靈思DSP產(chǎn)品的新套件將可以為開發(fā)人員提供硬件、工具和參考設計,以確保打造出一款適合各種不同 DSP 應用的生產(chǎn)力高效的設計流程。   賽靈思平臺解決
          • 關鍵字: 賽靈思  FPGA  DSP  

          基于MATLAB在FPGA 算法上浮點定點轉(zhuǎn)換的實現(xiàn)

          • 基于MATLAB在FPGA 算法上浮點定點轉(zhuǎn)換的實現(xiàn),浮點定點轉(zhuǎn)換是在 FPGA 上實現(xiàn)算法時最困難的地方(圖 1)。雖然 MATLAB 是一種強大的運算開發(fā)工具,但其許多優(yōu)點卻在浮點定點轉(zhuǎn)換過程中被降低了。例如,由于定點算術中精度較低,新的數(shù)學誤差被引入算法。您必須重
          • 關鍵字: 定點  轉(zhuǎn)換  實現(xiàn)  浮點  算法  MATLAB  FPGA  基于  

          FPGA芯片EPXA10在圖像處理中的應用

          • FPGA芯片EPXA10在圖像處理中的應用, 本文所介紹的圖像驅(qū)動和處理系統(tǒng)正是應用了EPXA10的這些特點,充分發(fā)揮了FPGA邏輯控制實現(xiàn)簡單、對大量數(shù)據(jù)做簡單處理速度快的優(yōu)勢以及ARM軟件編程靈活的特點。
            1 內(nèi)嵌ARM核的FPGA芯片EPXA10及其主要特點
          • 關鍵字: 應用  圖像處理  EPXA10  芯片  FPGA  

          利用FPGA加密芯片的抗DPA攻擊電路設計

          • 利用FPGA加密芯片的抗DPA攻擊電路設計,0 引言
            近年來,現(xiàn)場可編程門陣列(Field Programmable Gate Array,F(xiàn)PGA)由于其高性能、低價格、高開發(fā)速度、方便的編程方式等特點得到了廣泛的應用。但對FPGA進行DPA(Differential Power Analysis,差分功耗分
          • 關鍵字: 攻擊  電路設計  DPA  芯片  FPGA  加密  利用  

          采用FPGA/MCU技術的光電式滾轉(zhuǎn)角測量儀的解決方案

          • 采用FPGA/MCU技術的光電式滾轉(zhuǎn)角測量儀的解決方案,本文設計基于FPGA/MCU的光電式滾轉(zhuǎn)角測量儀,安裝于實驗轉(zhuǎn)臺上,實時輸出滾轉(zhuǎn)角度值,為彈體的滾轉(zhuǎn)角測量提供對照基準,并可與上位機進行通信,將數(shù)據(jù)傳送到主機中進行后續(xù)處理?! ∠到y(tǒng)整體方案  滾轉(zhuǎn)角測量儀物
          • 關鍵字: 測量儀  解決方案  轉(zhuǎn)角  光電  FPGA/MCU  技術  采用  

          FPGA低功耗設計注意事項

          • FPGA低功耗設計注意事項,FPGA的功耗高度依賴于用戶的設計,沒有哪種單一的方法能夠?qū)崿F(xiàn)這種功耗的降低,如同其它多數(shù)事物一樣,降低功耗的設計就是一種協(xié)調(diào)和平衡藝術,在進行低功耗器件的設計時,人們必須仔細權衡性能、易用性、成本、密度
          • 關鍵字: 注意事項  設計  功耗  FPGA  

          基于FPGA和硬件描述語言Verilog的液晶顯示控制器的設計

          • 基于FPGA和硬件描述語言Verilog的液晶顯示控制器的設計,本設計是一種基于FPGA(現(xiàn)場可編程門陣列)的液晶顯示控制器。與集成電路控制器相比,F(xiàn)PGA更加靈活,可以針對小同的液晶顯示模塊更改時序信號和顯示數(shù)據(jù)。FPGA的集成度、復雜度和面積優(yōu)勢使得其日益成為一種頗具吸引力
          • 關鍵字: 液晶顯示  控制器  設計  Verilog  語言  FPGA  硬件  描述  基于  

          FPGA的低功耗設計分析

          • FPGA的低功耗設計分析,FPGA的功耗高度依賴于用戶的設計,沒有哪種單一的方法能夠?qū)崿F(xiàn)這種功耗的降低,在進行低功耗器件的設計時,人們必須仔細權衡性能、易用性、成本、密度以及功率等諸多指標。  盡管基于90nm工藝的FPGA的功耗已低于先
          • 關鍵字: 分析  設計  功耗  FPGA  

          基于Flash構架的模數(shù)混合的FPGA在心電監(jiān)控儀上的應用設計

          • 基于Flash構架的模數(shù)混合的FPGA在心電監(jiān)控儀上的應用設計,Fution系列的FPGA是世界上首個基于Flash構架的模數(shù)混合的FPGA,即在數(shù)字FPGA的基礎上加入了模擬電路部分,解決了傳統(tǒng)模擬電路和FPGA分離給設計帶來的諸多問題,降低了PCB板的制作難度,縮小了產(chǎn)品的體積。FPGA的可編
          • 關鍵字: 心電  監(jiān)控  應用  設計  FPGA  混合  Flash  構架  模數(shù)  基于  

          怎樣在FPGA中處理開關控制信號

          • 怎樣在FPGA中處理開關控制信號,本系統(tǒng)設計利用FPGA間接控制2塊MAX4312選通所需要的視頻通道,實現(xiàn)各個視頻通道間相互切換。根據(jù)開關控制信號的設計思想在FPGA中對撥動開關輸入信號做去抖動處理,然后對不同的開關操作進行編碼,最后將信號送給DSP進
          • 關鍵字: 控制  信號  開關  處理  FPGA  怎樣  
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