risc-v soc 文章 進入risc-v soc技術(shù)社區(qū)
IAR與先楫半導體達成戰(zhàn)略合作，支持先楫RISC-V MCU開發(fā)
- （中國｜上海）2023年6月14日 - 在Embedded World China首屆展會舉辦期間，嵌入式開發(fā)軟件和服務(wù)的全球領(lǐng)導者 IAR 與國產(chǎn)領(lǐng)先高性能MCU廠商先楫半導體（HPMicro）共同宣布達成戰(zhàn)略合作協(xié)議：IAR 最新的 Embedded Workbench for RISC-V 版本將全面支持先楫HPM6000高性能RISC-V MCU系列，這是IAR 首次支持高性能通用RISC-V MCU產(chǎn)品系列。IAR為先楫半導體的創(chuàng)新產(chǎn)品提供全面的開發(fā)工具支持，包括
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2023 SiFive RISC-V中國技術(shù)論壇即將盛大開幕
- 指令精簡、模塊化、可擴展……已于2022年利用7年時間達成出貨量100億顆的里程碑，RSIC-V正在充分發(fā)揮自身的開放開源優(yōu)勢，一路開疆拓土。身為RISC-V的發(fā)明者與領(lǐng)導廠商，SiFive正發(fā)揮開源生態(tài)疊加未來計算新范式的“鏈主”效應(yīng)，致力于將RISC-V的無限潛力引領(lǐng)至高性能處理器與高算力場景應(yīng)用中。?同時，100億顆RISC-V處理器芯片中，近一半產(chǎn)自中國的亮眼數(shù)據(jù)有目共睹，RISC-V在中國市場信心持續(xù)走高，在此大環(huán)境背景下，SiFive親自運營中國市場與業(yè)務(wù)，希望和中國一起見證RISC
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Debian 13“Trixie”Linux 發(fā)行版有望將帶來 RISC-V 64 位支持
- IT之家 6 月 12 日消息，Debian 是最為古老的 GNU / Linux 發(fā)行版之一，該操作系統(tǒng)以穩(wěn)定性為重，不追求高速迭代，因此在新版本發(fā)布很早以前，就會揭曉一系列新特性。目前 Debian 項目宣布，在未來的 Debian 13 “Trixie” 中，將帶來 RISC-V 64 位支持。日前 Debian 發(fā)布團隊分享的更新郵件中，Debian 開發(fā)人員 Jonathan Wiltshire 透露了 RISC-V 架構(gòu)下 Debian 的現(xiàn)狀：“雖然 RISC-V 64 位移植在此
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聯(lián)發(fā)科繼續(xù)霸主地位！全球市占第一，天璣9300全大核引爆期待
- 根據(jù)最新市場調(diào)研報告揭示，聯(lián)發(fā)科再次登頂智能手機芯片市場，市占率高達32%。其連續(xù)12個季度居于王者之位，全靠5G Soc出貨量大增和高端手機市場的鼎力支持！與此同時，天璣9300的“全大核”CPU架構(gòu)設(shè)計也引發(fā)了廣泛關(guān)注，其卓越性能和低功耗優(yōu)勢成為業(yè)界關(guān)注的焦點，為即將到來的旗艦大戰(zhàn)增添了更多看點。所以，“全大核”到底是什么東西？就目前來說，國內(nèi)旗艦手機芯片的CPU普遍由8個核心組成，其中包含超大核、大核、小核。而這次聯(lián)發(fā)科卻直接以超大核+大核方案來設(shè)計旗艦芯片架構(gòu)，這一舉動使其性能獲得了大幅提升。不少
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三星、英特爾、高通等 13 家企業(yè)發(fā)起 RISC-V 軟件生態(tài)計劃 RISE
- IT之家 6 月 2 日消息，三星、英特爾、英偉達、高通、聯(lián)發(fā)科、谷歌等 13 家 IT 和半導體企業(yè)今日在比利時布魯塞爾正式發(fā)起全球 RISC-V 軟件生態(tài)計劃“RISE”。據(jù)介紹，該計劃旨在加速 RISC-V 新架構(gòu)的軟件生態(tài)建設(shè)及應(yīng)用商業(yè)化進程，推動 RISC-V 處理器在移動通信、數(shù)據(jù)中心、邊緣計算及自動駕駛等領(lǐng)域的市場化落地。RISE 創(chuàng)始董事會包含 13 名成員：谷歌、英特爾、平頭哥、三星、聯(lián)發(fā)科、英偉達、高通、Andes、Imagination、Red Hat、Rivos、SiFive、Ve
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RISC-V切入云計算的元年，進展如何了？
- 近兩年，RISC-V 作為 IT 產(chǎn)業(yè)鏈中國產(chǎn)替代中的重要一環(huán)備受關(guān)注。這個基于 BSD 協(xié)議開源，基金會總部設(shè)在瑞士的開源指令集也一直被視為 X86 和 ARM 強有力的競爭對手。不過，由于起步較晚，性能與生態(tài)尚未成熟，RISC-V 以往更多地是用在物聯(lián)網(wǎng)領(lǐng)域。今年，算能科技基于阿里平頭哥玄鐵 C910 開發(fā)了一臺 64 核 RISC-V 服務(wù)器 SG2042。這一動作則拉開了 RISC-V 挺入云計算領(lǐng)域的序幕，2023 也被業(yè)界看做是 RISC-V 進入云計算的元年。本期開源訪談我們邀請中國電信研究
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阿里加入RISC-V官方組織，還有高通、三星、intel也加入了
- 在ARM、X86芯片架構(gòu)之后，最被大家看好的芯片架構(gòu)就是RISC-V了。特別是中國芯片廠商，紛紛擁抱RISC-V架構(gòu)，原因在于RISC-V架構(gòu)是開源免費的，不怕被人卡脖子。所以我們看到中科院、阿里紛紛推出了眾多的RISC-V芯片，2022年全球出貨100億顆RISC-V芯片中，50%是中國廠商貢獻的。也正因為RISC-V架構(gòu)的火爆，最近全球13家知名IT巨頭，成立了一個RISC-V軟件生態(tài)系統(tǒng) (RISE) 的指導委員會。這個委員會的目的，就是推進RISC-V芯片的落地，加速RISC-V新架構(gòu)的軟件生態(tài)建
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科技巨頭聯(lián)合發(fā)起RISC-V生態(tài)計劃 年出貨將超800億顆
- 據(jù)報道，由谷歌、英特爾、平頭哥等13家企業(yè)發(fā)起的全球RISC-V軟件生態(tài)計劃“RISE”，在比利時布魯塞爾正式啟動。RISE旨在加速RISC-V新架構(gòu)的軟件生態(tài)建設(shè)及應(yīng)用商業(yè)化進程，成員將聯(lián)合推動RISC-V處理器在移動通信、數(shù)據(jù)中心、邊緣計算及自動駕駛等領(lǐng)域的市場化落地。面對物聯(lián)網(wǎng)等應(yīng)用新變化，RISC-V作為新一代指令集，擁有開源、精簡、靈活、可自定義的特點，相比封閉的ARM指令集，更適合專用處理器的開發(fā)，有望在IoT MCU市場迅速擴張，而后推廣至數(shù)據(jù)中心等領(lǐng)域。我國RISC-V發(fā)展意義更加重大，在
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手機芯片為啥這么燒錢
- 隨著互聯(lián)網(wǎng)的普及，手機逐漸成為我們的個人標配。手機的關(guān)鍵在于芯片，芯片的質(zhì)量很大程度上決定了手機的性能，可是手機芯片為什么這么貴呢？芯片就像手機的大腦，我們將輸入信號作為原材料輸入手機，通過改變芯片內(nèi)部的走線、邏輯，就能對輸入信號實現(xiàn)不同的處理方式。也正因此，手機芯片是當今集成度超高的元器件，別看它只有一個指甲蓋的大小，里面可是包含了數(shù)十億晶體管呢，蘋果的 A15 仿生芯片包含了 150 億個晶體管，每秒可執(zhí)行 15.8 萬億次操作。因此，無論是研發(fā)還是制造難度，大家都可想而知。經(jīng)常會
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基于形式驗證的高效RISC-V處理器驗證方法
- RISC-V的開放性允許定制和擴展基于 RISC-V 內(nèi)核的架構(gòu)和微架構(gòu)，以滿足特定需求。這種對設(shè)計自由的渴望也正在將驗證部分的職責轉(zhuǎn)移到不斷壯大的開發(fā)人員社群。然而，隨著越來越多的企業(yè)和開發(fā)人員轉(zhuǎn)型RISC-V，大家才發(fā)現(xiàn)處理器驗證絕非易事。新標準由于其新穎和靈活性而帶來的新功能會在無意中產(chǎn)生規(guī)范和設(shè)計漏洞，因此處理器驗證是處理器開發(fā)過程中一項非常重要的環(huán)節(jié)。在復雜性一般的RISC-V 處理器內(nèi)核的開發(fā)過程中，會發(fā)現(xiàn)數(shù)百甚至數(shù)千個漏洞。當引入更多高級特性的時候，也會引入復雜程度各不相同的新漏洞。而某些類
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用于多時鐘域 SoC 和 FPGA 的同步器技術(shù)
- 通常，傳統(tǒng)的雙觸發(fā)器同步器用于同步單比特電平信號。如圖1和圖2所示，觸發(fā)器A和B1工作在異步時鐘域。CLK_B 時鐘域中的觸發(fā)器 B1 對輸入 B1-d 進行采樣時，輸出 B1-q 有可能進入亞穩(wěn)態(tài)。但在 CLK_B 時鐘的一個時鐘周期期間，輸出 B1-q 可能穩(wěn)定到某個穩(wěn)定值。常規(guī)二觸發(fā)器同步器通常，傳統(tǒng)的雙觸發(fā)器同步器用于同步單比特電平信號。如圖1和圖2所示，觸發(fā)器A和B1工作在異步時鐘域。CLK_B 時鐘域中的觸發(fā)器 B1 對輸入 B1-d 進行采樣時，輸出 B1-q 有可能進入亞穩(wěn)態(tài)。但在 CLK
- 關(guān)鍵字： SoC FPGA
歐洲RISC-V處理器流片：216核心 不需要風扇散熱
- 5月9日消息，歐洲航天局(ESA)贊助、瑞士蘇黎世聯(lián)邦理工學院和意大利博洛尼亞大學共同開發(fā)的“Occany”(鳥蛇)處理器，現(xiàn)已流片。這顆處理器基于開源開放的RISC-V架構(gòu)，GlobalFoundries 12nm LPP低功耗工藝，chiplet小芯片設(shè)計，2.5D封裝，雙芯片共集成多達216個核心，晶體管數(shù)量達10億個，而面積僅為73平方毫米。同時，它還集成了未公開數(shù)量的64位FPU浮點單元，整合兩顆美光的16GB HBM2e高帶寬內(nèi)存。硅中介層面積26.3 x 23.05毫米，制造工藝為65nm，
- 關(guān)鍵字： risc-v 架構(gòu) 處理器
基于ARM的多核SoC的啟動方法
- 引導過程是任何 SoC 在復位解除后進行各種設(shè)備配置（調(diào)整位、設(shè)備安全設(shè)置、引導向量位置）和內(nèi)存初始化（如 FLASH/SRAM/GRAM）的過程。在引導過程中，各種模塊/外設(shè)（如時鐘控制器或安全處理模塊和其他主/從）根據(jù) SoC 架構(gòu)和客戶應(yīng)用進行初始化。在多核 SoC 中，首先主要核心（也稱為引導核心）在引導過程中啟動，然后輔助核心由軟件啟用。引導過程從上電復位 (POR)開始，硬件復位邏輯強制 ARM 內(nèi)核（Cortex M 系列）從片上引導 ROM 開始執(zhí)行。引導 ROM 代碼使用給定的引導選擇選
- 關(guān)鍵字： ARM SoC
risc-v soc介紹
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