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VHDL語(yǔ)言的幀同步算法實(shí)現(xiàn)
- 數(shù)字通信網(wǎng)中,幀同步是同步復(fù)接設(shè)備中最重要的部分,他包括幀同步碼的產(chǎn)生和幀同步碼的識(shí)別,其中接收端的幀同步識(shí)別電路的結(jié)構(gòu)對(duì)同步性能的影響是主要的。
1 工作原理
實(shí)現(xiàn)幀同步的基本方法是在發(fā)送端預(yù)先規(guī) - 關(guān)鍵字: 實(shí)現(xiàn) 算法 同步 語(yǔ)言 VHDL
SDH中E1接口分接復(fù)用器VHDL設(shè)計(jì)及FPGA實(shí)現(xiàn)
- 摘要:介紹了SDH系統(tǒng)中的接口電路--數(shù)字分接復(fù)用器的VHDL設(shè)計(jì)及FPGA實(shí)現(xiàn)。該分接復(fù)用器電路用純數(shù)字同步方...
- 關(guān)鍵字: 分接復(fù)用器、狀態(tài)轉(zhuǎn)移圖、VHDL FPGA
基于DSP和CPLD的低壓斷路器智能控制系統(tǒng)的設(shè)計(jì)
- 電子產(chǎn)品世界,為電子工程師提供全面的電子產(chǎn)品信息和行業(yè)解決方案,是電子工程師的技術(shù)中心和交流中心,是電子產(chǎn)品的市場(chǎng)中心,EEPW 20年的品牌歷史,是電子工程師的網(wǎng)絡(luò)家園
- 關(guān)鍵字: DSP 低壓斷路器 CPLD 智能控制系統(tǒng)
基于CPLD的單片機(jī)PCI接口設(shè)計(jì)
- 1 PCI接口設(shè)計(jì)原理1.1 PCI總線協(xié)議簡(jiǎn)介這里只討論P(yáng)CI總線2.0協(xié)議,其它協(xié)議僅僅是在2.0的基礎(chǔ)上作了一些擴(kuò)展,僅就單片機(jī)與PCI設(shè)備間的通信來(lái)說(shuō),意義不大。PCI總線是高性能局部總線,工作頻率0~33MHz,可同時(shí)支持多
- 關(guān)鍵字: CPLD PCI 單片機(jī) 接口設(shè)計(jì)
基于DSP與CPLD的輸電線路局部氣象監(jiān)測(cè)裝置系統(tǒng)設(shè)計(jì)
- 電子產(chǎn)品世界,為電子工程師提供全面的電子產(chǎn)品信息和行業(yè)解決方案,是電子工程師的技術(shù)中心和交流中心,是電子產(chǎn)品的市場(chǎng)中心,EEPW 20年的品牌歷史,是電子工程師的網(wǎng)絡(luò)家園
- 關(guān)鍵字: DSP 氣象監(jiān)測(cè) CPLD
基于CPLD非多路復(fù)用/多路總線轉(zhuǎn)換橋設(shè)計(jì)/實(shí)現(xiàn)
- 微處理器對(duì)外并行總線接口方式一般分為兩種,一種為多路復(fù)用方式,數(shù)據(jù)與地址采用共用引腳,分時(shí)傳輸;另一種是非多...
- 關(guān)鍵字: CPLD 多路總線 轉(zhuǎn)換橋
FPGA/CPLD常用的四種設(shè)計(jì)方法
- FPGA/CPLD常用的四種設(shè)計(jì)方法,FPGA/CPLD的設(shè)計(jì)思想與技巧是一個(gè)非常大的話題,本文僅介紹一些常用的設(shè)計(jì)思想與技巧,包括乒乓球操作、串并轉(zhuǎn)換、流水線操作和數(shù)據(jù)接口的同步方法。希望本文能引起工程師們的注意,如果能有意識(shí)地利用這些原則指導(dǎo)日
- 關(guān)鍵字: 方法 設(shè)計(jì) 常用 FPGA/CPLD
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