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xilinx fpga 文章 進(jìn)入xilinx fpga技術(shù)社區(qū)
基于FPGA的電子攝像系統(tǒng)的穩(wěn)像設(shè)計(jì)
- 穩(wěn)像系統(tǒng)的反應(yīng)速度是電子穩(wěn)像要解決的關(guān)鍵技術(shù)之一。傳統(tǒng)的基于“攝像機(jī)-圖像采集卡-計(jì)算機(jī)”模式的穩(wěn)像系統(tǒng)、圖像檢測(cè)和匹配算法全部由計(jì)算機(jī)以軟件方式實(shí)現(xiàn)。盡管當(dāng)今計(jì)算機(jī)的性能很高，能夠部分滿足單傳感器電子穩(wěn)系統(tǒng)的實(shí)時(shí)處理要求，但在以下幾個(gè)方面有著難以解決的問(wèn)題：首先，其固有的串行工作方式使得單計(jì)算機(jī)難以適應(yīng)其于多傳感器視頻處理系統(tǒng)的實(shí)時(shí)穩(wěn)像，阻礙了在實(shí)際中的應(yīng)用adw欠，傳統(tǒng)的圖像采集卡中能將采集圖像數(shù)據(jù)實(shí)時(shí)傳輸給計(jì)算機(jī)，而不能傳輸給標(biāo)準(zhǔn)接口的視頻監(jiān)視設(shè)備lk之很多應(yīng)用場(chǎng)合對(duì)聽(tīng)要求很高。因此，研制專(zhuān)用的電
- 關(guān)鍵字： 隔行掃描 電子穩(wěn)像系統(tǒng) FPGA
基于FPGA和PCI的AFDX終端接口卡設(shè)計(jì)
- 航空電子全雙工交換式以太網(wǎng)(AFDX)是在商用以太網(wǎng)的基礎(chǔ)上經(jīng)過(guò)改進(jìn)實(shí)時(shí)性和可靠性建立起來(lái)的。依據(jù)ARINC664規(guī)范第7部分對(duì)終端接口卡時(shí)延和抖動(dòng)的性能要求，提出基于FPGA和PCI的AFDX終端接口卡的整體設(shè)計(jì)方案，對(duì)發(fā)送和接收模塊等關(guān)鍵模塊進(jìn)行了設(shè)計(jì)，并分析了PCI接口驅(qū)動(dòng)程序。測(cè)試結(jié)果表明,該接口卡實(shí)時(shí)性好、傳輸速率高、穩(wěn)定可靠，符合AFDX協(xié)議標(biāo)準(zhǔn)。
- 關(guān)鍵字： 全雙工交換式以太網(wǎng) 實(shí)時(shí)性 FPGA
基于FPGA的四通道視頻縮放引擎的研究及設(shè)計(jì)
- 設(shè)計(jì)了一種可實(shí)現(xiàn)4路視頻信號(hào)縮放和幀率轉(zhuǎn)換的電路架構(gòu)。視頻信號(hào)依次經(jīng)過(guò)縮小模塊、幀率轉(zhuǎn)換模塊以及放大模塊，有效地減少了幀率轉(zhuǎn)換對(duì)存儲(chǔ)器帶寬的需求。
- 關(guān)鍵字： 幀率轉(zhuǎn)換 加權(quán)均值算法 FPGA
基于FGPA的數(shù)字密碼鎖設(shè)計(jì)
- 設(shè)計(jì)選用FPGA芯片、4×4矩陣鍵盤(pán)、七段數(shù)碼管為主要硬件，設(shè)計(jì)了一種低功耗、體積小的密碼鎖，并在硬件上驗(yàn)證了其可靠性。由于FPGA的靈活性，密碼長(zhǎng)度可根據(jù)寄存器個(gè)數(shù)而隨意改變，此設(shè)計(jì)在現(xiàn)代物聯(lián)網(wǎng)技術(shù)中將有廣泛應(yīng)用。
- 關(guān)鍵字： 電子鎖 狀態(tài)機(jī) FPGA
LTE上行DFT/IDFT的一種設(shè)計(jì)實(shí)現(xiàn)
- MSL4163提供1MHz I2C串口，器件包括先進(jìn)的PWM引擎以及片上EEPROM等。主要用在電視和臺(tái)式電腦監(jiān)視器、醫(yī)療、工業(yè)儀表和汽車(chē)音/視頻顯示器。本文介紹了MSL4163/MSL4164主要特性、方框圖和典型應(yīng)用電路、級(jí)聯(lián)連接電路。
- 關(guān)鍵字： 3GPP協(xié)議 流水線結(jié)構(gòu) FPGA
基于FPGA的級(jí)聯(lián)H橋多電平變流器CPS-PWM觸發(fā)脈沖快速生成
- 提出一種基于現(xiàn)場(chǎng)可編程門(mén)陣列(FPGA)及不對(duì)稱(chēng)規(guī)則采樣的級(jí)聯(lián)H橋型變流器觸發(fā)脈沖的快速生成方法。詳細(xì)分析了基于不對(duì)稱(chēng)規(guī)則采樣的載波相移SPWM(CPS-SPWM)觸發(fā)脈沖的快速生成原理。重點(diǎn)介紹了基于FPGA的CPS-SPWM觸發(fā)脈沖快速生成的實(shí)現(xiàn)方法。理論分析和實(shí)驗(yàn)結(jié)果表明，在既沒(méi)有增加采樣頻率，又沒(méi)有增加計(jì)算量的情況下，相對(duì)基于對(duì)稱(chēng)規(guī)則采樣的CPS-SPWM脈沖生成方法，該方法具有較快的生成速度，并可廣泛應(yīng)用于DSTATCOM等高壓級(jí)聯(lián)H橋多電平變流器觸發(fā)脈沖的快速生成。
- 關(guān)鍵字： 脈沖形成 CPS-SPWM技術(shù) FPGA
數(shù)字基帶預(yù)失真系統(tǒng)中環(huán)路延遲估計(jì)的FPGA實(shí)現(xiàn)
- 基于FPGA芯片Stratix II EP2S60F672C4設(shè)計(jì)實(shí)現(xiàn)了數(shù)字基帶預(yù)失真系統(tǒng)中的環(huán)路延遲估計(jì)模塊。該模塊運(yùn)用了一種環(huán)路延遲估計(jì)新方法，易于FPGA實(shí)現(xiàn)。同時(shí)，在信號(hào)失真的情況下也能給出正確的估計(jì)結(jié)果。Modelsim SE 6.5c的時(shí)序仿真結(jié)果和SignalTaps II的硬件調(diào)試結(jié)果驗(yàn)證了模塊的有效性。
- 關(guān)鍵字： 數(shù)字基帶預(yù)失真系統(tǒng) 環(huán)路延遲估計(jì) FPGA
基于FPGA的FOR循環(huán)并行CRC流水線算法
- 通過(guò)研究通用串行循環(huán)冗余校驗(yàn)(CRC)編碼技術(shù)并在此基礎(chǔ)上,利用等式代換或矩陣變換等方法推導(dǎo)出通用并行CRC編碼電路結(jié)構(gòu)。根據(jù)傳統(tǒng)的并行CRC編碼方法,發(fā)現(xiàn)在高速數(shù)據(jù)傳輸校驗(yàn)中,需要大量的人為計(jì)算量,由于計(jì)算量大,容易產(chǎn)生一些計(jì)算錯(cuò)誤。于是在傳統(tǒng)的串行CRC編碼的思想基礎(chǔ)上,利用FOR循環(huán)語(yǔ)句與流水線技術(shù)相結(jié)合,提出基于FPGA的FOR循環(huán)并行CRC流水線算法。
- 關(guān)鍵字： 循環(huán)冗余校驗(yàn) 流水線技術(shù) FPGA
基于FPGA的VHDL語(yǔ)言電路優(yōu)化設(shè)計(jì)
- 在VHDL語(yǔ)言電路優(yōu)化設(shè)計(jì)當(dāng)中，優(yōu)化問(wèn)題主要包括面積優(yōu)化和速度優(yōu)化。面積優(yōu)化是指CPLD／FPGA的資源利用率優(yōu)化，即用盡可能少的片內(nèi)資源實(shí)現(xiàn)更多電路功能；速度優(yōu)化是指設(shè)計(jì)系統(tǒng)滿足一定的速度要求。
- 關(guān)鍵字： 電路優(yōu)化設(shè)計(jì) VHDL FPGA
用Zynq-7000 EPP實(shí)現(xiàn)端到端廣播
- 在今年舉辦的美國(guó)國(guó)廣播電視設(shè)備展上亮相的數(shù)項(xiàng)創(chuàng)新中，BBC RD新開(kāi)發(fā)的Stagebox可以安裝到攝像機(jī)的背面，將有效傳輸距離從數(shù)百米延長(zhǎng)到互聯(lián)網(wǎng)協(xié)議數(shù)據(jù)包能抵達(dá)的幾乎任何一個(gè)地方。在近期涌現(xiàn)的利用 FPGA與生俱來(lái)的可編程功能提供更多功能和適應(yīng)性，實(shí)現(xiàn)協(xié)議和標(biāo)準(zhǔn)的對(duì)接的開(kāi)創(chuàng)性設(shè)備中，Stagebox是最新一員。
- 關(guān)鍵字： Zynq-7000 端到端廣播 FPGA
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Xilinx FPGA
Xilinx FPGA主要分為兩大類(lèi)，一種側(cè)重低成本應(yīng)用，容量中等，性能可以滿足一般的邏輯設(shè)計(jì)要求，如Spartan系列；還有一種側(cè)重于高性能應(yīng)用，容量大，性能能滿足各類(lèi)高端應(yīng)用，如Virtex系列，用戶可以根據(jù)自己實(shí)際應(yīng)用要求進(jìn)行選擇。 在性能可以滿足的情況下，優(yōu)先選擇低成本器件。
Xilinx FPGA可編程邏輯解決方案縮短了電子設(shè)備制造商開(kāi)發(fā)產(chǎn)品的時(shí)間 [ 查看詳細(xì) ]
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