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          基于FPGA的彩屏控制器設(shè)計(jì)

          作者: 時(shí)間:2013-03-05 來源:網(wǎng)絡(luò) 收藏

          將控制字以串行的方式寫入到內(nèi)部寄存器的Verilog HDL代碼如下所示:

          if (dclk)

          data_in = {data_in[6:0],1'b0};

          第二、三次通信則是ADS7843 將觸摸后的X、Y的電壓值轉(zhuǎn)換為16 bit數(shù)據(jù)賦值給DOUT端口,然后芯片采集其高12 bit數(shù)據(jù),低4 bit自動(dòng)補(bǔ)零。本設(shè)計(jì)將采集到的串行的12 bit數(shù)據(jù)轉(zhuǎn)化為并行的12 bit數(shù)據(jù),其Verilog HDL代碼如下:

          if (!dclk)

          begin

          if(rd_cd_strob)

          begin

          if(y_cde_config)

          y_cde={y_cde[10:0],adc_out};

          else

          x_cde={x_cde[10:0],adc_out};

          end

          end

          2 實(shí)驗(yàn)結(jié)果

          2.1 仿真驗(yàn)證

          整個(gè)是在Quartus II 8.0中設(shè)計(jì)并仿真的。仿真分為兩個(gè)部分,包括TFT-LCD的時(shí)序波形和ADS7843芯片的時(shí)序波形。仿真結(jié)果分別如圖4、圖5所示。

          由圖4可以得出,在一幀的數(shù)據(jù)(oVD的一個(gè)時(shí)鐘周期內(nèi)的數(shù)據(jù))中,前1/3幀顯示紅色(oLCD_R對應(yīng)255),中間1/3幀顯示綠色(oLCD_G對應(yīng)255),后1/3幀顯示藍(lán)色(oLCD_B對應(yīng)255);則相應(yīng)的屏幕上1~90行顯示為紅色、91~180行為綠色,180~272行為藍(lán)色,如圖6所示。

          下面分析X坐標(biāo)值。由圖5可以看到,當(dāng)產(chǎn)生觸摸時(shí)筆中斷信號(hào)PENIRQ變?yōu)榈碗娖?,此時(shí)片選信號(hào)CS變?yōu)榈碗娖?,其低電平維持時(shí)間為24個(gè)DCLK時(shí)鐘周期,在前8個(gè)時(shí)鐘周期DIN端口寫入控制字為10010010,在第10個(gè)時(shí)鐘DOUT端口開始接收轉(zhuǎn)化的12 bit數(shù)據(jù),其值為011110001000。同理可分析Y坐標(biāo)值。在DOUT端口接收X、Y坐標(biāo)值之后,通過串并轉(zhuǎn)換最終得到并行輸出的X、Y的坐標(biāo)值,如圖5中的oX和oY端口所示。

          2.2 最終顯示效果

          采用Altera公司的EP2C70F896C6;彩色液晶觸摸屏采用臺(tái)灣東華公司的WXCAT43-TG3#001R。最終的顯示效果如圖6所示。

          使用Verilog HDL編寫觸摸界面過于復(fù)雜,通過軟件設(shè)計(jì)觸摸屏操作界面則需要編寫彩色觸摸屏的IP核,本設(shè)計(jì)基于的彩色觸摸屏控制器能夠?qū)崿F(xiàn)顏色深度為24 bit,分辨率為480×272的TFT-LCD控制和ADS7843芯片的時(shí)序控制,為后續(xù)IP核的編寫工作打下了基礎(chǔ)。


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