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基于FPGA的等精度頻率計的設計與實現(xiàn)

作者：時間：2012-11-26 來源：網(wǎng)絡

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仿真波形如圖2所示。

仿真時序波形

3 結(jié) 語

本文利用ALTERA公司的FPGA芯片EPF10K10，使用VHDL編程語言設計等精度頻率計，給出核心程序，經(jīng)過ISPEXPER仿真后，驗證設計是成功的，達到預期結(jié)果。

和傳統(tǒng)的頻率計相比，FPGA的頻率計簡化了電路板的設計，提高了系統(tǒng)設計的實現(xiàn)性和可靠性，測頻范圍達到100 MHz，實現(xiàn)了數(shù)字系統(tǒng)硬件的軟件化，這是數(shù)字邏輯設計的新趨勢。

參考文獻

[1]李景華，杜玉遠.可編程邏輯器件與EDA技術(shù)[M].沈陽：東北大學出版社，2002.

[2]趙雅興.FPGA原理、設計與應用[M].天津：天津大學出版社，1999.

[3]夏宇聞.復雜數(shù)字電路與系統(tǒng)的VERILOGHDL設計技術(shù)[M].北京：北京航空航天大學出版社，1998.

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關鍵詞： FPGA 等精度頻率計

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