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          聚焦面向Smarter視覺的Zynq SoC

          作者:Mike Santarini 時間:2014-03-06 來源:電子產(chǎn)品世界 收藏

            OPENCV庫

          本文引用地址:http://www.ex-cimer.com/article/234276.htm

            還推出了OpenCV(CV就是計算機(jī)視覺的縮寫)庫,進(jìn)一步完善了視覺技術(shù)。OpenCV是OpenCV.org發(fā)布的一種業(yè)界標(biāo)準(zhǔn)的開源算法庫,可供嵌入式視覺開發(fā)人員用于迅速創(chuàng)建視覺系統(tǒng)。世界各地的嵌入式視覺開發(fā)人員都積極為該庫貢獻(xiàn)新算法,目前該庫已包含有2,500多種使用C、C++、Java和Python語言編寫完成的算法(見第24頁的OpenCV報道)。庫中的算法復(fù)雜程度各個不同,從圖像濾波器等簡單功能到動作檢測等高級分析功能,無所不有。

            Alvarez表示,這些OpenCV算法所針對的幾乎是用任何商用微處理器和DSP實現(xiàn)的方案。由于Zynq 使用的是ARM處理系統(tǒng),因此可在其處理器上實現(xiàn)這些采用C++語言編寫的算法。

            Alvarez指出,有了Vivado HLS,用戶可以用C或C++語言編寫這些算法,將函數(shù)調(diào)用從OpenCV改為HLS,然后使用Vivado HLS,將算法綜合成或者編譯成為便于Zynq-7000 的邏輯部分實現(xiàn)而優(yōu)化的RTL代碼。在Vivado環(huán)境中使用OpenCV,便于視覺架構(gòu)師方便地比較設(shè)計方案中的給定算法到底是在處理器還是Zynq-7000 All Programmable 邏輯部分運(yùn)行效率最佳。開源庫的推出可為客戶提供一個良好的設(shè)計開端。使用Vivado HLS,已經(jīng)編譯了OpenCV庫中30多種最常用的嵌入式視覺算法??蛻裟軌蛟谙到y(tǒng)級快速權(quán)衡處理器與邏輯,并且立即在Zynq-7000 All Programmable SoC中運(yùn)行,為給定應(yīng)用提供最理想的系統(tǒng)。

            賽靈思及其聯(lián)盟成員將積極不斷地從OpenCV庫移植更多功能,按季提供給賽靈思的用戶群。由于開發(fā)人員可以在幾乎任何商用處理器上運(yùn)行OpenCV庫,視覺設(shè)計人員將能夠比較運(yùn)行在各種芯片器件上的算法的性能并為之建立基準(zhǔn)。

            作為視覺計劃的一部分,賽靈思還開發(fā)出了SmartCORE IP套件,以滿足各種細(xì)分市場的Smarter視覺設(shè)計要求,為新一代產(chǎn)品帶來Smarter視覺功能。借助賽靈思最新推出的IP Integrator工具,客戶能夠?qū)martCORE IP套件提供的內(nèi)核和OpenCV庫提供的算法迅速實現(xiàn)在設(shè)計中。這種新工具是一種新型即插即用IP環(huán)境,方便客戶在原理圖環(huán)境中工作,或者如果需要的話也支持在命令行環(huán)境中工作。

            目標(biāo)平臺意識

            Alvarez指出,自Vivado設(shè)計套件誕生后,賽靈思讓該套件的設(shè)計具有器件意識,這樣就能充分發(fā)揮每款器件的功能。Alvarez稱,有了IP Integrator,Vivado設(shè)計套件不僅具有器件意識,現(xiàn)在還具有目標(biāo)平臺意識,支持所有Zynq SoC和7系列開發(fā)板以及套件。具有目標(biāo)平臺意識,就意味著Vivado設(shè)計套件現(xiàn)在能配置和應(yīng)用特定開發(fā)板的設(shè)計規(guī)則檢查,從而確??焖偻瞥銮袑嵖尚械南到y(tǒng)。

            舉例來說,當(dāng)設(shè)計人員選擇賽靈思Zynq-7000 SoC視頻及成像套件,并在IP Integrator中實例化Zynq SoC處理系統(tǒng)時,Vivado設(shè)計套件則會用恰當(dāng)?shù)耐庠O(shè)、驅(qū)動程序和存儲器映射對處理系統(tǒng)進(jìn)行預(yù)配置,從而為開發(fā)板提供支持。嵌入式設(shè)計團(tuán)隊現(xiàn)在能針對雙核ARM處理系統(tǒng)和高性能邏輯更迅速地識別、重用并集成IP軟/硬核。

            用戶可使用一系列對話框設(shè)定處理系統(tǒng)及其邏輯之間的接口。IP Integrator隨后自動生成RTL,并針對性能或面積進(jìn)行優(yōu)化。接下來用戶可添加自己的定制邏輯,或使用Vivado IP目錄完成設(shè)計。

            到目前賽靈思客戶使用賽靈思FPGA已經(jīng)開發(fā)出怎樣的Smarter視覺系統(tǒng),是非常值得一看的。Zynq-7000 All Programmable SoC和強(qiáng)大的Smarter視覺環(huán)境的問世,為開發(fā)更令人叫絕的新產(chǎn)品提供了保障。

           


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