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目前,DSP以其卓越的性能、獨(dú)有的特點(diǎn),已經(jīng)成為通信、計(jì)算機(jī)、消費(fèi)類電子產(chǎn)品等領(lǐng)域的基礎(chǔ)器件。同時(shí),隨著對(duì)知識(shí)產(chǎn)權(quán)的重視,在利用DSP進(jìn)行產(chǎn)品設(shè)計(jì)時(shí),如何保護(hù)自己的成果,防止破譯者竊取,也成為設(shè)計(jì)者工作在一個(gè)重要方面[1......
重慶交通大學(xué)計(jì)算機(jī)通訊學(xué)院TI DSP聯(lián)合實(shí)驗(yàn)室是TI在重慶地區(qū)大學(xué)掛牌的第三家聯(lián)合實(shí)驗(yàn)室(前兩家為:重慶大學(xué)和重慶郵電大學(xué)),該校領(lǐng)導(dǎo)對(duì)實(shí)驗(yàn)室的建設(shè)極為重視,前期投入了專向資金并對(duì)實(shí)驗(yàn)室產(chǎn)品的采購(gòu)進(jìn)行了多方選擇,最終選......
At recent conferences, PDA makers and wireless phone vendors have......
1 并行流水結(jié)構(gòu)FIR的原理 在用FPGA或?qū)S眉呻娐穼?shí)現(xiàn)數(shù)字信號(hào)處理算法時(shí),計(jì)算速度和芯片面積是兩個(gè)相互制約的主要問(wèn)題。實(shí)際應(yīng)用FIR濾波器時(shí),要獲得良好的濾波效果,濾波器的階數(shù)可能會(huì)顯著增加,有時(shí)可能會(huì)多達(dá)幾百......
FPGA設(shè)計(jì)和驗(yàn)證工程師當(dāng)今面臨的最大挑戰(zhàn)之一是時(shí)間和資源制約。隨著FPGA在速度、密度和復(fù)雜性方面的增加,完成一個(gè)完整時(shí)序驗(yàn)證對(duì)人力和計(jì)算機(jī)處理器、存儲(chǔ)器提出了更多更高的要求。 隨著FPGA器件體積和復(fù)雜性的不......
引言 基于SRAM工藝FPGA在每次上電后需要進(jìn)行配置,通常情況下FPGA的配置文件由片外專用的EPROM來(lái)加載。這種傳統(tǒng)配置方式是在FPGA的功能相對(duì)穩(wěn)定的情況下采用的。在系統(tǒng)設(shè)計(jì)要求配置速度高、容量大、以及遠(yuǎn)程升......
一、概述 隨著VLSI的集成度越來(lái)越高,設(shè)計(jì)也越趨復(fù)雜。一個(gè)系統(tǒng)的設(shè)計(jì)往往不僅需要硬件設(shè)計(jì)人員的參與,也需要有軟件設(shè)計(jì)人員的參與。軟件設(shè)計(jì)人員與硬件設(shè)計(jì)人員之間的相互協(xié)調(diào)就變的格外重要,它直接關(guān)系到工作的效率......
為網(wǎng)絡(luò)多媒體應(yīng)用選擇一個(gè)恰當(dāng)數(shù)字信號(hào)處理器(DSP)是一項(xiàng)很復(fù)雜的工作。首先,必須在當(dāng)前和近期業(yè)界接口的需求環(huán)境下對(duì)處理器的內(nèi)核體系結(jié)構(gòu)和外圍設(shè)備配置進(jìn)行透徹的分析。其次,為了防止出現(xiàn)帶寬瓶頸問(wèn)題,了解多媒體數(shù)據(jù)(例......
1 電磁干擾(EMI)分析 1.1 電磁干擾的概念及途徑 電磁干擾產(chǎn)生于干擾源,他......
介紹了一種基于DSP+FPGA結(jié)構(gòu)的小波圖像處理系統(tǒng)設(shè)計(jì)方案,以高性能數(shù)字信號(hào)處理器ADSP—BF535作為核心,結(jié)合現(xiàn)場(chǎng)可編程門(mén)陣列FPGA,實(shí)現(xiàn)了實(shí)時(shí)數(shù)字圖像處理。 &nb......
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