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賽靈思交付行業(yè)首個(gè)目標(biāo)設(shè)計(jì)平臺(tái)

　　全球可編程邏輯解決方案領(lǐng)導(dǎo)廠商賽靈思公司(Xilinx, Inc. )今天宣布，致力于加速基于Virtex?-6 和 Spartan?-6 現(xiàn)場(chǎng)可編程門陣列 (FPGA) 片上系統(tǒng) (SoC) 解決方案開(kāi)發(fā)的賽靈思基礎(chǔ)目標(biāo)設(shè)計(jì)平臺(tái)隆重推出。這款基礎(chǔ)級(jí)目標(biāo)設(shè)計(jì)平臺(tái)在完全集成的評(píng)估套件中融合了 ISE? 設(shè)計(jì)套件 11.2版本、擴(kuò)展的IP系列以及面向Virtex-6或Spartan-6 FPGA的預(yù)驗(yàn)證參考設(shè)計(jì)，可幫助設(shè)計(jì)團(tuán)隊(duì)大幅縮短開(kāi)發(fā)時(shí)間，從而集中工程設(shè)計(jì)資源以提高產(chǎn)品差異化。
關(guān)鍵字： Xilinx Virtex Spartan FPGA SoC ISE

Xilinx宣布隆重推出賽靈思基礎(chǔ)目標(biāo)設(shè)計(jì)平臺(tái)

　　全球可編程邏輯解決方案領(lǐng)導(dǎo)廠商賽靈思公司(Xilinx, Inc.? )今天宣布隆重推出賽靈思基礎(chǔ)目標(biāo)設(shè)計(jì)平臺(tái)，致力于加速基于其Virtex?-6 和 Spartan?-6 現(xiàn)場(chǎng)可編程門陣列 (FPGA) 的片上系統(tǒng) (SoC) 解決方案的開(kāi)發(fā)。這款基礎(chǔ)級(jí)目標(biāo)設(shè)計(jì)平臺(tái)在完全集成的評(píng)估套件中融合了 ISE? 設(shè)計(jì)套件 11.2版本、擴(kuò)展的IP系列以及面向Virtex-6或Spartan-6 FPGA的預(yù)驗(yàn)證參考設(shè)計(jì)，可幫助設(shè)計(jì)團(tuán)隊(duì)大幅縮短開(kāi)發(fā)時(shí)間，從而集中工程設(shè)計(jì)資源
關(guān)鍵字： Xilinx Virtex Spartan.FPGA SoC

基于FPGA的數(shù)字下變頻的研究與實(shí)現(xiàn)

數(shù)字下變頻技術(shù)在移動(dòng)通信、數(shù)字廣播、電視領(lǐng)域具有重要應(yīng)用價(jià)值。討論了對(duì)已知信號(hào)進(jìn)行數(shù)字下變頻時(shí)方案的選擇和參數(shù)的確定，通過(guò)選擇采樣頻率和使用分布式算法的濾波器，以期利用較少的FPGA資源完成信號(hào)的下變頻。對(duì)于采取的方案進(jìn)行仿真驗(yàn)證，結(jié)果證明其達(dá)到了預(yù)期的目的。
關(guān)鍵字：研究實(shí)現(xiàn) 變頻數(shù)字 FPGA 基于射頻

Actel提升業(yè)界領(lǐng)先的 RTAX航天用FPGA的性能

　　愛(ài)特公司 (Actel Corporation) 宣布進(jìn)一步提升其業(yè)界領(lǐng)先之耐輻射RTAX-S和RTAX-SL航天用FPGA的性能和可用性，為航天應(yīng)用設(shè)計(jì)人員帶來(lái)更大優(yōu)勢(shì)。RTAX-S/SL 系列FPGA能夠免除與耐輻射ASIC相關(guān)的成本和進(jìn)度表風(fēng)險(xiǎn)，是需要防止輻射引發(fā)單事件翻轉(zhuǎn) (single-event upset, SEU) 事件保護(hù)功能的航天應(yīng)用的首選FPGA。　　RTAX-S/SL系列FPGA的性能提升包括：　　· 相比 RTAX-S FPGA 產(chǎn)品，RTAX-SL
關(guān)鍵字： Actel FPGA RTAX-S RTAX-SL ASIC

基于單片機(jī)和FPGA的網(wǎng)絡(luò)數(shù)據(jù)加密實(shí)現(xiàn)

摘要：介紹了基于單片機(jī)、FPGA的網(wǎng)絡(luò)數(shù)據(jù)加密實(shí)現(xiàn)。整個(gè)系統(tǒng)由單片機(jī)，F(xiàn)PGA和E1通信接口組成。流密碼加密算法采用A5／l和W7算法。采用VHDL硬件語(yǔ)言實(shí)現(xiàn)FPGA功能。該硬件加密系統(tǒng)具有較好的安全性。
關(guān)鍵詞：通信技術(shù)
關(guān)鍵字： FPGA 單片機(jī) 網(wǎng)絡(luò)數(shù)據(jù) 加密

積分梳狀濾波器的FPGA實(shí)現(xiàn)

本文提出了多級(jí)CIC抽取濾波器結(jié)構(gòu)不僅能夠?qū)崿F(xiàn)更寬輸入信號(hào)的任意速率的抽取，并且對(duì)帶外信號(hào)的衰減也更大。
關(guān)鍵字： FPGA 積分梳狀濾波器

FPGA消費(fèi)電子市場(chǎng)的驅(qū)動(dòng)力來(lái)自中國(guó)

　　市場(chǎng)調(diào)研公司iSuppli曾經(jīng)在報(bào)告中指出，在可編程邏輯市場(chǎng)，Actel公司擁有的重要?jiǎng)?chuàng)新是市場(chǎng)“大腕”Xilinx和Altera所缺乏的。它擁有一種FPGA(現(xiàn)場(chǎng)可編程門陣列)技術(shù)，可以給芯片中的編程邏輯電路加密。它在FPGA中引入了業(yè)界熟悉的ARM核心，而且它還提供混合信號(hào)平臺(tái)。近日，《中國(guó)電子報(bào)》記者就Actel的銷售、技術(shù)演進(jìn)和應(yīng)用市場(chǎng)情況采訪了Actel的首席執(zhí)行官JohnEast先生。　　記者：近幾年來(lái)Actel的銷售額持續(xù)增長(zhǎng)，這在壟斷性極高的可編程邏輯市場(chǎng)是
關(guān)鍵字： Actel FPGA 可編程邏輯 CPLD 40納米 32納米

DDS信號(hào)源的FPGA實(shí)現(xiàn)

1 引言
目前直接數(shù)字頻率合成DDS專用器件大多采用先進(jìn)特定工藝技術(shù)，并具有高性能，多功能，且其內(nèi)部數(shù)字信號(hào)抖動(dòng)?。敵鲂盘?hào)的質(zhì)量高等特點(diǎn)，諸如Qualcomm公司的Q2230、Q2334，Analog Device公司的AD9955、AD
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基于FPGA的脈沖壓縮仿真與實(shí)現(xiàn)

1 引言
隨著現(xiàn)代武器與航天技術(shù)的發(fā)展，要求雷達(dá)應(yīng)具有高精度、遠(yuǎn)距離、高分辨力等性能。簡(jiǎn)單矩形脈沖雷達(dá)存在雷達(dá)探測(cè)能力與距離分辨力之間的矛盾。為解決這一矛盾，大多數(shù)現(xiàn)代雷達(dá)采用脈沖壓縮技術(shù)，調(diào)制信號(hào)
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FPGA在激光測(cè)速靶中的應(yīng)用

0 引言
彈丸飛行速度的測(cè)量是武器系統(tǒng)各種運(yùn)動(dòng)參數(shù)中一項(xiàng)至關(guān)重要的內(nèi)容，它是衡量火炮特性、彈藥特性和彈道特性的一個(gè)重要指標(biāo)。在眾多的彈丸速度測(cè)量系統(tǒng)中，激光光幕區(qū)截測(cè)速靶以其精度高而獨(dú)具優(yōu)勢(shì)。但采用
關(guān)鍵字： FPGA 激光測(cè)速中的應(yīng)用

基于FPGA的航空總線協(xié)議接口設(shè)計(jì)

MIL-STD-1553B是一種應(yīng)用廣泛的航空總線協(xié)議，針對(duì)總線協(xié)議控制器基本依賴于進(jìn)口專用器件現(xiàn)狀，提出了以Xilinx公司Virtex-II Pro FPGA為核心實(shí)現(xiàn)航空總線協(xié)議接口的系統(tǒng)設(shè)計(jì)方案。采用SoPC技術(shù)，將PowerPC 405硬核處理器與總線接口邏輯集成在一片F(xiàn)PGA上，從而使系統(tǒng)集成度高、擴(kuò)展性強(qiáng)。通過(guò)測(cè)試表明，系統(tǒng)工作穩(wěn)定可靠．滿足1553B總線協(xié)議標(biāo)準(zhǔn)。
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AD9847的原理及其在CCD 成像系統(tǒng)中的應(yīng)用

隨著晶圓工藝的不斷發(fā)展，CCD相機(jī)和攝像機(jī)的發(fā)展也趨于小型化、智能化、功能多樣化。隨著45 nm甚至40 nm技術(shù)的發(fā)展，無(wú)論是消費(fèi)級(jí)還是科學(xué)級(jí)攝像機(jī)，設(shè)計(jì)師們?cè)谠O(shè)計(jì)時(shí)更愿意選擇小型且功能強(qiáng)大的芯片。ADI公司推出的
關(guān)鍵字：系統(tǒng) 應(yīng)用成像 CCD 原理及其 AD9847 成像系統(tǒng) AD9847 FPGA 相關(guān)雙采樣可變?cè)鲆?/a> 放大器

FPGA和EZ-USB FX2在采集圖像數(shù)據(jù)中的應(yīng)用

摘要：利用FPGA和EZ_15SB FX2(CY7C68013)將MT9M112(Sensor)數(shù)據(jù)準(zhǔn)確無(wú)損地傳給PC機(jī)。方案使用CY7C68013控制器工作在Slave FIFO從機(jī)方式，用Verilog HDL語(yǔ)言在FPGA中產(chǎn)生相應(yīng)的控制信號(hào)，最終實(shí)現(xiàn)對(duì)數(shù)據(jù)的快速傳輸，
關(guān)鍵字： EZ-USB FPGA FX2 采集

單精度浮點(diǎn)加法器的FPGA實(shí)現(xiàn)

摘要：在FPGA上實(shí)現(xiàn)單精度浮點(diǎn)加法器的設(shè)計(jì)，通過(guò)分析實(shí)數(shù)的IEEE 754表示形式和IEEE 754單精度浮點(diǎn)的存儲(chǔ)格式，設(shè)計(jì)出一種適合在FPGA上實(shí)現(xiàn)單精度浮點(diǎn)加法運(yùn)算的算法處理流程，依據(jù)此算法處理流程劃分的各個(gè)處理模塊
關(guān)鍵字： FPGA 精度浮點(diǎn) 加法器

20×18位符號(hào)定點(diǎn)乘法器的FPGA實(shí)現(xiàn)

摘要：在數(shù)字信號(hào)處理中經(jīng)常需要進(jìn)行乘法運(yùn)算，乘法器的設(shè)計(jì)對(duì)整個(gè)器件的性能有很大的影響，在此介紹20×18比特定點(diǎn)陣列乘法器的設(shè)計(jì)。采用基4-Booth算法和4-2壓縮的方案，并采用先進(jìn)的集成電路工藝，使用SMIC O．18
關(guān)鍵字： FPGA 符號(hào) 定點(diǎn)乘法器