cadence reality 文章 進入cadence reality技術(shù)社區(qū)
Cadence宣布流片GDDR6芯片：基于三星7LPP，不僅用于顯卡
- 根據(jù)外媒報道，Cadence宣布已成功在三星的7LPP制造工藝中流片其GDDR6 IP芯片?！ adence的GDDR6 IP解決方案包括該公司的Denali內(nèi)存控制器，物理接口和驗證IP?？刂破骱蚉HY的額定值可處理每個引腳高達16 Gbps的數(shù)據(jù)傳輸速率，并具有低誤碼率(BER)功能，可降低內(nèi)存總線上的重試次數(shù)，從而縮短延遲，從而確保更大的內(nèi)存帶寬。IP封裝以Cadence的參考設(shè)計提供，允許SoC開發(fā)人員快速復(fù)制IP設(shè)計人員用于其測試芯片的實現(xiàn)?！ 鹘y(tǒng)上，GDDR內(nèi)存主要用于顯卡，但
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4周小白成為大神，速成Cadence Allegro 讓你走向職場巔峰！
- 一、PCB工程師目前現(xiàn)狀 近年來，隨著工業(yè)4.0戰(zhàn)略的實施，智能硬件的加速崛起，PCB工程師更是成為了未來最有前途的職業(yè)之一。特別是電子工業(yè)的不斷壯大，使得產(chǎn)品研發(fā)周期不斷縮短、信號速率不斷提高、單板密度越來越大、門電路工作電壓越來越低、SI-PI-EMI問題趨于復(fù)雜，這樣就要求PCB設(shè)計工程師必須提高專業(yè)素養(yǎng)，也使得PCB設(shè)計的工作日益成為電子設(shè)計中獨立而又不可缺失的一環(huán)。 二、作為一名Allegro工程師 面對電子設(shè)備這些高性能、高速、高密、輕薄的趨勢，高速信號的PCB設(shè)計，越來越成為電子硬
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EDA的低功耗游戲
- 隨著芯片設(shè)計轉(zhuǎn)移到90nm和65nm，芯片制造商面臨著新的挑戰(zhàn)包括溫度、穩(wěn)定性及電源可靠性或電源效率的差異性等方面的挑戰(zhàn)。業(yè)界試圖通過幾種途徑努力來
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Cadence Sigrity 2018最新版集成3D設(shè)計與分析，大幅縮短PCB設(shè)計周期
- 楷登電子(美國Cadence公司，NASDAQ: CDNS)今日宣布發(fā)布Cadence? Sigrity? 2018版本，該版本包含最新的3D解決方案，幫助PCB設(shè)計團隊縮短設(shè)計周期的同時實現(xiàn)設(shè)計成本和性能的最優(yōu)化。 獨有的3D設(shè)計及分析環(huán)境，完美集成了Sigrity工具與Cadence Allegro?技術(shù)，較之于當(dāng)前市場上依賴于第三方建模工具的產(chǎn)品，Sigrity? 2018版本可提供效率更高、出錯率更低的解決方案，大幅度縮短設(shè)計周期的同時、降低設(shè)計失誤風(fēng)險。 此外，全新的3D Workbench
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Cadence Innovus助力Realtek成功開發(fā)DTV SoC解決方案
- 楷登電子(美國Cadence公司)今日宣布，瑞昱半導(dǎo)體股份有限公司(Realtek Semiconductor Corp.)將 Cadence? Innovus? 設(shè)計實現(xiàn)系統(tǒng)用于其最新 28nm 數(shù)字電視(DTV)系統(tǒng)級芯片的研發(fā)并成功流片，同時成功縮小了芯片面積并降低了功耗。除了改善結(jié)果質(zhì)量(QoR)之外，Innovus 設(shè)計實現(xiàn)系統(tǒng)容量更高，可支持實現(xiàn)更大的頂層模塊，降低 SoC 頂層設(shè)計的分割區(qū)
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PCB layout用啥軟件比較好？Cadence or AD？
- PCB layout是什么 PCB layout是印刷電路板。 印刷電路板同時也叫印制電路板，是一種讓各類電子元件實現(xiàn)有規(guī)則連接的載體?！ CB layout中文翻譯為印制板布局，傳統(tǒng)工藝上的電路板是利用印刷蝕刻出線路的方式，因此稱之為印刷或印制電路板。利用印制板人們不僅能夠避免安裝過程接線錯誤(在PCB出現(xiàn)前，電子元件都是通過導(dǎo)線連接，不僅錯綜雜亂還存在安全隱患)。最早使用PCB的是一個奧地利人叫保羅。愛斯勒，于1936年首次在收音機中使用。廣泛應(yīng)用出現(xiàn)在20世紀(jì)
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Cadence Virtuoso定制IC設(shè)計平臺助力WillSemi提升模擬IC設(shè)計的穩(wěn)健性和交付速度
- 楷登電子(美國Cadence公司)今日宣布，WillSemi采用Cadenceò Virtuosoò 定制集成電路設(shè)計平臺，增強了模擬集成電路設(shè)計的可靠性，并縮短了產(chǎn)品的總體上市時間。較此前部署的行業(yè)解決方案，WillSemi采用Cadence定制集成電路設(shè)計流程不僅將模擬設(shè)計和實現(xiàn)時間減半，總設(shè)計周期時間也縮短了三分之一。 Cadence定制設(shè)計流程工具幫助WillSemi集成電路設(shè)計團隊實現(xiàn)了如下目標(biāo)： · 采用Virtuoso電路原理圖編輯器與Virtuoso版
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日月光2017年營收增長12%，預(yù)計Q2營收將逐季成長
- 封測大廠日月光2月1日召開法說會，展望2018年首季營運，日月光預(yù)期以美元計價的封測營收，將略高于去年同期12.3億美元，毛利率將略高于去年同期的23%。電子代工(EMS)合并營收將略低于去年第三季331億元，毛利率將略高于上季9.2%。 2017年日月光集團自結(jié)合并營收創(chuàng)2904.41億元新臺幣新高，年增6%。毛利率18.2%、營益率8.7%，低于前年19.3%、9.7%。歸屬業(yè)主稅后凈利229.88億元新臺幣，年增6%，創(chuàng)歷史次高，受股本膨脹影響，每股盈余2.82元新臺幣，與前年追溯調(diào)整后相
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Cadence推出業(yè)界首款PCI Express 5.0驗證IP 現(xiàn)可供貨
- 楷登電子(美國Cadence 公司， NASDAQ：CDNS)今日宣布，業(yè)界首款支持全新 PCI Express ® (PCIe®)5.0 架構(gòu)的驗證 IP(VIP)正式可用。結(jié)合 TripleCheck™ 技術(shù)，Cadence® VIP 旨在幫助設(shè)計師快速執(zhí)行基于 PCIe 5.0 標(biāo)準(zhǔn)的服務(wù)器和存儲器的系統(tǒng)級芯片(SoC)設(shè)計的完整功能性驗證，確保產(chǎn)品功能符合設(shè)計初衷。 如需進一步了解基于PCIe 5.0架構(gòu)并采用TripleCheck技術(shù)的Cadence
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Cadence本土化公司落戶南京 EDA產(chǎn)業(yè)正發(fā)生什么變化？
- 中國的半導(dǎo)體產(chǎn)業(yè)持續(xù)呈現(xiàn)超過20%的成長率，而全球只有約5%。在中國建立本土化的公司，這對Cadence來說是個很重要的決定，從一年前開始討論這個問題，最后決定選址南京... 2017年11月13日，江蘇南京，Cadence與南京市浦口區(qū)人民政府簽署了為建立Cadence (中國)半導(dǎo)體產(chǎn)業(yè)基地的戰(zhàn)略合作備忘錄及中國IC知識產(chǎn)權(quán)(IP)開發(fā)與服務(wù)平臺的正式投資協(xié)定。 此次簽約儀式受到中國半導(dǎo)體業(yè)界的廣泛關(guān)注，100多位嘉賓現(xiàn)場出席和見證了儀式。 江蘇省省委常委、南京市市委書記張敬華代
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Cadence落戶南京市浦口區(qū),成為繼引進臺積電后的又一龍頭項目
- 11月13日，電子設(shè)計自動化(EDA)與半導(dǎo)體知識產(chǎn)權(quán)(IP)的領(lǐng)先供應(yīng)商美國楷登電子(Cadence)與南京市浦口區(qū)人民政府正式簽署戰(zhàn)略合作備忘錄以及投資協(xié)議。據(jù)悉，Cadence 項目是南京市浦口區(qū)繼引進臺積電之后在集成電路設(shè)計領(lǐng)域引進的又一個龍頭性項目，歷經(jīng)兩年的洽談，在多方的共同努力下，今天終于簽約落地。 南京市江北新區(qū)管委會常務(wù)副主任、浦口區(qū)區(qū)委書記瞿為民先生致辭表示，此次簽約儀式標(biāo)志著南京市浦口區(qū)與 Cadence 雙方的戰(zhàn)略投資進入實質(zhì)性階段。南京江北新區(qū)是江蘇省唯一的國家級新區(qū)，
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Cadence攜手Arm交付首個基于低功耗、高性能Arm服務(wù)器的SoC驗證解決方案
- 楷登電子(美國Cadence 公司)今日與Arm聯(lián)合發(fā)布基于Arm? 服務(wù)器的Xcelium? 并行邏輯仿真平臺，這是電子行業(yè)內(nèi)首個低功耗高性能的仿真解決方案?！ ≡谛酒圃熘?， SoC芯片功能正確性驗證占用了整個項目70%的EDA軟件使用資源，這一需求促進了數(shù)據(jù)中心的增長。運行于ARM服務(wù)器的Xcelium仿真可帶來功耗顯著降低和仿真容量的顯著提升，可執(zhí)行高吞吐和長周期測試，縮減了整個SoC驗證的時間和成本?！ ∽鳛镃adence驗證套件(Cadence&n
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