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          中芯國際采用Cadence數(shù)字流程新增高級功能
          
                                                            
            
                    	
          • 全球電子設計創(chuàng)新領先企業(yè)Cadence設計系統(tǒng)公司(NASDAQ: CDNS) 與中芯國際集成電路制造有限公司(“中芯國際”，紐約證券交易所：SMI ，香港聯(lián)交所：981)，中國內(nèi)地規(guī)模最大、技術最先進的集成電路晶圓代工企業(yè)，日前共同宣布中芯國際已采用Cadence? 數(shù)字工具流程，應用于其新款SMIC Reference Flow 5.1，一款為低功耗設計的完整的RTL-GDSII 數(shù)字流程。
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          • 關鍵字：
                        中芯國際  Cadence  晶圓                          
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          Cadence布線常見問題
          
                                                            
            
                    	
          • 1. 怎樣建立自己的元件庫?建立了一個新的project后，畫原理圖的第一步就是先建立 自己所需要的庫，所采用的工具就是part developer.  首先在建立一個存放元件庫的目錄(如mylib)，然后用寫字板打開cds.lib，定義： De
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          • 關鍵字：
                        Cadence  布線                            
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          常見硬件設計EDA工具之比較
          
                                                            
            
                    	
          • 項目中EDA工具是每個工程師必不可少的好幫手，大大加快了我們的設計進程。每一位工程師都應該掌握并熟練至少一種EDA工具的使用。在論壇里經(jīng)常能看到新手的經(jīng)典提問：我應該學習哪種畫圖工具呀?哪種畫圖工具更強大?哪種畫圖工具更好用?網(wǎng)上關于各種工具功能介紹的資料多如牛毛，EDA工具本身又包含很多版本和獨立功能的工具，初學者難免無所適從。
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          • 關鍵字：
                        EDA  PCB  Allegro  Mentor  Cadence  Altium                          
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          Cadence將分別于9月10、12日在北京和上海舉辦CDNLive 2013用戶大會
          
                                                            
            
                    	
          • 全球電子設計創(chuàng)新領先企業(yè)Cadence設計系統(tǒng)公司(NASDAQ:CDNS)將分別于9月10日、12日在北京金隅喜來登酒店和上海浦東嘉里大酒店舉辦“CDNLive用戶大會”。此會議集聚中國產(chǎn)業(yè)鏈高階主管、Cadence的技術使用者、開發(fā)者與業(yè)界專家，分享重要設計與驗證問題的解決經(jīng)驗，并為實現(xiàn)高階芯片、SoC和系統(tǒng)、IP及工具的新技術發(fā)現(xiàn)新技術。
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          • 關鍵字：
                        Cadence  SoC                          
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          華力微電子基于Cadence數(shù)字工具開發(fā)55納米參考設計流程
          
                                                            
            
                    	
          • 　　Cadence設計系統(tǒng)公司與上海華力微電子有限公司，今天共同宣布華力微電子基于Cadence Encounter數(shù)字技術交付出55納米平臺的參考設計流程。從現(xiàn)在起，華力微電子首次在其已建立的55 納米工藝平臺上實現(xiàn)了從 RTL到GDSII的完整流程，它也是Cadence與上海華力緊密合作的結果。
　　在該流程中所使用的Cadence數(shù)字工具包括RTL Compiler、Encounter Digital Implementation 系統(tǒng)、Conformal LEC、QRC Extraction、E
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          • 關鍵字：
                        Cadence  55納米                          
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          瑞昱獲授權使用Cadence Tensilica HiFi 音頻/語音DSP IP內(nèi)核
          
                                                            
            
                    	
          • 全球電子設計創(chuàng)新領先企業(yè)Cadence設計系統(tǒng)公司(NASDAQ:CDNS)日前宣布，瑞昱半導體公司(Realtek Semiconductor Corp)獲得Cadence Tensilica(Cadence? Tensilica?)授權，可使用HiFi 音頻/語音DSP(數(shù)字信號處理器)IP內(nèi)核，配合Sensory公司(IC和嵌入式軟件解決方案提供商)的TrulyHandsFree?方案一起，用以實現(xiàn)長時開啟(Always-on)語音控制與識別技術。
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          • 關鍵字：
                        Cadence  瑞昱  DSP                          
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          華力開發(fā)55納米平臺的參考設計流程
          
                                                            
            
                    	
          • 全球電子設計創(chuàng)新領先企業(yè)Cadence設計系統(tǒng)公司(NASDAQ:CDNS)與上海華力微電子有限公司，日前共同宣布華力微電子基于Cadence ? Encounter? 數(shù)字技術交付出55納米平臺的參考設計流程。從現(xiàn)在起，華力微電子首次在其已建立的55 納米工藝平臺上實現(xiàn)了從 RTL到GDSII的完整流程，它也是Cadence與上海華力緊密合作的結果。
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          • 關鍵字：
                        Cadence  華力  納米                          
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          ST、ARM和Cadence聯(lián)合向Accellera提交三個新方案
          
                                                            
                    
          
                
          
                                
          
                    
          Cadence推出用于PCIe 3.0的SpeedBridge Adapter
          
                                                            
            
                    	
          • 全球電子設計創(chuàng)新領先企業(yè)Cadence設計系統(tǒng)公司(NASDAQ:CDNS)日前宣布推出全新用于PCIe 3.0的SpeedBridge? Adapter。它為設計師們提供了一個重要的工具，來驗證和確認他們的PCI Express (PCIe) 設計。
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          • 關鍵字：
                        Cadence  PCIe  SoC                          
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          Cadence協(xié)助創(chuàng)意、聯(lián)電克服先進制程設計挑戰(zhàn)
          
                                                            
            
                    	
          • 益華電腦(Cadence Design Systems)近日宣布兩項成功合作案例，其一為設計服務業(yè)者創(chuàng)意電子(GUC)運用Cadence Encounter數(shù)位設計實現(xiàn)系統(tǒng)(Digital Implementation System，EDI)與Cadence Litho Physical Analyzer，成功地完成了20nm系統(tǒng)晶片(SoC)測試晶片的試產(chǎn)。此外晶圓代工大廠聯(lián)電(UMC)已經(jīng)采用Cadence 「設計中(in-design)」與signoff DFM (design-for-manufa
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          • 關鍵字：
                        Cadence  制程設計                          
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          聯(lián)華28納米節(jié)點采用Cadence物理和電學制造性設計簽收解決方案
          
                                                            
            
                    	
          • 全球電子設計創(chuàng)新領先企業(yè)Cadence設計系統(tǒng)公司(NASDAQ:CDNS)日前宣布，歷經(jīng)廣泛的基準測試后，半導體制造商聯(lián)華電子(NYSE：UMC;TWSE：2303)(UMC)已采用Cadence? “設計內(nèi)”和“簽收”可制造性設計(DFM)流程對28納米設計進行物理簽收和電學變量優(yōu)化。
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          • 關鍵字：
                        聯(lián)華電子  Cadence  DFM                          
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          Cadence采用全新可支持電學感知設計的Virtuoso版圖套件
          
                                                            
            
                    	
          • 全球電子設計創(chuàng)新領先企業(yè)Cadence設計系統(tǒng)公司(NASDAQ:CDNS) 日前宣布推出用于實現(xiàn)電學感知設計的Virtuoso?版圖套件，它是一種開創(chuàng)性的定制設計方法，能提高設計團隊的設計生產(chǎn)力和定制IC的電路性能。
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          • 關鍵字：
                        Cadence  Virtuoso  EAD                          
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          臺積電TSMC擴大與Cadence在Virtuoso定制設計平臺的合作
          
                                                            
            
                    	
          • 為專注于解決先進節(jié)點設計的日益復雜性，全球電子設計創(chuàng)新領先企業(yè)Cadence設計系統(tǒng)公司(NASDAQ:CDNS) 日前宣布，臺積電已與Cadence在Virtuoso定制和模擬設計平臺擴大合作以設計和驗證其尖端IP。
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          • 關鍵字：
                        Cadence  Virtuoso  臺積  PDKs                          
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          Cadence解決方案助力創(chuàng)意電子20納米SoC測試芯片成功流片
          
                                                            
            
                    	
          • 全球電子設計創(chuàng)新領先企業(yè)Cadence設計系統(tǒng)公司(NASDAQ:CDNS) 日前宣布，設計服務公司創(chuàng)意電子(GUC)使用Cadence? Encounter?數(shù)字實現(xiàn)系統(tǒng)(EDI)和Cadence光刻物理分析器成功完成20納米系統(tǒng)級芯片(SoC)測試芯片流片。雙方工程師通過緊密合作，運用Cadence解決方案克服實施和可制造性設計(DFM)驗證挑戰(zhàn)，并最終完成設計。
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          • 關鍵字：
                        Cadence  DFM                          
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          Cadence解決方案助力創(chuàng)意電子20納米SoC測試芯片成功流片
          
                                                            
            
                    	
          • 　　Cadence Encounter數(shù)字實現(xiàn)系統(tǒng)與Cadence光刻物理分析器
　　可降低風險并縮短設計周期
　　全球電子設計創(chuàng)新領先企業(yè)Cadence設計系統(tǒng)公司(NASDAQ:CDNS) 今天宣布，設計服務公司創(chuàng)意電子(GUC)使用Cadence? Encounter?數(shù)字實現(xiàn)系統(tǒng)(EDI)和Cadence光刻物理分析器成功完成20納米系統(tǒng)級芯片(SoC)測試芯片流片。雙方工程師通過緊密合作，運用Cadence解決方案克服實施和可制造性設計(DFM)驗證挑戰(zhàn)，并最終完成設計。
　　在開發(fā)過程中
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          • 關鍵字：
                        Cadence  20納米  SoC                          
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