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fpga soc 文章進入fpga soc技術社區(qū)

Arteris推出NCore cache一致性互連IP (cache coherence)用于異構多核SoC的高效率設計

　　Arteris公司今天宣布推出1.5版本NCore cache一致性互連IP。Arteris公司是從事系統(tǒng)級芯片(SoC)互連IP的創(chuàng)新性供應商，它的商用系統(tǒng)級芯片NoC互連IP已經廣泛被采用。NCore IP是分散式異構cache一致性互連解決方案，系統(tǒng)設計師可以用它高效率地設計出cache一致性的系統(tǒng)，它的優(yōu)點是具有多個可配置的Snoop Filter和嵌入式高速緩存(cache)。在今天的SoC設計中通常使用傳統(tǒng)固定式或集中式cache一致性式互連，與之相比，NCo
關鍵字： Arteris SoC

Arteris以分散式、可配置半導體架構重新定義異構多核高速緩存一致性(Cache Coherence)

　　Arteris公司是商用系統(tǒng)級芯片(SoC)互連IP的創(chuàng)新性供應商，今天宣布推出一種半導體設計技術，在用不同供應商的IP設計出高速緩存一致性(Cache Coherent)高效率系統(tǒng)時，它提高了系統(tǒng)級芯片設計師的設計能力。利用這項新技術，推出了業(yè)界第一個分散式、異構高速緩存一致性(Cache Coherence)互連，幫助設計人員實現(xiàn)更高的頻率，更低的功耗，高效率地生產有特色的系統(tǒng)級芯片，縮短產品進入市場的時間。這種系統(tǒng)級芯片跨越多個設計領域，如移動設備、高清晰度電視、企業(yè)級存儲、
關鍵字： Arteris SoC

萊迪思半導體針對工業(yè)市場提供增強的視頻橋接解決方案

　　萊迪思半導體公司，客制化智能互連解決方案市場的領先供應商，今日宣布針對工業(yè)市場推出19款HDMI?產品。HDMI發(fā)送器、接收器、端口處理器和視頻處理器套件保證了無縫的“即插即用”連接，超越了傳統(tǒng)消費電子和移動應用。　　視頻應用在整個工業(yè)產品市場普遍存在，在今天的智能自動化系統(tǒng)中扮演著重要的角色。萊迪思提供了一系列可編程器件，滿足工業(yè)環(huán)境和長時間工作的要求，同時保持連續(xù)工作和無與倫比的可靠性。隨著HDMI產品的加入，萊迪思可以幫助制造商解決關鍵橋接問題或實現(xiàn)視頻處理功能，增強了人機界面、安全監(jiān)控以及數字
關鍵字：萊迪思 FPGA

揭開全球第一大企業(yè)安全廠商IBM的面紗

　　今年2月底，一個收購消息在國外安全社區(qū)開始傳播。IBM Security 正在收購網絡安全應急響應公司 Resilient Systems，據知情人士透露，收購價約為1億美金。　　實際上，自從 IBM Security 在2012年正式建立之后，連續(xù)收購了Trusteer(10億美金)、CrossIdeas和Lighthouse三家安全公司。而且IBM安全正式成立之前，IBM還收購了包括Q1 Labs、Algorithmics、BigFix、Guardium、Watchfire、Consul R
關鍵字： IBM SOC

話說單片機應用系統(tǒng)硬件電路設計

　　一個單片機應用系統(tǒng)的硬件電路設計包含兩部分內容：一是系統(tǒng)擴展，即單片機內部的功能單元，如ROM、RAM、I/O、定時器/計數器、中斷系統(tǒng)等不能滿足應用系統(tǒng)的要求時，必須在片外進行擴展，選擇適當的芯片，設計相應的電路。二是系統(tǒng)的配置，即按照系統(tǒng)功能要求配置外圍設備，如鍵盤、顯示器、打印機、A/D、D/A轉換器等，要設計合適的接口電路?！　∠到y(tǒng)的擴展和配置應遵循以下原則：　　1、盡可能選擇典型電路，并符合單片機常規(guī)用法。為硬件系統(tǒng)的標準化、模塊化打下良好的基礎?！　?、系統(tǒng)擴展與外圍設備的配置水平應充分滿
關鍵字：單片機 SoC

Altera發(fā)布Quartus Prime Pro設計軟件，加速大容量FPGA設計

　　Altera，現(xiàn)在已屬英特爾公司，今天發(fā)布新的產品版Quartus? Prime Pro設計軟件，進一步提高了FPGA設計性能和設計團隊的效率。Quartus Prime Pro軟件設計用于支持英特爾下一代高度集成的大容量FPGA，這將推動云計算、數據中心、物聯(lián)網及其連網等領域的創(chuàng)新。內置在最新版軟件中的功能前所未有的縮短了編譯時間，提供通用設計輸入方法，簡化了知識產權(IP)的集成，從而加速了大規(guī)模FPGA設計流程?！　∮⑻貭柕腇PGA軟件和IP市場營銷總監(jiān)B
關鍵字： Altera FPGA

【E課題】FPGA/CPLD數字電路原理介紹

　　當產生門控時鐘的組合邏輯超過一級時，證設計項目的可靠性變得很困難。即使樣機或仿真結果沒有顯示出靜態(tài)險象，但實際上仍然可能存在著危險。通常，我們不應該用多級組合邏輯去鐘控PLD設計中的觸發(fā)器?！　D1給出一個含有險象的多級時鐘的例子。時鐘是由SEL引腳控制的多路選擇器輸出的。多路選擇器的輸入是時鐘(CLK)和該時鐘的2分頻 (DIV2)。由圖1的定時波形圖看出，在兩個時鐘均為邏輯1的情況下，當SEL線的狀態(tài)改變時，存在靜態(tài)險象。險象的程度取決于工作的條件。多級邏輯的險象是可以去除的
關鍵字： FPGA CPLD

市場勢態(tài)加速增長中國內FPGA產業(yè)如何實現(xiàn)騰飛？

FPGA是一個需要長期積累的過程，而FPGA是為特殊需要而生的，注定無法是大眾的，產業(yè)細分才是王道。
關鍵字： FPGA 京微雅格

老杳:從京微雅格“倒閉”看國家經費的走向

業(yè)內有些公司套取政府資金上癮了，公司就是公司，少拿自主創(chuàng)新說事，更不要打著民族的名義要錢。
關鍵字：京微雅格 FPGA

【E課堂】verilog之可綜合與不可綜合

　　可綜合的意思是說所編寫的代碼可以對應成具體的電路，不可綜合就是所寫代碼沒有對應的電路結構，例如行為級語法就是一種不可綜合的代碼，通常用于寫仿真測試文件。　　建立可綜合模型時，需注意以下幾點：　　不使用initial　　不使用#10之類的延時語句　　不使用循環(huán)次數不確定的循環(huán)語句，如forever，while等　　不使用用戶自定義原語(UDP元件)　　盡量使用同步方式設計電路　　用always塊來描述組合邏輯時，應列出所有輸入信號作為敏感信號列表，即always@(*)　　所有的內部寄存器都應該能夠被復
關鍵字： verilog FPGA

Altera設計解決方案網絡連接客戶和專家，助力客戶基于FPGA的設計創(chuàng)新

　　Altera，現(xiàn)在已屬英特爾公司，今天宣布啟動其設計解決方案網絡(DSN，Design Solutions Network)，這一全球輔助支持系統(tǒng)將穩(wěn)健的設計服務網絡、IP、電路板和商用現(xiàn)貨產品(COTS)公司合并到一個計劃中。DSN計劃將客戶與網絡成員連接起來，通過統(tǒng)一的搜索網站，為他們提供Altera CPLD、FPGA、SoC和Enpirion?電源器件相關的產品或者設計服務，幫助客戶加速產品創(chuàng)新，網站位于www.altera.com.cn/dsn?！　ntel可
關鍵字： Altera FPGA

通信基帶成SoC核心競爭力高通/海思/三星各有法寶

通信基帶才是SoC能在市場上能脫穎而出的制勝法寶，擁有基帶的廠商在競爭中的優(yōu)勢不言而喻，手機廠商們在選擇SoC方案時必然要考慮這方面的因素，而活到今天依然滋潤的芯片廠商大都也是擁有基帶的廠商。
關鍵字： SoC 基帶

MCU/SoC助力本土車企追趕世界

智能互聯(lián)和自動駕駛是未來汽車產業(yè)的一個大的趨勢，其中安全問題和汽車圖像處理問題變得尤為重要。瑞薩電子面對這一趨勢會有怎樣的對策呢?又將怎樣看待中國的汽車電子業(yè)?
關鍵字： MCU/SoC 智能互聯(lián) 自動駕駛趙明宇 201605

Mentor Graphics硬件加速仿真服務使用Veloce硬件加速仿真平臺加速驗證

　　Mentor Graphics公司今日宣布，Mentor® 硬件加速仿真服務采用具有專業(yè)服務和 IP 的 Veloce® 硬件加速仿真平臺，借此加速仿真驗證并降低與片上系統(tǒng) (SoC) 設計相關的風險。對于選擇日后購買或已擁有 Veloce 平臺并需要額外短期容量的公司而言，Mentor 硬件加速仿真服務為其提供了能滿足其迫切需求的 Veloce 硬件加速仿真平臺。　　國際汽車供應商 Continental 采用 Mentor 硬件加速仿真服務驗證復雜的 SoC，最終如期一次性通
關鍵字： Mentor Graphics SoC

數字電路(fpga/asic)設計入門之靜態(tài)時序分析

　　靜態(tài)時序分析簡稱STA(Static Timming Analysis)，它提供了一種針對大規(guī)模門級電路進行時序驗證的有效方法。它指需要更具電路網表的拓撲，就可以檢查電路設計中所有路徑的時序特性，測試電路的覆蓋率理論上可以達到100%，從而保證時序驗證的完備性;同時由于不需要測試向量，所以STA驗證所需時間遠小于門級仿真時間。但是，靜態(tài)時序分析也有自己的弱點，它無法驗證電路功能的正確性，所以這一點必須由RTL級的功能仿真來保證，門級網表功能的正確性可以用門級仿真技術，也可以用后面講到的形式驗證技術。值
關鍵字： fpga asic 靜態(tài)時序

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fpga soc介紹

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fpga soc電路

利用FPGA資源和最小模擬電路發(fā)電進行開關電源設計的方法
基于FPGA的機載顯示系統(tǒng)架構設計與優(yōu)化
基于FPGA+DSP遠程監(jiān)控器設計與實現(xiàn)
基于FPGA的LCD顯示遠程更新

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