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fpga+arm 文章 進(jìn)入fpga+arm技術(shù)社區(qū)
一種混合結(jié)構(gòu)高速LDPC編碼器的FPGA實(shí)現(xiàn)
- 分析了準(zhǔn)循環(huán)低密度奇偶校驗(yàn)碼生成矩陣的結(jié)構(gòu)特點(diǎn),討論了硬件可實(shí)現(xiàn)的三種常見(jiàn)編碼器結(jié)構(gòu),提出了一種混合結(jié)構(gòu)的FPGA實(shí)現(xiàn)方法。通過(guò)利用循環(huán)矩陣的結(jié)構(gòu)特性,增加少量硬件開(kāi)銷(xiāo),就可以實(shí)現(xiàn)編碼器高速編碼,滿足高速通信需求,吞吐量達(dá)1.36Gb/s。
- 關(guān)鍵字: 奇偶校驗(yàn)碼 循環(huán)矩陣 FPGA
SRAM型FPGA單粒子效應(yīng)試驗(yàn)研究
- 針對(duì)軍品級(jí)SRAM型FPGA的單粒子效應(yīng)特性,文中采用重離子加速設(shè)備,對(duì)Xilinx公司Virtex-II系列可重復(fù)編程FPGA中一百萬(wàn)門(mén)的XQ2V1000進(jìn)行輻射試驗(yàn)。試驗(yàn)中,被測(cè)FPGA單粒子翻轉(zhuǎn)采用了靜態(tài)與動(dòng)態(tài)兩種測(cè)試方式。并且通過(guò)單粒子功能中斷的測(cè)試,研究了基于重配置的單粒子效應(yīng)減緩方法。試驗(yàn)發(fā)現(xiàn)被測(cè)FPGA對(duì)單粒子翻轉(zhuǎn)與功能中斷都較為敏感,但是在注入粒子LET值達(dá)到42MeV.cm2/mg時(shí)仍然對(duì)單粒子鎖定免疫。
- 關(guān)鍵字: 單粒子效應(yīng) 重離子加速設(shè)備 FPGA
基于FPGA的LCoS顯示驅(qū)動(dòng)系統(tǒng)的設(shè)計(jì)與實(shí)現(xiàn)
- 研究了硅基液晶(LCoS)場(chǎng)序彩色顯示驅(qū)動(dòng)系統(tǒng)的設(shè)計(jì)與實(shí)現(xiàn).該系統(tǒng)以FPGA作為主控芯片,用兩片高速DDR2 SDRAM作為幀圖像存儲(chǔ)器.通過(guò)對(duì)圖像數(shù)據(jù)以幀為單位進(jìn)行處理,系統(tǒng)將并行輸入的紅、綠、藍(lán)數(shù)據(jù)轉(zhuǎn)換成申行輸出的紅、綠、藍(lán)單色子幀.將該驅(qū)動(dòng)系統(tǒng)與投影光機(jī)配合,實(shí)現(xiàn)了分辨率為800×600的LCoS場(chǎng)序彩色顯示.
- 關(guān)鍵字: 硅基液晶 DDR FPGA
基于FPGA的平方根升余弦濾波器設(shè)計(jì)
- 為了滿足陸上集群無(wú)線電(TETRA)數(shù)字集群系統(tǒng)對(duì)基帶信號(hào)成形處理的要求,提出了一種用于TETRA數(shù)字集群系統(tǒng)的平方根升余弦(SRRC)濾波器設(shè)計(jì),論述了基帶成形濾波和SRRC濾波器的基本原理,分析了窄帶調(diào)制帶寬限制、TETRA鄰道干擾限制和濾波器階數(shù)等需解決的問(wèn)題,論述了濾波器參數(shù)設(shè)計(jì)和FIR濾波器FPGA實(shí)現(xiàn)等關(guān)鍵技術(shù),完成了對(duì)基于FPGA的SRRC濾波器設(shè)計(jì)的仿真分析。
- 關(guān)鍵字: 數(shù)字集群系統(tǒng) 基帶信號(hào) FPGA
基于FPGA圖形字符加速的液晶顯示模塊
- 在傳統(tǒng)的工業(yè)控制應(yīng)用中,由于工業(yè)控制計(jì)算機(jī)中集成了高性能的顯卡,故通常采用工業(yè)控制計(jì)算機(jī)+液晶顯示器的體系結(jié)構(gòu),可方便地實(shí)現(xiàn)以圖形和字符為主的人機(jī)界面。而在對(duì)實(shí)時(shí)性能和可靠性要求比較高的航空航天領(lǐng)域,通常要求液晶顯示器內(nèi)部集成圖形顯示功能,以減輕主控處理器的負(fù)擔(dān),并提高系統(tǒng)的實(shí)時(shí)性。重點(diǎn)介紹了如何利用FPGA實(shí)現(xiàn)基于Bresenham算法的2D圖形繪制(包括畫(huà)點(diǎn)、畫(huà)線、畫(huà)圓、畫(huà)橢圓),以及點(diǎn)陣字符和位圖在液晶屏上的顯示,并提出了顯示性能優(yōu)化的一系列策略。
- 關(guān)鍵字: 圖形顯示 2D圖形繪制 FPGA
基于FPGA的簡(jiǎn)易微機(jī)的結(jié)構(gòu)分析與實(shí)現(xiàn)
- 微型計(jì)算機(jī)的原理及結(jié)構(gòu)一般不易理解掌握,利用FPGA來(lái)學(xué)習(xí)并構(gòu)建一個(gè)簡(jiǎn)易微型計(jì)算機(jī)無(wú)疑是一個(gè)好方法,對(duì)EDA的軟硬件學(xué)習(xí)也是一個(gè)不錯(cuò)的選擇,可為將來(lái)進(jìn)行相關(guān)ASIC沒(méi)計(jì)打下良好的基礎(chǔ)。
- 關(guān)鍵字: 微型計(jì)算機(jī) FPGA EDA
基于FPGA的AVS解碼芯片驗(yàn)證平臺(tái)
- 針對(duì)AVS視頻解碼芯片仿真和驗(yàn)證的要求,提出了基于FPGA的驗(yàn)證平臺(tái)框架。該驗(yàn)證平臺(tái)主要用于對(duì)AVS解碼芯片進(jìn)行硬件模塊的驗(yàn)證,從而為整個(gè)視頻解碼芯片的開(kāi)發(fā)提供可靠的依據(jù)。該平臺(tái)基于Nios II軟核處理器,可使軟件模塊和硬件模塊在一個(gè)平臺(tái)下真正實(shí)現(xiàn)軟硬件協(xié)同工作?;谠撈脚_(tái)實(shí)現(xiàn)了多個(gè)硬件模塊和AVS視頻解碼芯片的驗(yàn)證,其結(jié)果證明了該驗(yàn)證平臺(tái)的正確性和可靠性。
- 關(guān)鍵字: 視頻解碼 驗(yàn)證平臺(tái) FPGA
基于FPGA的高精度時(shí)間數(shù)字轉(zhuǎn)換電路的設(shè)計(jì)與實(shí)現(xiàn)
- 本文介紹一種基于 FPGA高精度時(shí)間數(shù)字轉(zhuǎn)換電路的設(shè)計(jì)方法,利用片內(nèi)鎖相環(huán)(PLL)和環(huán)形移位寄存器,采用不高的系統(tǒng)時(shí)鐘便可得到很高的時(shí)間分辨率,且占用較少邏輯資源。可作為功能電路獨(dú)立使用,也可作為 IP核方便地移植到其他片上系統(tǒng)(SOC)中。在 Altera公司的 Stratix和 Cyclone系列芯片上實(shí)現(xiàn)時(shí),時(shí)間分辨率昀高可達(dá) 3.3ns。時(shí)序仿真和硬件測(cè)試表明該方法的可行性和準(zhǔn)確性。
- 關(guān)鍵字: 時(shí)間數(shù)字轉(zhuǎn)換電路 激光探測(cè) FPGA
量程自整定高精度頻率測(cè)量的FPGA實(shí)現(xiàn)
- 數(shù)字頻率計(jì)是一種應(yīng)用十分廣泛的電子測(cè)量?jī)x表,針對(duì)寬頻率范圍被測(cè)信號(hào)頻率測(cè)量應(yīng)用需求,提出并實(shí)現(xiàn)了一種基于FPGA的自動(dòng)量程切換高精度數(shù)字頻率計(jì)的設(shè)計(jì)方法。通過(guò)構(gòu)建測(cè)頻控制器、閘門(mén)同步生成器、量程自動(dòng)切換等模塊,并采用Verilog HDL語(yǔ)言進(jìn)行描述,運(yùn)用自頂向下的數(shù)字系統(tǒng)設(shè)計(jì)方法實(shí)現(xiàn)了寬頻率范圍頻率測(cè)量的量程自動(dòng)切換。在Xilinx公司的XUPV5-LX110T開(kāi)發(fā)板上進(jìn)行了測(cè)試,給出了系統(tǒng)后仿真波形。結(jié)果表明目標(biāo)系統(tǒng)能根據(jù)被測(cè)信號(hào)頻率范圍進(jìn)行自動(dòng)量程切換,實(shí)現(xiàn)高精度頻率測(cè)量,測(cè)量精度不低于10-7,
- 關(guān)鍵字: 數(shù)字頻率計(jì) 自動(dòng)量程切換 FPGA
一種基于FPGA的雷達(dá)回波實(shí)時(shí)模擬器的實(shí)現(xiàn)
- 提出了一種基于FPGA的雷達(dá)回波實(shí)時(shí)模擬器的實(shí)現(xiàn)方法。該模擬器采用cPCI標(biāo)準(zhǔn)總線,以FPGA為核心計(jì)算單元,配有高速數(shù)模、模數(shù)轉(zhuǎn)換模塊,可實(shí)現(xiàn)雷達(dá)回波信號(hào)實(shí)時(shí)在線注入模擬。該模擬器可實(shí)現(xiàn)多種體制下復(fù)雜回波的模擬,具有很好的工程應(yīng)用價(jià)值。
- 關(guān)鍵字: 雷達(dá)回波實(shí)時(shí)模擬器 半實(shí)物仿真 FPGA
基于FPGA的嵌入式圖像采集系統(tǒng)設(shè)計(jì)
- 介紹了以FPGA為核心的邏輯控制模塊的數(shù)據(jù)采集系統(tǒng)的設(shè)計(jì)可以滿足實(shí)時(shí)性要求,設(shè)計(jì)中采用自頂向下的設(shè)計(jì)方法,根據(jù)不同的功能將整個(gè)系統(tǒng)劃分為若干模塊進(jìn)行設(shè)計(jì),并介紹了每個(gè)模塊的功能和實(shí)現(xiàn)方法。在設(shè)計(jì)中采用VHDL語(yǔ)言對(duì)各個(gè)模塊進(jìn)行描述。視頻解碼芯片采用Philips公司的SAA7113H,該芯片通過(guò)I2C總線協(xié)議進(jìn)行配置。實(shí)驗(yàn)表明,設(shè)計(jì)可以滿足圖像采集實(shí)時(shí)性的要求。
- 關(guān)鍵字: I2C總線 圖像處理 FPGA
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