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          Tensilica 新處理器IP主打數(shù)據(jù)平面和信號處理

          •   Tensilica今天驕傲地宣布以其面向密集計算數(shù)據(jù)平面和DSP(數(shù)據(jù)信號處理器)如成像、視頻、網(wǎng)絡(luò)和有線/無線基帶通信的處理器IP鞏固了其在IP內(nèi)核領(lǐng)域的領(lǐng)導(dǎo)者地位,任何需要龐大數(shù)據(jù)處理的應(yīng)用都將極大都受益于這些突破性功能――通過內(nèi)建Tensilica面向SOC的Xtensa® LX4數(shù)據(jù)平面處理器(DPU)可以將這些應(yīng)用數(shù)據(jù)帶寬提高4倍!   新的Xtensa LX4 DPU支持更高的本地數(shù)據(jù)存儲位寬,最高到每周期1024比特,支持更寬的128位VLIW(超長指令字)指令,從而提高指
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          萊迪思和HELION TECHNOLOGY發(fā)布了適用于LatticeECP3 FPGA系列的壓縮和加密IP核

          •   萊迪思半導(dǎo)體公司和Helion Technology今日宣布一系列適用于LatticeECP3 FPGA系列的壓縮和加密的IP核現(xiàn)已上市。該系列具有有效載荷壓縮系統(tǒng)核,提高了有限信道帶寬的利用率,因此非常適合微波回程應(yīng)用、寬帶無線接入適用于802.16e(WiMAX)以及潛在的其他多鏈路多輸入-多輸出(MIMO)應(yīng)用中的使用。在LatticeECP3器件中,IP核可以從500Mbps無縫擴展至超過3Gbps,并可用于典型的網(wǎng)絡(luò)應(yīng)用中的第2層或第3層。IP核采用了非常強大和成熟的LZRW無損壓縮算法,它
          • 關(guān)鍵字: 萊迪思  FPGA  

          Altera、Apical和AltaSens聯(lián)合發(fā)布HD寬動態(tài)范圍視頻監(jiān)控芯片組

          •   延續(xù)其在高清晰(HD)寬動態(tài)范圍(WDR)監(jiān)控攝像機解決方案上的領(lǐng)先優(yōu)勢,Altera公司、Apical有限公司(UK)以及AltaSens有限公司今天宣布,開始提供業(yè)界第一款HD WDR視頻監(jiān)控芯片組。這一獨特的芯片組結(jié)合了Altera Cyclone® IV E FPGA和安全芯片,支持Apical的HD WDR全圖像信號處理(ISP)流水線IP和AltaSens的1080p60 A3372E3-4T圖像傳感器。這一獨特的解決方案能夠方便的使用Apical IP,降低了用戶在全傳感器處理解
          • 關(guān)鍵字: Altera  視頻監(jiān)控  FPGA  

          基于FPGA的多路圖像采集系統(tǒng)的軟件設(shè)計

          • 摘要:分析了現(xiàn)有的視頻采集方案的研究現(xiàn)狀,對如何采用CCD攝像頭采集多通道、高分辨率、高質(zhì)量的圖像以及基于FPGA的嵌入式圖像采集系統(tǒng)的實現(xiàn)方法做了研究。與傳統(tǒng)圖像采集系統(tǒng)相比,該系統(tǒng)主要利用四片視頻解碼芯片
          • 關(guān)鍵字: FPGA  多路  圖像采集系統(tǒng)  軟件設(shè)計    

          基于FPGA的空間目標碰撞預(yù)警系統(tǒng)

          • 摘要:為了解決空間目標與航天器發(fā)生碰撞的問題,設(shè)計了一種基于FPGA,以在軌目標三維坐標為待處理數(shù)據(jù)進行快速并行處理的目標碰撞預(yù)警系統(tǒng)。該系統(tǒng)基于Xilinx公司FPGA芯片中的內(nèi)容可尋址存儲器(Content Addressable
          • 關(guān)鍵字: FPGA  目標碰撞  預(yù)警系統(tǒng)    

          寬帶數(shù)字信道化接收機的FPGA實現(xiàn)

          • 摘要:為解決現(xiàn)代電子戰(zhàn)對接收機處理帶寬寬、靈敏度高及實時性處理的要求,提出一種數(shù)字信道化接收機的設(shè)計方法。在推導(dǎo)高效信道化接收機模型的基礎(chǔ)上,采用多相濾波器結(jié)構(gòu)實現(xiàn)的數(shù)字信道化接收機。該接收機利用超高
          • 關(guān)鍵字: FPGA  寬帶  接收機  數(shù)字信道化    

          基于FPGA的ARINC429通信協(xié)議設(shè)計實現(xiàn)

          • 摘要:介紹了在FPGA上利用SoPC技術(shù)設(shè)計實現(xiàn)某機載數(shù)據(jù)傳榆設(shè)備與機載專用計算機進行通信的ARINC429通信協(xié)議,實現(xiàn)了對ARINC429數(shù)據(jù)的一發(fā)一收。該系統(tǒng)模塊充分利用了FPGA硬件可編程性、高度集成性、實時性的特點。測
          • 關(guān)鍵字: 設(shè)計  實現(xiàn)  協(xié)議  通信  FPGA  ARINC429  基于  

          具有多個電壓軌的FPGA和DSP電源設(shè)計實例

          • 大多數(shù)電子產(chǎn)品由于包含一個或多個FPGA或DSP數(shù)字處理芯片而需要提供多個電源軌。在為這些數(shù)字IC供電時,有多種方案可以選擇,也有許多潛在的陷阱需要避免。在“具有多個電壓軌的FPGA和DSP應(yīng)用的電源設(shè)計方法rd
          • 關(guān)鍵字: 電源  設(shè)計  實例  DSP  FPGA  多個  電壓  具有  

          基于DSP和OZ890 的電池管理系統(tǒng)設(shè)計

          • 摘要:本文從設(shè)計要求和功能出發(fā),設(shè)計了一種用于混合動力汽車的電池管理系統(tǒng)。其中硬件系統(tǒng)包括:電源模塊、基于OZ890 的單體電壓采集電路和I2C 通信電路、基于DSP 的RS232
            串口通信和CAN 通信等硬件系統(tǒng)的設(shè)計;軟
          • 關(guān)鍵字: DSP  890  OZ  電池管理    

          基于FPGA的DES、3DES硬件加密技術(shù)

          • 基于FPGA的DES、3DES硬件加密技術(shù),傳統(tǒng)的加密工作是通過在主機上運行加密軟件實現(xiàn)的。這種方法除占用主機資源外,運算速度較慢,安全性也較差。而硬件加密是通過專用加密芯片、FPGA芯片或獨立的處理芯片等實現(xiàn)密碼運算。相對于軟件加密,硬件加密具有
          • 關(guān)鍵字: 加密  技術(shù)  硬件  3DES  FPGA  DES  基于  

          一種密鑰可配置的DES加密算法的FPGA

          基于DSP離散頻率編碼雷達信號的實現(xiàn)

          • 基于DSP離散頻率編碼雷達信號的實現(xiàn),摘要:離散頻率編碼序列集合是一種具有良好自相關(guān)和互相關(guān)性的正交編碼波形序列集合,其信號可以提升網(wǎng)狀多雷達系統(tǒng)的目標搜索能力、追蹤與識別能力。為了設(shè)計這種信號,需要求解NP-難的組合優(yōu)化問題,且考慮到DSP的
          • 關(guān)鍵字: 雷達  信號  實現(xiàn)  編碼  頻率  DSP  離散  基于  

          基于DSP技術(shù)的雙電源自動轉(zhuǎn)換控制器的設(shè)計

          • 隨著國民經(jīng)濟的迅速發(fā)展,人們對供電連續(xù)性、可靠性的要求越來越高,研究能夠精確檢測電源狀態(tài),實時控制兩路電源可靠安全轉(zhuǎn)換,結(jié)構(gòu)簡單的雙電源供電系統(tǒng)是十分緊迫和必要的。本文提出一種新型雙電源供電系統(tǒng)控制器的設(shè)計方案,該控制器采用高性能處理器TMS320F2812作為主控芯片,通過信號采集和處理電路對常用和備用電源的狀態(tài)進行實時檢測和實時控制,實現(xiàn)對負載的連續(xù)供電。
          • 關(guān)鍵字: 轉(zhuǎn)換  控制器  設(shè)計  自動  電源  DSP  技術(shù)  基于  

          基于DSP TMS 3 2 0F2 8 1 2的智能接口板設(shè)計

          • 基于DSP TMS 3 2 0F2 8 1 2的智能接口板設(shè)計,本文介紹了一種基于TI公司高性能DSP TMS320F2812的智能接口板設(shè)計,主要包括處理器及存儲器電路設(shè)計、復(fù)位時鐘電路設(shè)計、接口設(shè)計等內(nèi)容。具有成本低、通用性強、設(shè)計難度低、開發(fā)周期短的優(yōu)點,在數(shù)據(jù)處理系統(tǒng)設(shè)計中具有典型性和實用性。
          • 關(guān)鍵字: 接口  設(shè)計  智能  0F2  DSP  TMS  基于  

          基于FPGA的步進電機控制器研究和實現(xiàn)

          • 摘要:步進電機是一種將電脈沖轉(zhuǎn)化為角位移的執(zhí)行機構(gòu),已廣泛應(yīng)用于各種自動化控制系統(tǒng)中。為了提高對步進電機的細分要求,提出了基于FPGA控制的步進電機控制器方案。給出了用VHDL語言層次化設(shè)計各功能模塊的過程,
          • 關(guān)鍵字: FPGA  步進電機  控制器    
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