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基于FPGA的SoC/IP驗證平臺的設計與應用
- SoC是大規(guī)模集成電路的發(fā)展趨勢。SoC設計必須依靠完整的系統(tǒng)級驗證來保證其正確性?；贔PGA的驗證平臺能夠縮短SoC驗證時間，并提高驗證工作的可靠性，還具有可重用性。本文利用Altera公司的FPGA設計了一個基于片上總線的SoC原型驗證平臺，并將VxWorks嵌入式操作系統(tǒng)應用于此平臺，通過軟硬件協(xié)同驗證的方法，驗證了平臺的可靠性。該平臺在CF卡及通用智能卡SoC芯片驗證中得以應用。
- 關鍵字： SoC驗證平臺 系統(tǒng)級驗證 FPGA
基于FPGA實現(xiàn)CPCI數(shù)據(jù)通信
- 本文設計的系統(tǒng)采用PLX公司生產(chǎn)的CPCI協(xié)議轉換芯片PCI9054，通過Verilog HDL語言在FPGA中產(chǎn)生相應的控制信號，完成對數(shù)據(jù)的快速讀寫，從而實現(xiàn)了與CPCI總線的高速數(shù)據(jù)通信。
- 關鍵字： CPCI協(xié)議轉換 Verilog FPGA
基于FPGA的主從式高速數(shù)據(jù)采集與傳輸系統(tǒng)
- 針對數(shù)據(jù)采集系統(tǒng)有信號形式多樣、實時傳輸和靈活配置的要求，介紹了一種基于FPGA的數(shù)據(jù)采集和傳輸系統(tǒng)，以及系統(tǒng)數(shù)字電路的程序設計。該系統(tǒng)以現(xiàn)場可編程邏輯陣列（FPGA）作為數(shù)據(jù)采集、預處理、組幀和傳輸?shù)目刂坪诵模ㄟ^低速串口接收控制命令，以高速USB接口向控制臺發(fā)送采集數(shù)據(jù)幀，設計了數(shù)字FIR濾波器濾除采集電路的信號干擾。
- 關鍵字： 數(shù)字FIR濾波器 數(shù)據(jù)采集系統(tǒng) FPGA
針對FPGA優(yōu)化的高分辨率時間數(shù)字轉換陣列電路
- 介紹一種針對FPGA優(yōu)化的時間數(shù)字轉換陣列電路。利用FPGA片上鎖相環(huán)對全局時鐘進行倍頻與移相，通過時鐘狀態(tài)譯碼的方法解決了FPGA中延遲的不確定性問題，完成時間數(shù)字轉換的功能。
- 關鍵字： 時間數(shù)字轉換 鎖相環(huán) FPGA
多項式擬合在log-add算法單元中的應用及其FPGA實現(xiàn)
- 綜合考慮面積和速度等因素，采用一次多項式擬合實現(xiàn)了簡單快速的log-add算法單元。實驗結果表明，在相同的精度要求下，其FPGA實現(xiàn)資源占用合理，硬件開銷好于其他次數(shù)的多項式擬合實現(xiàn)方案。
- 關鍵字： log-add算法單元 多項式擬合 FPGA
Canny算法的改進及FPGA實現(xiàn)
- 通過對傳統(tǒng)Canny邊緣檢測算法的分析提出了相應的改進方法。通過模板代替卷積、適當?shù)慕谱儞Q、充分利用并行處理單元等使其能夠用FPGA實現(xiàn)。
- 關鍵字： Canny邊緣檢測算法 卷積 FPGA
基于FPGA的三相PWM發(fā)生器
- 介紹了基于FPGA設計的三相PWM發(fā)生器。該發(fā)生器具有靈活和可編程等優(yōu)點,可應用于交流電機驅動用的三相電壓源逆變器。實驗結果驗證了本設計的有效性。
- 關鍵字： PWM發(fā)生器 三相逆變器 FPGA
獨立式多分辨率VGA/DVI壓縮存儲系統(tǒng)
- 一種獨立式多分辨率VGA/DVI壓縮存儲系統(tǒng)，該系統(tǒng)支持VGA/DVI輸入，同時支持SVGA、XGA、SXGA、UXGA、1080p等任意分辨率圖像的連續(xù)壓縮和存儲。在100 MHz時鐘頻率下，系統(tǒng)可以對圖像SXGA和UXGA實時壓縮為(25幀/s)和(17幀/s)。實驗表明，在不同碼率下，系統(tǒng)的單幀圖像壓縮性能與JPEG2000標準近似，PSNR值優(yōu)于JPEG標準。
- 關鍵字： VGA/DVI壓縮存儲系統(tǒng) 圖像壓縮 FPGA
SAR高速海量數(shù)據(jù)存儲與回放系統(tǒng)設計
- 為了解決SAR匹配成像數(shù)據(jù)以及合成孔徑雷達中頻采樣后高速海量數(shù)據(jù)的存儲問題，介紹了一種基于FPGA控制的NAND Flash數(shù)據(jù)存儲及回放系統(tǒng)設計方案。實驗證明,該系統(tǒng)能以3 Gb/s碼流實時存儲數(shù)據(jù)具有強實時性，且性能穩(wěn)定，有很好的工程使用價值。
- 關鍵字： 合成孔徑雷達 海量數(shù)據(jù)存儲 FPGA
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